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NVMe 这三个字母现在几乎成了高性能存储的代名词，但真要动手写一个能跑起来的 NVMe 驱动，很多人第一反应是发怵——协议文档上千页，队列机制、命令集、寄存器操作一大堆，从哪下手？我当初也是这么想的，直到把整条链路从 PCIe 枚举一路啃到块设备注册，才发现它其实是一条设计得相当规整的路径：PCIe 负责把设备"找出来"，NVMe 控制器负责"管队列"，块层负责"接上层"，三段拼起来就是一个完整驱动。这篇内容就是把这套路径拆开讲清楚，适合想入门复杂存储驱动、又不想被协议文档劝退的开发者，也适合做嵌入式、内核、固件方向、需要理解 NVMe 从硬件到系统全链路的朋友。

1. 为什么 NVMe 是复杂存储驱动入门的最佳样本

1.1 它踩在了三条主线的交汇点上

选一个驱动作为"复杂存储驱动入门"，最怕的是它太偏门——学完只会这一个设备，换个场景全废。NVMe 恰好相反，它同时踩在 PCIe、块设备、队列模型三条主线上，学一遍等于把内核存储栈的骨架过了一遍。

第一条线是PCIe。NVMe 设备在系统眼里首先是一个 PCIe 设备，你得先让内核通过 PCIe 枚举把它认出来，读到它的 BAR 空间，拿到寄存器基地址。这一步是所有 PCIe 设备驱动的通用流程，学 NVMe 顺带就把 PCIe 驱动的 probe 流程摸熟了。

第二条线是块设备层。NVMe 最终要暴露成一个块设备（比如/dev/nvme0n1），上层文件系统、页缓存都通过块层跟它打交道。你要处理请求队列、bio、完成回调，这套东西是内核存储栈的核心。

第三条线是队列与并发模型。NVMe 最标志性的设计就是多队列——每个 CPU 核可以有自己的提交队列和完成队列，彻底甩掉了传统单队列的锁竞争。理解这套模型，对理解现代高性能驱动怎么榨干多核性能极有帮助。

三条线交汇，意味着你写一个 NVMe 驱动，实际上是在练"PCIe 设备驱动 + 块设备驱动 + 高性能队列设计"三件事。这就是它作为入门样本的价值。

1.2 和传统 SATA/AHCI 驱动比，它到底复杂在哪

很多人会问：SATA 驱动也是存储驱动，为什么不从 SATA 入门？我的体会是，SATA/AHCI 的复杂度更多藏在"历史包袱"里——它要兼容 IDE 时代的寄存器模型，命令下发走的是任务文件（Task File）那一套，队列深度只有 32，还是单队列。你学它，学到的是一堆兼容性设计，而不是现代存储的思路。

NVMe 则是"从零设计"的产物，没有历史包袱。它的命令集是干净的 64 字节定长命令，队列是标准的环形队列，寄存器布局规整。复杂度是"结构性的复杂"，而不是"历史性的复杂"。结构性复杂的好处是：每一块都能单独拆出来理解，拼起来逻辑自洽。

这张表不是要贬低 SATA，而是说明：如果你目标是理解"现代高性能存储驱动长什么样"，NVMe 是更直接的样本。

1.3 入门门槛到底卡在哪几个点

说实话，NVMe 驱动入门的门槛不在协议本身，协议文档虽然厚，但核心就那几章。真正卡人的是三个点。

第一个是PCIe 那一段的"黑盒感"。很多人写驱动时，PCIe 枚举、BAR 映射、MSI-X 配置这些是内核帮你做好的，你只管在 probe 函数里拿资源。但一旦出问题——比如设备没被枚举到、BAR 映射失败——你就懵了，因为不知道内核在背后做了什么。所以理解 PCIe 枚举过程是绕不开的。

第二个是队列的内存布局。NVMe 的提交队列和完成队列是驱动和控制器共享的内存，谁分配、谁写、怎么写、内存屏障怎么加，这些细节协议里写了但很容易看漏，漏了就是各种玄学 bug。

第三个是中断与轮询的取舍。NVMe 支持中断驱动也支持轮询，实际驱动里两者混用，什么时候用哪个、怎么切换，是性能调优的关键。

把这三个点啃下来，剩下的就是体力活了。

2. 从 PCIe 枚举到 BAR 映射：设备是怎么被"认出来"的

2.1 PCIe 枚举过程：内核在背后做了什么

当你把一块 NVMe 固态插到主板上，上电之后内核能"看到"它，靠的是 PCIe 枚举。这个过程简单说就是：系统从根复合体（Root Complex，RC）出发，逐级扫描总线，给每个设备分配总线号、设备号、功能号，读取配置空间，识别设备类型。

配置空间里有几个关键字段：Vendor ID、Device ID、Class Code。NVMe 设备的 Class Code 是0x010802（Mass Storage Controller / NVM Express）。内核的 PCIe 子系统扫到这个 Class Code，就会去匹配对应的驱动。如果你在写驱动，注册时用pci_device_id表声明你支持的 Vendor/Device ID 或 Class，内核匹配上就会调用你的 probe 函数。

这里有个容易忽略的点：枚举顺序和 EP/RC 启动顺序有关。热词里有人问"pcie ep 先启动还是 rc 先启动"，这在实际调试里很关键。标准流程是 RC 先完成枚举，再去配置 EP。如果 EP 上电比 RC 慢，RC 枚举时可能读不到设备，导致设备"消失"。有些平台会做延迟枚举或重新扫描来规避，但如果你自己写裸机驱动，这个时序必须自己保证。

2.2 BAR 空间：驱动和控制器对话的窗口

设备被认出来之后，驱动要拿到跟它通信的窗口，这就是 BAR（Base Address Register）。NVMe 控制器把它的寄存器暴露在某个 BAR 里，通常是 BAR0。驱动通过pci_iomap或ioremap把这个 BAR 映射到内核虚拟地址空间，之后读写寄存器就是读写这段内存。

NVMe 的寄存器分两类：控制器寄存器和队列寄存器。控制器寄存器包括 CAP（能力）、VS（版本）、CC（配置）、CSTS（状态）、AQA（队列属性）等，是全局的。队列寄存器则是每个队列一对，包括提交队列基地址、完成队列基地址、门铃寄存器等。

映射 BAR 时有个坑：BAR 的大小和类型要先读出来。你不能假设 BAR0 一定是多大，得先读 BAR 的低位判断是内存空间还是 IO 空间，再读高位拿到基地址，最后用pci_resource_len拿到长度。如果映射长度不对，访问越界就是内核崩溃。

/* 典型的 BAR 映射流程（内核驱动视角） */ bar = pci_resource_start(pdev, 0); len = pci_resource_len(pdev, 0); if (!request_mem_region(bar, len, "nvme")) { return -EBUSY; } regs = ioremap(bar, len); if (!regs) { release_mem_region(bar, len); return -ENOMEM; }

这段代码看着简单，但每一步都有讲究。request_mem_region是声明这块物理内存归我管，防止别的驱动抢；ioremap是建立虚拟地址映射。少了任何一步，要么资源冲突，要么访问非法。

2.3 MSI-X 中断配置：多队列的物理基础

NVMe 的多队列要发挥威力，中断必须支持多向量，这就是 MSI-X。传统 MSI 只支持最多 32 个向量，而且共享一个地址；MSI-X 支持最多 2048 个向量，每个向量有自己的地址和数据，可以精确路由到不同 CPU。

配置 MSI-X 的流程是：先读设备的能力寄存器确认支持多少个向量，然后调用pci_alloc_irq_vectors申请，拿到向量号之后，把每个队列的中断向量号写进控制器的队列配置里。这样当某个队列有完成事件时，控制器就发对应的 MSI-X 中断，内核直接路由到绑定的 CPU 上处理。

提示：MSI-X 向量数不是越多越好。实际驱动里通常按 CPU 核数来申请，比如 8 核就申请 8 个 IO 队列加 1 个管理队列。申请太多会浪费中断资源，申请太少又发挥不了多核优势。

这里还有个细节：中断亲和性。默认情况下中断可能都落在 CPU0 上，导致单核打满。你需要在申请向量后用irq_set_affinity_hint把每个队列的中断绑到对应 CPU，才能真正做到"每个核处理自己的队列"。

3. NVMe 控制器初始化：从复位到就绪的完整链路

3.1 控制器复位与 CC 寄存器的使能序列

设备认出来了、BAR 映射好了、中断配好了，接下来要让控制器进入工作状态。NVMe 规范里定义了一个明确的状态机，驱动要按顺序操作 CC（Controller Configuration）和 CSTS（Controller Status）寄存器。

第一步是禁用控制器。写 CC.EN = 0，然后等 CSTS.RDY = 0，确认控制器已经停了。这一步在初始化时做，是为了保证从一个干净状态开始。

第二步是配置管理队列。管理队列（Admin Queue）是驱动和控制器通信的第一条通道，用来发识别命令、创建 IO 队列等。你要先把管理队列的基地址、长度写进 AQA（Admin Queue Attributes）和 ASQ/ACQ 寄存器。

第三步是使能控制器。写 CC.EN = 1，然后轮询等 CSTS.RDY = 1。这个等待不能死等，要有超时。规范建议的超时时间跟 CAP.TO 字段有关，实际驱动里通常给一个足够大的固定值，比如几秒。

/* 使能控制器的核心序列 */ writel(0, regs + NVME_CC); /* 先禁用 */ while (readl(regs + NVME_CSTS) & NVME_CSTS_RDY) ; /* 等 RDY 清零 */ /* ... 配置 AQA / ASQ / ACQ ... */ writel(cc_value | NVME_CC_EN, regs + NVME_CC); while (!(readl(regs + NVME_CSTS) & NVME_CSTS_RDY)) { if (timeout--) return -ETIMEDOUT; udelay(1); }

这段序列里，顺序不能乱。必须先禁用再配置，配置完再使能。我见过有人直接写 EN=1 就以为完事了，结果控制器状态一直是 RDY=0，因为前面的配置根本没生效。

3.2 管理队列的建立与 Identify 命令

控制器就绪之后，第一件事是发 Identify 命令，把控制器的能力、命名空间信息读回来。Identify 命令走管理队列，命令结构是 64 字节，包含操作码、命名空间 ID、数据缓冲区地址等字段。

管理队列的建立要注意内存对齐。提交队列和完成队列的基地址必须按页对齐（通常是 4KB），队列深度写在 AQA 里，实际深度是写入值加一。完成队列的每个条目是 16 字节，提交队列每个条目是 64 字节，分配内存时要按这个算准。

发 Identify 命令的流程是：在提交队列里填一个命令条目，更新提交队列尾门铃（Tail Doorbell），然后等完成队列里有条目，读出来看状态。这里有个关键点：门铃寄存器是 MMIO 写，写完要保证顺序，通常需要加内存屏障，否则可能出现命令还没写完门铃就响了的情况。

Identify 返回的数据里，最有用的是Identify Controller和Identify Namespace。前者告诉你控制器支持多少队列、队列深度多大、支持哪些命令；后者告诉你命名空间的大小、逻辑块大小、支持的读写命令等。这些信息是后续创建 IO 队列和注册块设备的基础。

3.3 IO 队列的创建与队列深度选择

管理队列只有一条，真正干活的是 IO 队列。NVMe 的多队列设计允许你创建多条 IO 队列，每条绑定一个 CPU 核。创建 IO 队列用Create IO Completion Queue和Create IO Submission Queue两条管理命令，先建完成队列再建提交队列。

队列深度怎么选？这取决于 CAP 寄存器里报告的最大队列深度（MQES）和你自己的需求。深度越大，能同时挂起的命令越多，吞吐越高，但占用的内存也越多。实际驱动里通常取一个折中值，比如 1024。对于消费级固态，1024 的深度已经足够跑满带宽；对于企业级高并发场景，可以往 4096 甚至更大调。

内存占用是按提交队列 64 字节/条目加完成队列 16 字节/条目算的，再乘上队列数。8 条 1024 深度的队列，光队列内存就 640KB 左右，这在现代系统里不算什么，但在内存紧张的嵌入式环境要掂量一下。

注意：创建 IO 队列时，完成队列的中断向量号要跟前面申请的 MSI-X 向量对应上。如果你申请了 8 个向量，就创建 8 条 IO 队列，每条绑一个向量。绑错了会导致中断收不到，命令永远等不到完成。

4. 提交与完成：NVMe 命令的生命周期拆解

4.1 提交队列的环形结构与门铃机制

NVMe 的提交队列是一个环形缓冲区，驱动往里写命令，控制器从里读命令。队列有两个指针：头指针（Head）和尾指针（Tail）。驱动只动尾指针，控制器只动头指针。驱动写完一个命令，把尾指针加一，然后写门铃寄存器通知控制器；控制器处理完，把头指针加一。

这个"驱动动尾、控制器动头"的设计很巧妙，避免了双方同时改同一个指针的竞争。但有个细节：尾指针回绕。队列是环形的，尾指针加到队列深度就回绕到 0。回绕的时候要保证控制器已经把前面的命令都处理完了，否则会覆盖未处理的命令。实际驱动里通过跟踪未完成命令数来避免这个问题。

门铃寄存器的写也有讲究。门铃是 MMIO，写的时候要保证前面的命令数据已经写入内存并对控制器可见。这需要内存屏障：

/* 提交命令并敲门铃 */ memcpy(sq->entries + sq->tail, &cmd, sizeof(cmd)); wmb(); /* 保证命令写入对设备可见 */ sq->tail = (sq->tail + 1) % sq->q_depth; writel(sq->tail, sq->q_db); /* 写门铃 */

少了wmb()，在某些弱内存序架构（比如 ARM）上，可能出现门铃先到、命令后到的情况，控制器读到一个空命令，直接报错。

4.2 完成队列的相位位与轮询逻辑

完成队列也是环形，但它的同步机制更巧妙——用相位位（Phase Bit）。完成队列的每个条目里有一个相位位，初始时所有条目的相位位是 0。控制器写完成条目时，会把相位位设成当前相位值；驱动读条目时，检查相位位是否等于自己期望的值，相等说明这个条目是新的。

驱动维护一个"当前相位"变量，初始为 1（因为控制器第一次写完成条目时会把相位位从 0 翻到 1）。每读完一轮队列，相位翻转一次。这样驱动不需要额外的计数器就能判断条目新旧，非常优雅。

/* 轮询完成队列 */ while (1) { struct nvme_completion *cqe = &cq->entries[cq->head]; if ((cqe->status & NVME_CQ_PHASE) != cq->phase) break; /* 没有新完成 */ /* 处理 cqe */ cq->head = (cq->head + 1) % cq->q_depth; if (cq->head == 0) cq->phase ^= 1; /* 回绕时翻转相位 */ }

这个相位位机制是 NVMe 的精髓之一，理解了它，你就理解了为什么 NVMe 不需要复杂的锁就能做到高效同步。

4.3 读写命令的字段填充与数据搬运

读写命令是 NVMe 最常用的命令。一条读命令要填的字段包括：操作码（0x02 读 / 0x01 写）、命名空间 ID、起始逻辑块地址（SLBA）、逻辑块数量（NLB）、数据缓冲区地址（PRP 或 SGL）。

数据搬运是 NVMe 驱动里最需要小心的地方。NVMe 用 PRP（Physical Region Page）或 SGL（Scatter Gather List）描述数据缓冲区。PRP 适合简单的连续或两段式缓冲区，SGL 适合复杂的分散缓冲区。对于块设备驱动，通常用 PRP 就够了。

PRP 的规则是：如果数据在一个页内，PRP1 指向这个页，PRP2 为 0；如果数据跨两页，PRP1 指向第一页，PRP2 指向第二页；如果跨更多页，PRP1 指向一个 PRP 列表，列表里再指向各个页。这个规则看着简单，但实际算的时候容易错，尤其是页边界对齐的情况。

提示：调试读写命令时，最常见的错误是 PRP 地址算错导致数据错乱，或者 NLB 字段填的是"块数减一"而不是"块数"。NVMe 规范里 NLB 是 0 基的，填 0 表示读 1 个块，这个跟很多人的直觉相反。

5. 块设备注册：让 NVMe 对上层的文件系统可见

5.1 命名空间与块设备的映射关系

NVMe 的存储空间按"命名空间"划分，一个控制器可以有多个命名空间，每个命名空间对应一个独立的地址空间。对上层来说，每个命名空间就是一个块设备，比如/dev/nvme0n1是第一个控制器的第一个命名空间，/dev/nvme0n1p5就是它的第 5 个分区。

这里回答一个热词里的问题：/dev/nvme0n1p5确实表示第 1 个 NVMe 硬盘的第 5 个分区。命名规则是nvme<控制器号>n<命名空间号>p<分区号>。控制器号从 0 开始，命名空间号从 1 开始，分区号从 1 开始。所以nvme0n1是控制器 0 的命名空间 1，p5是第 5 个分区。

注册块设备时，驱动要填一个gendisk结构，设置容量、逻辑块大小、请求队列等。容量从 Identify Namespace 返回的数据里拿，逻辑块大小通常是 512 或 4096 字节。请求队列用blk_mq多队列框架，每个硬件队列对应一条 IO 队列。

5.2 请求队列与多队列的对接

块层的多队列框架（blk-mq）跟 NVMe 的多队列是天然匹配的。blk-mq 把软件队列映射到硬件队列，每个 CPU 的请求最终落到对应的硬件队列上，由 NVMe 驱动提交给控制器。

对接的关键是设置tag_set和queue_map。tag_set告诉块层每个硬件队列有多少个 tag（对应 NVMe 的队列深度），queue_map告诉块层哪个 CPU 用哪个硬件队列。设置好了之后，块层会自动把请求分发到正确的队列。

/* 设置 blk-mq 的 tag 集合 */ tag_set->ops = &nvme_mq_ops; tag_set->nr_hw_queues = nr_io_queues; tag_set->queue_depth = q_depth; tag_set->numa_node = dev_to_node(dev); tag_set->flags = BLK_MQ_F_SHOULD_MERGE; blk_mq_alloc_tag_set(tag_set);

BLK_MQ_F_SHOULD_MERGE这个标志是允许块层合并相邻请求，能减少命令数、提升吞吐。但合并也有代价，会增加 CPU 开销。对于高性能 NVMe，有时候反而关掉合并、让每个请求独立下发更快，这取决于具体负载。

5.3 完成回调与上层唤醒

请求提交下去之后，完成时驱动要通知块层。NVMe 的完成处理通常在中断里做：读完成队列，找到对应的请求，调用blk_mq_complete_request通知块层。块层再唤醒等待的进程或触发下一个请求。

这里有个性能关键点：完成处理尽量在中断上下文里做完，不要丢到工作队列。因为 NVMe 的完成处理很轻量，就是读个条目、标记请求完成，放到工作队列反而增加延迟。但如果完成处理里要做复杂操作（比如错误恢复），那就得丢到工作队列，避免中断上下文里做耗时操作。

注意：完成回调里访问请求结构要小心并发。虽然每个请求只完成一次，但块层可能在别的 CPU 上同时操作这个请求。用blk_mq_complete_request而不是直接操作请求结构，能避免大部分并发问题。

6. 调试实战：那些协议文档不会告诉你的坑

6.1 设备枚举不到：从 PCIe 链路查起

设备插上了，lspci却看不到，这是最常见的入门问题。排查顺序应该是：先看物理链路，再看枚举配置，最后看驱动匹配。

物理链路层面，检查供电、时钟、复位信号。热词里有人问"pcie 时钟需要对地电容吗"，这其实是硬件设计问题——参考时钟通常需要匹配电容，但具体值要看平台设计，不是驱动能解决的。驱动层面能查的是：链路是否训练成功（读 Link Status 寄存器）、设备是否上电（读 Power Management 寄存器）。

枚举配置层面，检查 RC 是否完成了枚举。有些平台需要手动触发重新扫描，比如往/sys/bus/pci/rescan写 1。如果重新扫描后设备出现，说明是枚举时序问题，可能是 EP 上电太慢。

驱动匹配层面，检查lspci -nn看到的 Vendor/Device ID 是否在你的驱动支持列表里。如果设备出现了但驱动没绑定，多半是 ID 没匹配上。

6.2 命令超时：队列配置与中断路由排查

控制器使能了，命令发下去了，但一直等不到完成，最后超时。这种问题通常出在两个地方：队列配置错了，或者中断没路由对。

队列配置排查：确认提交队列和完成队列的基地址是按页对齐的，队列深度跟 AQA 里写的一致，门铃寄存器的偏移算对了。我踩过一次坑，门铃偏移算错了一个队列的大小，结果所有命令都敲到了错误的门铃上，控制器根本没收到。

中断路由排查：确认 MSI-X 向量申请成功，每个队列的中断向量号写对了，中断亲和性设置正确。可以在/proc/interrupts里看中断计数，如果某个队列的中断计数一直是 0，说明中断没到。这时候要检查 MSI-X 的配置，或者临时改成轮询模式验证队列本身是否工作。

6.3 性能不达标：从队列深度到中断合并逐层调

驱动跑通了，但性能只有标称的一半，这种问题最磨人。调优要一层一层来。

先看队列深度。深度太小，命令挂不满，带宽上不去。用fio压测时观察队列利用率，如果一直满，说明深度不够，往上调。

再看中断合并。NVMe 支持中断合并（Interrupt Coalescing），可以设置"多少个完成事件触发一次中断"或"多长时间触发一次中断"。合并能降低中断开销，但增加延迟。高吞吐场景可以激进合并，低延迟场景要保守。

最后看 CPU 亲和性。确认每个队列的中断绑到了不同的 CPU，且这些 CPU 没有被其他任务占满。用mpstat看各核利用率，如果只有一个核在跑，说明亲和性没生效。

# 查看 NVMe 设备的中断分布 cat /proc/interrupts | grep nvme # 查看各 CPU 利用率 mpstat -P ALL 1

调优是个迭代过程，每次只改一个参数，压测对比，找到瓶颈再改下一个。别一次改一堆，否则出了问题不知道是哪个参数导致的。

7. 从能跑到跑好：NVMe 驱动进阶的几个方向

7.1 轮询模式与中断模式的混合使用

NVMe 支持纯轮询模式（Polling），驱动不依赖中断，直接轮询完成队列。轮询的延迟比中断低，因为没有中断上下文切换的开销，但代价是占满一个 CPU 核。所以实际驱动里通常是混合模式：低负载用中断省 CPU，高负载切轮询降延迟。

Linux 内核里的 NVMe 驱动支持通过io_poll参数开启轮询。开启后，块层在提交请求后会先轮询一小段时间，如果完成得快就直接处理，不用等中断；如果没完成再退回中断模式。这个"先轮询后中断"的策略在延迟敏感场景很有效。

7.2 多路径与命名空间共享

企业级场景里，一个 NVMe 命名空间可能通过多条路径暴露给主机（比如双端口盘、PCIe Switch 拓扑）。多路径驱动要处理路径选择、故障切换、负载均衡。这部分复杂度比单路径高一个量级，但理解了单路径的队列和命令机制，多路径只是在上层加了一层路径管理。

热词里有人问"pcie switch"和"双卡 v100 pcie"，这些场景下多路径和拓扑理解就很重要。PCIe Switch 会把设备挂到下游端口，枚举时多一层，驱动要能处理这种嵌套拓扑。

7.3 错误处理与恢复流程

NVMe 的错误处理分几个层次：命令级错误（比如非法字段）直接返回给上层；队列级错误（比如队列故障）要重建队列；控制器级错误（比如固件崩溃）要复位控制器甚至重新初始化。

控制器复位是最复杂的，要先把所有未完成的请求标记失败，禁用控制器，重新初始化，再恢复队列。这个过程里最怕的是复位时还有请求在飞，导致状态不一致。规范里定义了复位流程，但实际实现时要加很多状态检查。

提示：调试错误恢复时，可以用内核的 fault injection 框架人为注入错误，验证恢复流程。这比等真实故障靠谱得多，也能覆盖到平时跑不到的代码路径。

8. 写在最后：我踩过的几个真实坑

第一个坑是相位位初始值搞反。我一开始以为相位位初始是 0，结果驱动永远读不到完成条目，因为控制器第一次写的是 1。这个 bug 卡了我大半天，最后对着规范一行一行看才找到。相位位的初始值跟控制器的实现有关，但标准行为是驱动期望 1、控制器写 1，回绕后翻转。

第二个坑是门铃写没有加屏障。在 x86 上跑得好好的，换到 ARM 平台就随机超时。原因是 ARM 是弱内存序，命令数据还没写到内存，门铃就先到了。加了wmb()之后问题消失。这个坑让我深刻理解了内存屏障不是可选项。

第三个坑是队列深度和 tag 数不匹配。blk-mq 的 tag 数设成了 1024，但 NVMe 队列深度只建了 256，结果块层往队列里塞了超过 256 个请求，驱动提交时越界。这个问题的现象是随机崩溃，很难定位。后来把两者对齐就好了。

第四个坑是中断亲和性没设。默认所有中断都落在 CPU0，8 核机器只有一个核在干活，性能只有预期的八分之一。用irq_set_affinity_hint把中断分散到各核之后，性能直接翻了几倍。这个坑最隐蔽，因为功能完全正常，只是慢。

这些坑的共同点是：协议文档里都写了，但写得太简略，不踩一次根本不会注意到。所以我的建议是，看文档的同时一定要动手跑，跑通了再回头对照文档，很多细节才会真正理解。NVMe 驱动看着复杂，但拆成 PCIe 枚举、控制器初始化、队列管理、块设备注册这几块之后，每一块都是可以独立啃下来的。啃完这一遍，你对内核存储栈的理解会上一个大台阶。