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做开关电源这么多年，最怕听到的一句话就是：“EMC没过，改板吧。”一提到EMC不过关，很多人的第一反应是加磁环、换共模电感、加大吸收电容，结果滤波器件堆了一堆，测试曲线纹丝不动，甚至更差。后来我终于想明白一件事：开关电源的EMC问题，本质上是设计问题，而不是补救问题。真正决定一台电源能不能过测的，不是你最后堆了多少颗磁珠，而是PCB布局布线和变压器的内部结构。

这篇东西写给正在跟EMC死磕的电源工程师、硬件工程师、PCB设计工程师，哪怕你是刚接触反激式开关电源的小白，也能跟着把“噪声从哪来、走哪条路出去、怎么堵住它”这条线理顺。核心就一句话：把PCB的高频环路画小，把变压器的共模通道堵住，EMC问题能解决一大半。

1. 开关电源EMC不过关，先搞清楚噪声是怎么跑出去的

1.1 EMC测试到底在测什么：传导和辐射是两条不同的路

EMC的测试项很多，对开关电源来说，最常挂的就是两个：传导发射（CE）和辐射发射（RE）。传导发射测的是150kHz到30MHz频段，通过电源线传导出去的噪声。测试时设备通过一个叫LISN（线性阻抗稳定网络）的东西供电，LISN里面有两个50Ω的电阻，专门负责“接收”从设备电源线上流回来的噪声电流，然后送到接收机里去量电压。所以传导噪声的本质是：你设备产生的噪声电流，顺着电源线流回了电网，而LISN在电网和你的设备之间，抓了个正着。

辐射发射则分两个频段，常规是30MHz到1GHz，测的是设备像天线一样往外“广播”的电磁能量。这里要注意，辐射发射跟传导发射在物理机理上完全不同：传导是“导线上的电流”，辐射是“空间中的场”。但很多噪声源是同一个，只是传播途径不一样，一条路是跟着电缆走出去的，另一条路是透过空间直接怼出去的。

新工程师最容易犯的错就是把这两件事混在一起处理。看到传导超标就去加共模电感，看到辐射超标就去加屏蔽罩，完全不考虑噪声本质上是被PCB上的环路“发射”出去的，还是被变压器里的分布电容“耦合”出去的。方向错了，后面全是白忙。

1.2 噪声源头：开关动作产生的dv/dt和di/dt才是元凶

开关电源为何天生就是EMC“刺头”？因为它的工作原理就是不断高速开关。以最常见的反激式开关电源为例，MOS管以几十到几百千赫的频率高速导通和关断，开关节点上的电压在极短的时间内（几十纳秒）从0V跳到几百伏。这个极高的电压变化率dv/dt，会通过一切存在的寄生电容去“冲击”周围的东西。

同时，电流也在瞬间切换。MOS导通时，输入电容通过变压器初级和MOS形成一个电流回路，电流变化率di/dt极高；MOS关断时，变压器的漏感会立刻产生一个电压尖峰，这个振铃电流不仅会造成开关损耗，更会通过环路和走线向外辐射能量。还有个容易忽略的点：二极管的反向恢复电流。输出整流二极管从导通切换到截止时，存储的电荷要释放，这个反向恢复过程会产生一个尖锐的电流脉冲，频域上可以延展到几十甚至上百MHz，辐射超标的“元凶”经常是它。

这些噪声的特点是：频带宽、能量集中在开关沿的谐波上。所以你会看到传导测试曲线在开关频率的各次谐波处出现一个个“尖刺”，而辐射曲线则往往在某个频点出现“坨状”包络——那就是某个寄生回路的谐振峰。只要理解了这两个基本源头，后面所有对策都是围绕“减小dv/dt作用的寄生电容”和“减小di/dt作用的环路面积”展开的。

1.3 为什么说PCB和变压器才是核心问题

噪声源头是开关动作，这是工作原理决定的，改不了。你能改的只有噪声的“出口”。PCB上的走线和环路，本质就是一根根天线。任何一段走线，只要有高频电流流过，并且形成了闭合回路，这个回路就会向外辐射电磁波。环路面积越大，辐射效率越高，这跟天线一模一样。

变压器更不用说了，它是开关电源里最复杂的EMC元件。一方面，绕组之间存在分布电容，原边高压开关节点的dv/dt会通过这些电容直接耦合到副边，形成共模电流；另一方面，变压器的漏感和分布电容会形成谐振回路，产生振铃，这个振铃的能量是宽带的，可以轻松穿透屏蔽罩。所以可以说，一台开关电源的EMC性能，在PCB布局定稿、变压器绕制结构定下来的那一刻，就已经基本确定了。后面加再多滤波器件，都是在跟已经产生的噪声“搏斗”，事倍功半。

2. PCB布局布线：把高频环路画小，等于消灭一半天线

2.1 反激电源的两大高频环路：面积越小，辐射越弱

每一款开关电源，不管拓扑是什么，都至少有两个高频电流环路。对反激式开关电源来说，第一个是“热开关环路”：从输入滤波电容正极出发，经过变压器初级绕组，再经过MOS管，回到输入滤波电容负极。这个回路在MOS导通瞬间流过极大的脉冲电流，di/dt极快，而且开关节点（MOS漏极）的电压跳变极大，是整个电源里噪声最暴力的地方。

这个环路的面积，几乎决定了共模辐射的地板。我们做过一个很直接的对比：把输入端的电解电容和一颗100nF的陶瓷电容从板边挪到紧靠MOS管的漏极附近，环路面积缩小了一半左右，30MHz以上频段的辐射发射普遍降了10到15dB，这个改善比加任何磁珠都来得明显。所以强制要求：输入端的储能电容和陶瓷电容，必须尽量靠近MOS漏极和变压器初级引脚，用最短、最宽的走线连接，把电流路径“压扁”。

第二个是“次级整流环路”：从变压器次级绕组出发，经过整流二极管，到输出滤波电容，再回到变压器次级绕组的另一端。这个环路的特点是电流跳变幅度大（负载电流直接切换），而且二极管的结电容和反向恢复电流会让它产生高频振铃。同样，把输出电容和二极管尽量靠近变压器次级引脚，用铺铜而不是细走线来连接，环路面积控制住之后，你甚至能发现输出电压纹波都变好了。

这里有一个实操检查方法：设计完PCB之后，在软件里高亮这几条网络，把走线显示的路径闭环出来看一遍，凡是形成一个“大圈”的，都是潜在的辐射天线。正常应该做到让这个闭环的面积控制在手指甲盖大小以内。做不到的话，请先别急着谈EMC整改。

2.2 敏感信号的回流路径：驱动、采样、反馈都要有完整参考地

高频电流一定会走最小阻抗路径，这个“最小阻抗路径”指的不只是走线本身，还包括它的回流路径。很多新手在布PCB时只顾着把信号线画通，完全不看信号电流的“回头路”走的是哪个地回路。结果就是，驱动脉冲从控制IC出来，一路从MOS栅极返回，而它的回流电流被迫绕了一大圈，穿过别的敏感区域，把噪声带到四面八方。

开关电源里最需要保护的三类信号：MOS管驱动信号、电流采样信号、反馈环路信号。驱动信号的回路是栅极到源极这个闭环，电流采样信号是从采样电阻到IC的CS引脚，反馈信号是从输出电压采样点到IC的FB引脚。所有这些信号的地，都必须在IC的参考地（通常是IC下方的地焊盘）处形成一个星形汇聚，不要跟功率级的脉冲电流共享一条地线。

网上关于“PCB地与金属壳体之间加一个大电容到底有没有用”的争论，本质上也是回流路径问题：这个电容作用在于给共模电流提供一条低阻抗的旁路，减少共模电流流经测试系统的路径长度。有效的前提是，你要想清楚共模电流的源头是哪里、路径是什么、要把它引到哪里去。一会儿我在2.3节单独展开。

四层板的信号完整性往往比两层板好一个数量级，核心原因就是：有完整的地平面给所有信号提供了紧贴的回流路径。如果你有条件用四层板，强烈建议信号层下方一定保持地平面完整，不要为了走线方便把地平面切割得支离破碎。一片完整的铜皮，就是一根完美的回流“高速公路”。

2.3 PCB地与金属壳体之间的大电容到底有没有用

这个问题我在社区里看到过很多次，也亲手验证过。答案是：有用，但用错位置和容量，不仅没用，还会造成新的问题。这个电容在电源系统里的角色，通常是一个“Y电容”的变体，连接在PCB的参考地（或者输入母线的地）和金属外壳之间，目的是给共模噪声提供一个低阻抗的回流路径。

先讲共模电流是怎么流出去的。以反激电源为例：MOS漏极上的高压跳变，通过变压器原副边之间的分布电容，把能量耦合到次级绕组上，导致次级系统的电压相对于参考地出现了高频扰动。这个“扰动”推着电流流向次级的地、输出电缆、设备外壳，最后一路流到测试系统的参考地，穿过LISN的50Ω电阻，再沿着电源线的地线流回初级侧。结果就是你看到的传导测试曲线超标。

那PCB地和壳体之间加个电容，其实就是想在壳体这个“汇合点”给共模电流开一条近路：让它直接从PCB参考地流回初级源的静端，而不是流到LISN那边被“抄录”。这个思路是对的。但实际操作里有两个必须注意的坑。

第一是电容的容量不能贪大。这个电容会跟变压器的分布电容以及电缆的杂散电容形成一个谐振回路，容量选得过大，励磁电流变大、谐振频率被压低，反而可能把低频段的传导噪声放大。实践中几百皮法到几个纳法比较常见，我习惯从470pF开始试，不够再加到2.2nF，但很少用超过4.7nF。

第二是电容的安装位置决定了它的有效性。电容的两个引脚要尽量短，并且要接到PCB上“真正的初级参考静点”上，比如输入滤波电容的负极附近，而不是随手接到一块不知名的地铜皮上。有些板子里，明明加了Y电容却没效果，就是因为它的回流路径绕了一大圈，等效于没加。还有一类情况，如果电源是浮地结构（比如适配器次级是浮地的），Y电容接到次级地和壳体时，要注意安规要求，容量大了漏电流会超标，这在医疗电源等领域甚至可能直接违规。

2.4 四层板层叠和布线规则：把地和功率平面安排明白

现在很多中小功率的开关电源已经从两层板转向四层板，原因很简单：成本增量有限，EMC收益巨大。四层板的核心优势就一个——可控的层间距和完整的地平面/功率平面。推荐层叠方案：Top（器件和小信号走线），Layer2（完整地平面），Layer3（功率走线和电源平面），Bottom（辅助信号和铺铜）。把地层放在紧贴Top信号层的第二层，可以让所有顶层走线都有最近的回流参考面。

层叠厚度方面，常规1.6mm的板厚，四层常用的组合是：Top到地平面（半固化片）0.2mm左右，地平面到功率层（芯板）1.1mm左右，功率层到底层（半固化片）0.2mm左右。重点在于：把地平面尽可能靠近顶层信号/功率器件，这样顶层的高频电流能快速“镜像”回流，辐射效率显著下降。

布线规则上，几条硬经验分享：

• MOS管的漏极走线（也就是变压器初级到漏极的走线）尽量短、尽量宽，最好直接铺铜，因为上面有高频振铃电压，走线越长越像天线；
• 所有反馈、采样、驱动信号，严禁走成细长线穿过功率环路内部；
• 螺丝孔周围要留禁布区，避免螺丝孔把地平面短路到机壳，形成不希望的地环路；
• 对于功率地和小信号地，最终只允许在IC的地焊盘或者输入电容负极处一个点连接，避免“地线变成天线”。

3. 变压器：EMC的另一个重灾区，难点全在结构

3.1 变压器等效电路：漏感和分布电容是怎么“作妖”的

很多工程师画变压器时只关心匝比和感量，完全不看等效电路里的寄生参数，这其实是走了大弯路。一个实际的变压器，等效电路里除了理想变压器以外，至少还串着几个坏东西：初级漏感Llk、绕组电阻、原边和副边之间的分布电容Cps，以及每一层绕组之间的层间电容。

漏感的害处是产生电压尖峰：MOS关断瞬间，漏感里的能量无处释放，就向MOS的寄生电容充电，形成振铃。这个振铃的电压跳变是宽带的，频率往往在几十到上百MHz，直接通过漏极走线往外辐射。分布电容的害处则是给共模电流架桥：原副边之间即使隔着绝缘材料，物理上还是形成了一个微小电容。原边开关节点上的高压跳变，会通过这个电容直接“灌”到副边侧，让次级系统地跟着一起跳，共模电流就这样产生了。

这俩寄生参数有多 “狂”？我们曾经换过同一规格但绕制方式不同的变压器，EMC辐射值能差到20dB以上。拓扑、PCB一模一样，就变压器不一样，测出来一个天上一个地下。所以处理EMC问题时，变压器是优先级最高的嫌疑对象，因为它内部的电场和磁场耦合，是任何外部屏蔽都难以完全消除的。

3.2 共模电流最终回到了哪里：一条重要的回路

网上有个高频搜索问题：EMC共模电流最终回到哪里了？答案是：回到源端。任何电流都必须成环。共模电流从变压器的分布电容被“踢”到副边侧之后，它不会凭空消失，一定有回流路径。它通常沿着输出线缆流到负载端跨接的寄生电容，再流入测试系统的参考地平面，然后穿过LISN的50Ω电阻，通过电源线的地线回到原边的源极。这一路上它都要经过LISN，所以才会被接收机检测到、判定为超标。

理解了这条回路，你就能解释很多现象：为什么同样的电源，用不同长度的输出线测试，EMC结果差别很大？因为线缆相当于共模电流的“天线”，长度变了，谐振点就变了。为什么输出端加个共模电感有效？因为共模电感给共模电流提供了高阻抗，把回路“掐断”了。为什么变压器加屏蔽绕组有效？因为屏蔽层给共模电流提供了另一个低阻抗的回流路径，让它直接回到原边，而不去经过LISN。

所以“加Y电容”“加共模电感”“加变压器屏蔽层”其实是一回事：都在改变共模电流的回流路径，让它不要流过测试系统。这里的关键不是盲目堆器件，而是先判断噪声走的到底是哪条回路，再针对性地堵。

3.3 屏蔽绕组和三明治绕法：必须做选择，不能全都要

变压器绕组结构里，经典的三明治绕法和屏蔽绕组，是工程师最常用的EMC手段，但也是误解最多的地方。先讲三明治绕法：把次级绕组夹在初级绕组的中间段，比如初级分成两段，先绕初级的一半，然后绕次级，再把初级剩余一半绕在最外面。这么做的直接好处是初、次级耦合更紧，漏感明显减小，辐射峰值下降。但代价是：初级和次级之间的分布电容变大了，共模电流更容易跨过绝缘层传递。所以三明治绕法往往配合屏蔽层一起用，用屏蔽层把“耦合”变成“旁路”。

屏蔽绕组常见做法是，在原副边之间绕一层铜箔或一圈漆包线（宽度尽量覆盖整个绕组的宽度），然后引出一根线接到初级的参考静点。这个屏蔽层等于在初级和次级之间插了一面“静电墙”，初级的高压跳变先耦合到屏蔽层，再从屏蔽层直接回流到初级参考地，不会继续往次级传。关键点是屏蔽层的引出线必须接到初级静点（通常是母线电容负端附近），接错了地方，屏蔽层反而成了共模电流的“传递带”。

实践中的取舍原则是这样的：

• 漏感辐射占主导（中高频辐射尖峰明显，MOS尖峰电压高）：优先上三明治绕法，把漏感压下去；
• 共模传导占主导（低频传导超标，尤其开关频率附近）：优先上屏蔽绕组和Y电容，把共模回路切断；
• 如果两个问题都有：那就是三明治加屏蔽，先绕初级半段，再绕初级屏蔽层，再绕次级，再绕初级后半段。这种绕组结构在成品电源里非常常见，代价是工艺复杂、窗口利用率变低，设计时要提前算好磁芯窗口面积够不够用。

3.4 绕组引脚与起点终点处理：小细节决定大结果

再补一类容易被忽略的细节：绕组的起始端和结束端在哪里出线，也很影响EMC。原则上，连接到MOS漏极的那个绕组引脚（也就是高压跳变端）要尽量远离其他绕组的引脚和磁芯边缘，因为它是最强的电场辐射点。如果你把漏极引出线跨过整个绕组表面拉到对面引脚，等于在绕组上方架了一条天线。

另外，变压器的磁芯中间柱如果是开的，漏磁会从窗口往外散，会去“照射”PCB上的敏感走线。如果空间条件允许，用闭合磁芯，比如RM或PQ形状，比EE/EI形状的磁芯漏磁少，EMC更好。加磁芯接地铜箔也有效：有些变压器会在磁芯表面包一圈铜箔并接到初级静点，配合骨架本身的引脚，把磁芯外表面的电场干扰导走。但要小心铜箔别形成短路环，否则会在磁路里产生涡流发热。

4. 一次EMC整改实录：从测试曲线到落地改件，全程复盘

4.1 案例背景：一个5W反激适配器的传导和辐射双双超标

去年我经手一个5W的USB适配器项目，反激拓扑，开关频率65kHz，原边反馈架构。送到实验室一测，传导发射在150kHz到300kHz段整体高出限值6到8dB，辐射发射在100MHz附近有一个明显的“包”，高出限值约5dB。实验室的整改时间窗口只有两天，不能改版，只能在现有PCB上做零件调整和变压器返修。

这个案例非常有代表性：传导超标出现在低频段，基本可以锁定是共模电流的问题；辐射尖峰在100MHz附近，大概率是环路辐射加层间电容谐振。所以我的整改顺序是先看变压器结构，再看Y电容和输入滤波，最后才动吸收电路。

4.2 逐步定位问题：拆开变压器才看到真相

第一步，先用近场探头在板子上扫描，把磁场强度最大的位置定位。探头沿着MOS管到变压器初级那段走线附近移动，信号最强，说明高频环路确实太大了。拆掉在线测量用的电流探头夹在输入电源线上，又能测到很强的共模电流，频率跟辐射尖峰的频率对得上。

第二步，把变压器拆下来单独看绕线方式。这家的变压器为了方便生产，用的是最朴素的“先初级整段，再次级”的两层绕法，初级和次级之间没有屏蔽层，初级绕组的层间距离也比较大。这种结构漏感不算太大，但原副边分布电容不小，而且绕组的起始端离磁芯窗口边缘很近，电场直接往外面漏。这下问题全对上了：分布电容大导致共模电流大，绕组电场漏导致辐射尖峰。

4.3 具体整改措施与最终结果

两天时间，动手改了三处：

第一处，缩小PCB上的热开关环路。MOS管旁边的输入储能电容和陶瓷电容重新摆了下位置——原来的陶瓷电容在板子边角，离MOS管漏极有接近2cm的走线，挪到MOS管下方之后，漏极引线长度缩短了一半多。这个动作只花了一个小时，辐射峰值肉眼可见地下降了约4dB。

第二处，返修变压器结构，改成了“初级半段+屏蔽层+次级+初级半段”的夹层绕法。屏蔽层用的是比初级绕组略窄的铜箔，一端接到初级母线电容的负极端。返修后的变压器装上板子，传导发射的整段包络直接降了10dB以上，150~300kHz的包络基本贴着限值线走。同时100MHz左右的辐射尖峰也趴了下来。

第三处，在输入电源线上加了共模扼流圈，2匝绕在1mH左右的磁环上——磁环本身就存在，只是原来设计的是“一根直通线”，现在绕了两圈而已。同时把C处的RC吸收从“1kΩ+1nF”调整为“100Ω+47pF”的组合。这里有个经验：吸收阻抗调小、电容调小，能把高频振铃的Q值降下来，代价是MOS管略微发热，在这个功率等级上完全可接受。

最终复测：传导发射在全部频段有6dB以上的余量，辐射发射余量约4dB，顺利交付产线。要强调的是，这次整改没加任何屏蔽罩，纯粹是PCB热环路、变压器绕组结构、Y电容位置和吸收电路这几项的组合拳。

4.4 常见问题速查表与经验汇总

根据这些年接触的案例，我把开关电源EMC问题按现象、原因、对策整理了一个速查表，遇到问题可以照方抓药：

还有一条铁律送给大家：EMC整改最忌讳“一次动多个零件然后同时测”。改一个测一次，才能知道哪个措施有效。工程师天性里都有“多管齐下”的冲动，但整改现场必须克制。我见过太多人，一口气换了电容、电感、变压器、还改了布线，测出来改善了，却完全不知道是哪个动作起效，结果下一批样机回到原始状态，又得从零开始排查。

做项目这些年前前后后改过几百次EMC，我的体会是，开关电源EMC从来不是玄学。只要把“噪声源—耦合路径—回流通道”这串逻辑链在脑子里跑一遍，再在PCB和变压器这两个关键载体上把细节做扎实，问题通常都能收敛。与其迷信“一颗神电容拯救一台电源”，不如回到基础，把环路画小、把绕组结构理清。这两件事做对了，你想超标都难。