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1. 这不是又一个LLC教程——而是一套能直接打样、带BOM和PCB的两级式小功率电源工程包

你搜“LLC”出来的结果，十有八九是半桥LLC谐振变换器的原理图+Simulink仿真模型+增益曲线推导。再往下翻，可能看到“图腾柱无桥PFC设计要点”或者“移相全桥DCDC闭环控制策略”。但真正把这三者——无桥PFC + 移相全桥DCDC + 同步整流——揉进一个小功率（300W级）两级式电源系统里，且提供可量产级BOM表、已验证原理图、LAYOUT完成的PCB文件、配套嵌入式软件框架、以及完整内容概要文档的公开资料，几乎为零。这不是理论推演，也不是教学Demo，而是一个从EMI实测数据反推PCB走线、从热成像图修正MOSFET选型、从负载瞬态响应调整环路补偿参数后沉淀下来的工程包。关键词里的“llc”“无桥pfc”“同步整流”不是并列标签，而是三级技术栈的耦合点：无桥PFC解决前端输入效率与THD，移相全桥DCDC承担高压隔离与宽范围稳压，同步整流则在次级侧把最后1~2%的导通损耗抠出来。它适合两类人：一是正在做通信电源、医疗设备辅助电源、工业PLC模块电源的硬件工程师，需要快速验证拓扑组合可行性；二是高校电力电子方向的研究生，手头有课题但缺真实器件参数、PCB布板约束、热管理实测反馈这些教科书里不会写的细节。我去年帮一家做激光驱动器的客户落地这套方案时，光是图腾柱驱动死区时间调试就花了三周——不是因为不会算，而是因为实际MOSFET的体二极管反向恢复特性让理论死区完全失效。这些坑，文档里都标红写了。

2. 为什么必须用两级？单级LLC不行吗？

2.1 小功率场景下的效率-成本-体积三角悖论

很多人一上来就想用单级LLC搞定AC-DC全链路，理由很充分：LLC本身高效率、软开关、EMI低。但问题出在“小功率”这个限定词上。我们定义这里的“小功率”为200W–500W输出，输入电压范围85–265Vac，输出为12V/24V/48V单路或双路。在这个区间，单级LLC面临三个硬约束：

第一是输入电压适应性。LLC的电压增益曲线呈“∩”形，峰值增益点由Lr/Cr谐振参数决定，而实际应用中需覆盖85Vac（整流后约120Vdc）到265Vac（整流后约375Vdc）的宽范围。若按375Vdc设计谐振网络，85Vac时增益严重不足，轻载甚至无法维持ZVS；若按120Vdc设计，则375Vdc时主开关应力飙升，必须选更高耐压MOSFET，导通电阻Rds(on)增大，反而拉低效率。我们实测过一款标称300W的单级LLC模块，在85Vac满载时效率仅89.2%，而在265Vac时因开关损耗激增，结温比额定值高18℃，不得不降额至240W使用。

第二是THD（总谐波失真）合规性。IEC 61000-3-2 Class A要求输入电流THD≤30%（>2A输入电流设备）。单级LLC前端是二极管整流桥，其电流波形为尖峰状，THD天然在60%–80%区间。加被动滤波电感可压至40%左右，但体积重量剧增，且影响动态响应。而无桥PFC（尤其是图腾柱结构）将THD压至5%–8%是常规操作，且无需额外电感——它的“电感”就是交错并联的两个Boost支路。

第三是安全隔离与安规认证成本。单级LLC需在初级侧同时处理PFC升压与LLC谐振，变压器要兼顾高压绝缘（≥3kV AC）与高频漏感控制，绕组结构复杂，爬电距离难满足UL/EN62368要求。两级方案中，PFC级只处理低压直流（375Vdc以下），DCDC级专注高压隔离，变压器设计解耦，PCB安规间距可精确控制，某客户因此缩短了CE认证周期11天。

提示：所谓“两级”，不是简单拼凑两个模块。本方案的PFC输出电压（400Vdc）直接作为DCDC输入，中间不设母线电容——这是降低体积的关键。但这也意味着PFC的输出纹波会直接注入DCDC，必须在DCDC控制环路中加入前馈补偿，否则输出电压在输入电压跳变时会出现200ms以上的超调。

2.2 无桥PFC选型：图腾柱 vs 双Boost，谁更适合小功率？

当前主流无桥PFC拓扑有三类：二极管钳位型、双Boost型、图腾柱型。本方案采用图腾柱（Totem-Pole）结构，原因如下：

• 器件数量最少：仅需4颗MOSFET（2颗SiC用于高频臂，2颗Si用于工频臂）+ 2颗驱动芯片，而双Boost需6颗MOSFET+2颗驱动+额外电流采样电路。BOM表中器件总数减少17%，贴片成本下降约¥23/台（按年产量10万台计）。

• EMI更易管控：图腾柱的高频开关路径极短（源极-漏极直连），di/dt回路面积小；双Boost因两路Boost电感物理分离，高频电流环路形成大矩形，实测30–100MHz段EMI高出6dB。我们在同一PCB上对比测试，图腾柱方案仅需一级共模电感+X电容即可通过EN55032 Class B，双Boost需追加π型滤波器。

• 热分布更均衡：图腾柱中SiC MOSFET承担高频开关（Q1/Q2），Si MOSFET（Q3/Q4）仅在工频半周导通，结温差达42℃；双Boost六颗MOSFET全部高频工作，热成像显示四角温度比中心高15℃，散热器需加大30%。

但图腾柱的致命难点在于死区时间控制。理论计算死区需覆盖SiC MOSFET关断延迟（td(off)≈35ns）+ Si MOSFET体二极管反向恢复时间（trr≈120ns），合计155ns。实测发现，当负载从0突加至100%时，因电流变化率di/dt增大，trr实际延长至180ns，原设死区导致直通短路。解决方案是在驱动芯片（如UCC21540）的DEAD-TIME引脚接入RC延时网络，使死区随负载电流动态调整——BOM表中已标注该RC参数（R=10kΩ, C=22pF）。

2.3 DCDC级为何不用LLC？移相全桥的不可替代性

既然标题含“LLC专题”，为何DCDC级弃用LLC而选移相全桥？关键在同步整流适配性与宽范围输出调节能力。

LLC的次级侧通常采用中心抽头+双二极管整流，或全桥整流。前者无法实现同步整流（因两端电压极性固定），后者虽可同步，但需4颗驱动信号，且占空比受限于谐振腔状态，难以在12V–48V宽输出范围内保持ZVS。而移相全桥的次级是标准全波整流结构：两个同步整流MOSFET（SR1/SR2）分别对应正负半周，驱动信号与原边移相角严格同步，占空比可0–100%线性调节。

更重要的是环路响应速度。LLC的增益-频率特性使其环路带宽受限（通常<10kHz），面对负载阶跃（如CPU供电的10A→0A瞬变），输出电压跌落达±8%。移相全桥通过调节移相角直接控制能量传递，环路带宽可达50kHz，同条件下跌落仅±1.2%。我们在某基站RRU电源项目中实测：LLC方案负载瞬态恢复时间12.8ms，移相全桥仅2.3ms。

同步整流在此处不是“锦上添花”，而是效率瓶颈突破点。以12V/25A输出为例，传统肖特基二极管（SS34）导通压降0.55V，损耗13.75W；而采用OptiMOS™ 5系列60V MOSFET（BSC014N06LS5），Rds(on)=1.4mΩ，同步驱动下导通损耗仅0.875W，效率提升1.2个百分点——对300W电源而言，这意味着减少3.6W热功耗，PCB温升降低9℃，散热器体积缩小40%。

3. 核心设计细节与实操要点拆解

3.1 PFC级：图腾柱的SiC与Si器件协同设计

图腾柱PFC的器件选型不是简单查表，而是电气应力、热行为、驱动兼容性的三维博弈。本方案BOM表中PFC级核心器件如下：

实操中最大的坑是SiC栅极振荡。由于SiC寄生电感极小（<1nH），驱动回路中PCB走线电感（即使0.5nH）也会与栅极电容形成LC谐振，导致Vgs尖峰超20V（超出绝对最大额定值18V）。解决方案有三：

1. 布局上：驱动芯片紧贴MOSFET，栅极走线宽度≥0.3mm，长度<5mm；
2. 电路中：在栅极串联铁氧体磁珠（如BLM18AG102SH1D，100MHz阻抗1000Ω）而非普通电阻，抑制高频振荡而不增加开关损耗；
3. BOM表中：已指定磁珠型号及位置（Rg_ext），PCB文件中该器件位于顶层，焊盘尺寸按0402封装设计。

注意：切勿用普通10Ω电阻替代磁珠！我们曾因省掉这颗磁珠，导致批量生产中5%的MOSFET在老化测试时栅极击穿。失效分析显示Vgs峰值达22.3V，持续时间8ns——足够击穿栅氧层。

3.2 DCDC级：移相全桥的变压器与同步整流驱动设计

移相全桥DCDC的设计重心不在开关管，而在高频变压器与同步整流时序。本方案变压器参数如下：

• 输入：400Vdc（PFC输出）
• 输出：12V/25A（主路）+ 5V/3A（辅路）
• 开关频率：100kHz
• 磁芯：PC40材质EE65，AL值=2100nH/N²
• 初级匝数：24T（线径0.5mm漆包线，2股并绕）
• 次级匝数：主路3T（线径1.2mm，4股并绕），辅路1T（线径0.3mm）

关键设计点在于漏感控制。移相全桥依赖漏感实现ZVS，但过大漏感会导致占空比丢失（Dead Time Loss）。我们通过三重手段控制：

1. 绕组结构：初级分三层，每层8T，层间加0.1mm聚酰亚胺薄膜；次级居中，用铜箔绕制（非漆包线），降低交流电阻；
2. 气隙设计：在EE65磁芯中柱加0.25mm气隙，实测漏感12.5μH（目标12–13μH）；
3. PCB验证：在PCB文件中，变压器焊盘严格按BOM表标注的引脚顺序（P1/P2/S1/S2）布局，避免绕组反接导致漏感翻倍。

同步整流驱动是另一难点。SR1/SR2的驱动信号必须与原边Q1/Q4的移相角严格对应，且需加入前沿消隐（Leading Edge Blanking, LEB）防止电流采样噪声误触发。本方案采用专用同步整流控制器UCC24612，其LEB时间设为120ns（通过外部电容设定），实测可滤除95%的开关噪声尖峰。BOM表中已标注该电容值（C_leb=100pF），PCB文件中该电容紧邻UCC24612的LEB引脚放置。

3.3 控制系统：双环嵌套与前馈补偿的工程实现

整个系统的控制不是两个独立环路，而是PFC电压环 + DCDC电流环 + 前馈通道的嵌套结构。软件框架（基于TI C2000 F280049C）核心逻辑如下：

// 主循环（100kHz） while(1) { // 1. 采样：Vin_rms, Vout, Iout, Vpfc ADC_Sample(); // 2. PFC电压环（外环，2kHz） Vpfc_ref = 400.0; // 目标母线电压 Vpfc_error = Vpfc_ref - Vpfc; Vpfc_duty = PI_Controller(Vpfc_error, &pfc_pi); // 输出为PFC占空比 // 3. DCDC电流环（内环，50kHz） Iout_ref = Vout_ref / R_load; // 根据输出电压设定电流基准 Iout_error = Iout_ref - Iout; Iout_duty = PI_Controller(Iout_error, &dcdc_pi); // 输出为移相角 // 4. 前馈补偿（关键！） Vpfc_ff = (Vpfc - 400.0) * 0.05; // PFC电压偏差乘以系数 Iout_duty += Vpfc_ff; // 直接叠加到移相角 // 5. PWM输出 EPWM_setDutyCycle(EPWM1, Vpfc_duty); EPWM_setPhaseShift(EPWM2, Iout_duty); }

前馈补偿系数0.05的确定过程：在265Vac输入时，PFC输出电压实测为412V，比标称高12V；此时若不补偿，DCDC需增大移相角以维持输出，导致开关损耗上升。通过扫频测试，发现当Vpfc每升高1V，移相角需减小0.05°才能抵消影响，故系数取0.05。该参数已固化在软件配置文件中，BOM表附带的“CONFIG.h”文件里明确标注#define PFC_FF_GAIN 0.05。

4. 实操全流程：从原理图到打样验证的踩坑实录

4.1 原理图设计：关键节点的安规与EMI考量

原理图不是功能正确就行，更要考虑安规爬电距离与EMI滤波器接地方式。本方案原理图（PDF版已包含在交付包中）有三处关键设计：

• Y电容接地点选择：输入端Y电容（Cy1/Cy2）不接大地，而接PFC输出地（即400Vdc负端）。这是因为PFC级无隔离，若Y电容接大地，会形成漏电流路径，导致RCD误动作。实测漏电流<0.1mA，满足IEC62368限值。

• PFC与DCDC地分割：原理图中明确划分“PFC地”（GND_PFC）与“DCDC地”（GND_DCDC），二者仅在一点（400Vdc负端）连接。此举避免PFC高频噪声通过地平面耦合至DCDC敏感模拟电路。PCB文件中该连接点位于输入电解电容负极焊盘旁，用1.2mm宽铜皮直连。

• 同步整流驱动隔离：UCC24612的VDD引脚不直接接12V输出，而是通过1:1隔离DCDC（型号ISO1212）供电。这是为防止SR1/SR2开关噪声通过供电路径干扰控制器。BOM表中ISO1212的输入电容（C_iso_in=10μF）必须采用X7R材质，避免温度漂移导致隔离失效。

4.2 PCB LAYOUT：高频环路与热管理的硬约束

PCB文件（Gerber格式，含所有层）的核心约束来自高频环路最小化与热焊盘设计：

• PFC高频环路：图腾柱的高频电流路径（Q1漏极→Q2源极→Q2漏极→Q1源极）必须用2mm宽铜皮直连，禁止过孔。实测显示，若该路径中插入一个过孔（电感≈0.5nH），在100kHz开关时产生1.2V振铃，导致EMI超标。PCB文件中该区域铜皮已加粗至2.5mm，并标注“NO VIA”。

• DCDC同步整流热焊盘：SR1/SR2（BSC014N06LS5）的散热焊盘尺寸为8mm×8mm，但并非简单铺铜。我们采用热通孔阵列：在焊盘内布置16个0.3mm过孔（间距1.2mm），过孔内壁镀铜厚度≥25μm，并连接至内层大面积铺铜（GND_PLANE）。热成像测试表明，此设计使MOSFET结温比普通铺铜降低11℃。

• EMI滤波器布局：共模电感（L1）与X电容（Cx1）必须相邻放置，且L1的输入/输出引脚走线平行、等长、间距≤0.5mm。这是为保证共模电流在L1中磁通抵消。PCB文件中L1与Cx1的焊盘已按此规则镜像对称布局，BOM表中L1型号（B82727A2302N001）的引脚间距（12.7mm）与Cx1封装（X2, 27.5mm）严格匹配。

4.3 BOM表深度解析：器件替代与采购避坑指南

BOM表（Excel格式）不仅是清单，更是供应链风险预警表。我们对关键器件标注了三类信息：

• 主选型号：如PFC驱动芯片UCC21540，TI原厂供货稳定，交期8–12周；
• 替代型号：如DCDC控制器UCC28950，当UCC28950缺货时，可用ST的L6599AT替代，但需修改软件中PWM死区配置（L6599AT默认死区500ns，UCC28950为200ns）；
• 禁用型号：如输出滤波电容，明确禁止使用国产“黑金刚”系列，因其ESR实测值比标称高40%，导致12V输出纹波超标。BOM表中指定日系品牌（Nippon Chemi-Con KME系列），并标注批次号要求（KME-2023-Q3起）。

最易被忽视的是电流采样电阻。PFC级用0.01Ω/5W无感电阻（CSM2512），DCDC级用0.5mΩ/3W（WSK2512）。BOM表中特别注明：WSK2512必须选“四端子”结构（Kelvin connection），否则引线电阻引入0.1mΩ误差，在25A电流下导致1.25%的电流检测偏差，环路失控。

5. 常见问题排查与独家调试技巧

5.1 PFC级常见故障速查表

实操心得：PFC调试时，务必先断开DCDC级输入（拔掉400Vdc连接线），单独验证PFC。我们曾因未断开，导致DCDC级反灌电流烧毁PFC驱动芯片——DCDC在无输入时，其变压器次级感应电压经同步整流MOSFET体二极管反向注入PFC母线，形成意外回路。

5.2 DCDC级同步整流失效诊断

同步整流失效表现为输出电压跌落、SR MOSFET异常发热、效率骤降。根本原因90%在于驱动时序错位。调试时按此顺序检查：

1. 确认UCC24612供电正常：测其VDD引脚电压应为12V±5%，若低于11.4V，芯片进入欠压锁定，SR驱动停止；
2. 验证电流采样信号：用示波器看ISENSE引脚波形，应为干净的三角波（反映原边电流），若含高频噪声，检查RC滤波器（R=10kΩ, C=100pF）是否焊接正确；
3. 测量SR驱动波形：SR1/SR2栅极波形应与原边Q1/Q4漏源电压反相，且前沿对齐。若延迟>100ns，检查UCC24612的DELAY引脚电容（C_delay=47pF）是否容值准确。

我们遇到过一次诡异故障：SR1常温下工作正常，但温度升至60℃后失效。失效分析发现，UCC24612的内部温度传感器在高温下灵敏度下降，导致LEB时间延长至200ns，错过真正的电流过零点。解决方案是将C_leb从100pF改为82pF，使LEB时间恒定在100ns。

5.3 EMI整改实战技巧：从30MHz到1GHz的逐频段压制

EMI测试失败是电源开发最头疼的问题。本方案通过三阶段整改达成EN55032 Class B：

• 30–100MHz（共模主导）：在PFC输入端增加第二级共模电感（L2），参数2.2mH，与首级L1（1.2mH）形成梯度滤波。关键点是L2的绕向必须与L1相反，使共模磁通叠加增强；
• 100–300MHz（差模主导）：在DCDC输出端增加π型滤波器（Cout1=100μF钽电容 + L_filter=1.5μH + Cout2=47μF陶瓷电容），其中L_filter必须用磁屏蔽电感（如TDK VLS-C series），避免辐射；
• 300–1000MHz（高频谐振）：在PCB顶层关键节点（如PFC高频环路、DCDC变压器引脚）喷涂导电银漆，形成局部法拉第笼。实测可压低峰值6–8dB。

独家技巧：EMI整改时，不要盲目增加滤波器件。先用近场探头定位噪声源——我们发现85%的超标点来自PFC级Q1/Q2的漏极节点，而非预期的变压器。因此，最终方案是在Q1/Q2漏极焊盘边缘蚀刻0.2mm宽槽，并填充导电胶，切断高频电流环路，比加电感更有效。

6. 软件框架与内容概要文档的实用价值

6.1 软件框架：不只是代码，而是可裁剪的控制逻辑库

交付的软件（Code Composer Studio工程）包含三大模块：

• 底层驱动库：涵盖ADC采样校准（含偏置补偿）、EPWM相位同步（精度±0.5°）、GPIO中断防抖（10μs滤波）；
• 控制算法库：PFC电压环PI参数（Kp=0.8, Ki=20）、DCDC电流环PI参数（Kp=1.2, Ki=50）、前馈系数（0.05）均已实测优化，注释中说明各参数物理意义；
• 保护逻辑库：过压（Vout>12.5V）、过流（Iout>26A）、过温（NTC>95℃）三级保护，且支持故障自锁与自动重启（间隔5s）。

所有参数均定义在config.h中，修改后重新编译即可生效。例如，若需将输出电压改为24V，只需改#define VOUT_REF 24.0，软件自动重算电流基准与环路参数。

6.2 内容概要文档：工程师的快速索引手册

内容概要文档（PDF，32页）不是冗长论文，而是按问题组织的速查手册：

• 第3页：“如何修改PFC输出电压？”——列出需改动的3个参数（Vpfc_ref、PI参数、驱动死区）及验证步骤；
• 第12页：“DCDC输出纹波超标怎么办？”——提供4种方案优先级：①检查输出电容ESR；②增加π型滤波；③优化PCB地平面；④调整环路带宽；
• 第25页：“BOM表中器件停产了如何替代？”——给出12个关键器件的替代清单，含TI/ST/Infineon交叉型号及注意事项。

这份文档的价值在于，当你凌晨两点调试失败时，不用翻50页原理图，直接翻到对应问题页，3分钟内找到解决方案。它是我过去三年在17个电源项目中积累的“故障-对策”映射表，现在完整交给你。

我在实际项目中发现，最浪费时间的不是设计错误，而是重复查找已知问题的解法。这套资料存在的唯一目的，就是让你少走我走过的弯路——比如那个因磁珠缺失导致的栅极击穿，比如那个因Y电容接地错误引发的RCD跳闸。它们都明明白白写在文档里，标着红色警告符号。