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1. I2C主控制器中断机制深度解析

在嵌入式系统开发中，中断机制是实现高效、实时响应的核心技术。其原理是通过硬件或软件事件触发，暂停当前程序执行，转而处理优先级更高的任务，处理完毕后恢复原流程。这种机制对于管理外设通信、处理异步事件具有重要价值，尤其在多任务和实时系统中不可或缺。I2C（Inter-Integrated Circuit）总线作为一种广泛应用的同步、多主从、串行通信总线，其主控制器（Master）的中断管理是确保通信可靠性与效率的关键。通过配置特定的中断屏蔽寄存器（如I2CMIMR），开发者可以灵活控制哪些原始中断事件（如传输完成、FIFO状态、仲裁丢失、时钟超时等）能够被提升为控制器中断，从而实现对不同通信场景（如DMA传输、突发读写、错误处理）的精准响应。理解并掌握I2C主控制器的中断配置，是进行高效I2C驱动开发和系统调试的基础。

对于刚接触TM4C129这类微控制器的开发者来说，面对手册中数十个寄存器位域，常常感到无从下手。我最初调试I2C时，也曾在中断配置上栽过跟头，要么是中断不触发，要么是中断频繁发生导致系统卡死。实际上，I2C主控制器的中断机制是一个层次清晰、逻辑严密的体系，核心围绕着几个关键寄存器展开：中断屏蔽寄存器（I2CMIMR）、原始中断状态寄存器（I2CMRIS）、屏蔽后中断状态寄存器（I2CMMIS）和中断清除寄存器（I2CMICR）。这套机制的设计哲学是“事件驱动”，让CPU从轮询的苦力中解放出来，只在真正需要处理事务时才被唤醒。

1.1 中断信号链：从物理事件到CPU响应

要理解I2C中断配置，首先要明白一个中断信号是如何从I2C总线上的一个物理事件（比如从机发送了一个NACK），最终传递到你的中断服务程序（ISR）的。这个过程可以类比为一个公司的报警系统：各个部门（I2C模块内部的不同功能单元）发现异常情况（原始中断事件），会先报告给本部门的经理（原始中断状态寄存器I2CMRIS），但经理不能直接惊动老板（CPU），他需要先查看公司的通知规则（中断屏蔽寄存器I2CMIMR），如果规则允许该类型事件上报，他才会按下通往老板办公室的警报按钮（产生控制器中断）。老板的秘书（中断控制器NVIC）接到警报后，会根据优先级安排老板处理。老板处理完后，需要亲自去部门经理那里签字确认（写中断清除寄存器I2CMICR），表示此事已处理完毕，警报可以解除。

具体到TM4C129的I2C主控制器，这个链条如下：

1. 事件发生：例如，发送FIFO变空（TXFE）、接收到数据（RX）、仲裁丢失（ARBLOST）等。
2. 原始状态置位：I2C硬件自动将I2CMRIS寄存器中对应的位（如TXFERIS）置为1。此时，无论你是否想处理这个中断，这个“事实”已经被记录在案。
3. 屏蔽判断：硬件同时会查询I2CMIMR寄存器中对应的屏蔽位（如TXFEIM）。如果该屏蔽位为0（中断被屏蔽），则到此为止，信号链中断。如果为1（中断未屏蔽），则进入下一步。
4. 生成中断请求：硬件将I2CMMIS寄存器中对应的位（如TXFEMIS）置为1，并向微控制器的嵌套向量中断控制器（NVIC）发出一个中断请求。
5. CPU响应：如果全局中断已开启，且该I2C中断在NVIC中已使能并具有足够优先级，CPU将暂停当前任务，跳转到对应的I2C中断服务程序（ISR）。
6. 中断服务与清除：在ISR中，你需要做两件关键事：一是查询I2CMMIS或I2CMRIS寄存器来确定具体是哪个（或哪些）中断源触发了本次ISR；二是在处理完该中断事件后，必须向I2CMICR寄存器对应的位写入1来清除原始中断状态。这是一个关键操作，如果忘记清除，会导致中断持续触发，系统陷入死循环。

注意：I2CMRIS反映的是“所有发生的事件”，而I2CMMIS反映的是“未被屏蔽且已发生的事件”。在ISR中，通常通过读取I2CMMIS的值来判断需要处理哪些中断，因为它的值直接对应了触发本次ISR的原因。

1.2 核心寄存器功能与关联性解读

输入资料中给出了从寄存器5到寄存器16的详细位定义，信息量很大。我们将其核心功能进行归类，并理解它们之间的互动关系，这比死记每个位的偏移地址更重要。

中断管理寄存器组（核心四件套）：

• I2CMIMR (偏移 0x010)：中断“开关板”。RW（可读写）类型。你通过设置这个寄存器的各个位（IM, CLKIM, TXIM, RXIM等）来决定关心哪些中断事件。例如，如果你只希望在一次传输完成时被中断，那么你可能只使能IM（主中断）位；如果你使用DMA搬运数据，则需要使能DMARXIM或DMATXIM；如果你要进行流控，则需要使能TXFEIM和RXFFIM等FIFO中断。
• I2CMRIS (偏移 0x014)：中断“事件记录本”。RO（只读）类型。任何中断条件发生时，对应的位会自动置1。它是最原始、最真实的记录，不受I2CMIMR的影响。即使你屏蔽了某个中断，这里依然会记录该事件的发生。在调试时，读取这个寄存器非常有用，可以查看“到底发生了什么”，即使你没有收到中断。
• I2CMMIS (偏移 0x018)：中断“有效事件报告”。RO（只读）类型。它是I2CMRIS和I2CMIMR进行“逻辑与”操作后的结果。只有I2CMRIS中为1（事件发生）且I2CMIMR中对应位也为1（中断未屏蔽）的位，在I2CMMIS中才会显示为1。你的中断服务程序（ISR）首先应该读取这个寄存器，来判断是哪个中断源把你叫过来的。
• I2CMICR (偏移 0x01C)：中断“事件清除器”。WO（只写）类型。向这个寄存器的某个位写1，会同时清除I2CMRIS和I2CMMIS寄存器中的对应位。这是清除中断挂起状态、防止中断重入的唯一正确方式。特别注意，读取此寄存器无意义。

配置与状态寄存器：

• I2CMCR (偏移 0x020)：主控制器配置寄存器。最重要的位是MFE（主功能使能）和LPBK（环回测试模式）。在初始化I2C主模块时，必须先使能MFE。
• I2CMCLKOCNT (偏移 0x024)：时钟低超时计数。用于设置SCL线被从机拉低的最长时间，防止某个从机故障导致整个总线挂死。这是一个重要的可靠性设计。
• I2CMBMON (偏移 0x02C)：总线监控寄存器。只读，可以实时查看SCL和SDA线的电平状态。在调试总线死锁、通信失败时，这个寄存器是第一个要查看的地方。
• I2CMBLEN (偏移 0x030)和I2CMBCNT (偏移 0x034)：突发传输长度寄存器和当前计数寄存器。用于配置和监控突发（Burst）传输模式下的数据量。

从机相关寄存器（I2CSOAR, I2CSCSR, I2CSDR）： 虽然本文重点在主控制器，但输入资料也提供了从机部分的关键寄存器。I2CSOAR设置从机自身地址；I2CSCSR是一个多功能寄存器，读时为状态寄存器（反映接收请求RREQ、发送请求TREQ等），写时为控制寄存器（用于使能从机DA、FIFO等）；I2CSDR是从机数据寄存器。这提醒我们，TM4C129的I2C模块是主从一体的，同一个物理模块可以通过配置I2CMCR的MFE和SFE位来切换模式。

2. 关键中断源应用场景与配置策略

理解了寄存器框架后，我们需要深入每个关键中断源，知道它们何时触发，以及我们应该如何配置和处理它们。这是写出稳健、高效I2C驱动的关键。

2.1 主中断（IM）与传输请求中断（TXIM/RXIM）

• 主中断 (IM, RIS/MIS)：这是一个“总括性”中断。根据手册描述，它会在两种情况下触发：主事务完成和下一字节传输请求。在早期的或简单的I2C驱动中，开发者可能只使用这个中断。在中断服务程序中，再通过查询其他状态位（如I2CMCS寄存器中的BUSY,ERROR位）来判断具体状态。它的优点是逻辑简单，但缺点是不够精细，中断服务程序需要做更多判断工作。
• 传输请求中断 (TXIM/RXIM)：这两个中断用于字节-by-byte或非FIFO缓冲的数据传输模式。当发送FIFO需要新数据（TXIM）或接收FIFO中有数据可读（RXIM）时触发。例如，在发送多字节数据时，你写入第一个字节后启动传输，当该字节被移出FIFO发送后，TXIM中断触发，你在ISR中写入下一个字节，如此循环，直到所有数据发送完毕。这种模式给了软件最大的控制粒度，但中断频率高，CPU开销大。

配置策略： 对于简单的单字节或少量字节传输，可以只使能IM中断。对于需要软件精确控制每个字节传输时序的场景（例如与某些特殊时序要求的器件通信），可以使用TXIM/RXIM。但在TM4C129这类具有FIFO和DMA的现代控制器上，更推荐使用下面介绍的FIFO中断或DMA中断。

2.2 FIFO中断（TXFEIM/RXFFIM）与流控

这是提升传输效率、降低CPU中断负荷的核心机制。

• 发送FIFO空中断 (TXFEIM)：当发送FIFO完全为空时，此中断触发。这意味着发送器马上就要“饿”了，需要你及时补充数据。
• 接收FIFO满中断 (RXFFIM)：当接收FIFO完全满时，此中断触发。这意味着再不读取数据，新来的数据就要溢出了。

应用场景： 假设你的发送FIFO深度是8字节。你要发送100字节的数据。一种低效的做法是使能TXIM，每发完1字节就进一次中断，填1字节，总共产生100次中断。高效的做法是：

1. 使能TXFEIM中断，设置一个合理的FIFO填充阈值（通常通过I2CMCR相关配置，虽然输入资料未给出，但此类控制器通常有）。
2. 启动传输前，先一次性写入8字节（填满FIFO）。
3. 当FIFO空时，TXFEIM中断触发。在ISR中，你再一次性写入最多8字节的数据。
4. 这样，100字节的数据大约只产生100 / 8 ≈ 13次中断，大大减少了上下文切换的开销。

手册中的重要提示：

The TXFEIM interrupt mask bit in the I2CMIMR register should be clear (masking the TXFE interrupt) when the master is performing an RX Burst from the RXFIFO and should be unmasked before starting a TX FIFO transfers.

这句话非常关键！它指出：当主机正在从RX FIFO执行突发接收操作时，应该屏蔽TXFEIM中断；在开始TX FIFO传输之前，再取消屏蔽。这是因为在接收过程中，发送FIFO是空闲的，如果TXFEIM未被屏蔽，可能会因为发送FIFO为空而误触发中断，干扰你的接收流程。这体现了精细中断管理的重要性。

2.3 DMA中断（DMATXIM/DMARXIM）与高效数据搬运

直接内存访问（DMA）是解放CPU的终极武器。I2C模块可以与DMA控制器联动，在数据达到一定阈值时，由DMA自动在内存和I2C FIFO之间搬运数据，完全不需要CPU干预。

• 发送DMA完成中断 (DMATXIM)：当DMA控制器完成了预设的发送数据块搬运后触发。此时，数据可能还在I2C的发送FIFO中或正在发送，但DMA的搬运工作已经完成。
• 接收DMA完成中断 (DMARXIM)：当DMA控制器完成了预设的接收数据块搬运后触发。

配置策略：

1. 配置DMA通道的源/目标地址（内存地址和I2C数据寄存器地址）、传输数据量。
2. 在I2C主控制器中使能DMATXIM或DMARXIM。
3. 启动I2C传输和DMA传输。
4. 当整个数据块搬运完成，DMA中断触发。在对应的DMA ISR或I2C的DMA中断ISR中，你可以进行后续处理，例如准备下一块数据，或者通知任务传输完成。

使用DMA中断，CPU只在数据块开始和结束时被短暂打扰，期间可以处理其他任务，极大地提高了系统整体吞吐量和实时性。

2.4 错误与状态中断（ARBLOSTIM, NACKIM, CLKIM）

这些中断用于处理通信中的异常情况，是保证通信鲁棒性的关键。

• 仲裁丢失中断 (ARBLOSTIM)：在多主系统中，当两个主机同时发起传输时，I2C总线会进行仲裁。丢失仲裁的主机将自动转换为从机并监听总线。如果使能此中断，在仲裁丢失时你会收到通知，在ISR中通常需要重新尝试发送。
• NACK中断 (NACKIM)：当主机发送的地址或数据字节未收到从机的应答（ACK）时触发。这是最常见的错误之一，原因可能是从机地址错误、从机忙、从机故障或总线问题。在ISR中，你需要根据协议决定是重试、报错还是终止通信。
• 时钟超时中断 (CLKIM)：与I2CMCLKOCNT寄存器配合使用。如果从机拉低SCL线的时间超过了I2CMCLKOCNT设定的时间，此中断触发。这可以防止一个故障从机将总线时钟线永远拉低，导致总线死锁。处理方式通常是复位I2C模块或尝试恢复总线。

配置建议：在大多数应用中都应使能NACKIM和ARBLOSTIM（如果有多主可能）。CLKIM在连接可靠性未知的从机时建议使能，并设置一个合理的超时值（例如，远大于正常字节传输时间）。

3. 实战：中断驱动I2C主从通信配置流程

现在，我们将理论付诸实践，以一个具体的场景为例：TM4C129作为主机，向一个EEPROM从机（地址0x50）写入10字节数据，然后读回，使用中断方式处理传输完成和错误。

3.1 硬件与软件初始化

首先，进行基础的硬件和软件初始化，这是所有操作的前提。

// 假设使用I2C0模块，SCL/PB2, SDA/PB3 void I2C0_Init(void) { // 1. 使能I2C0和外设GPIOB的时钟 SYSCTL->RCGCI2C |= 0x01; // 使能I2C0时钟 SYSCTL->RCGCGPIO |= 0x02; // 使能GPIOB时钟 while(!(SYSCTL->PRGPIO & 0x02)){}; // 等待GPIOB时钟就绪 // 2. 配置GPIO引脚为I2C功能 GPIOB->AFSEL |= 0x0C; // PB2, PB3启用备用功能 GPIOB->PCTL &= ~0x0000FF00; GPIOB->PCTL |= 0x00003300; // PB2, PB3配置为I2C功能 (具体值查数据手册) GPIOB->ODR |= 0x08; // PB3 (SDA) 配置为开漏 GPIOB->DEN |= 0x0C; // 使能PB2, PB3数字功能 // 3. 初始化I2C为主机模式，设置时钟频率（假设系统时钟80MHz，目标100kHz） I2C0->MCR = 0x0010; // 主功能使能 MFE=1, 其他位默认（如LPBK=0） // 设置时钟分频，TPR = (SysClk / (2*(SCL_LP + SCL_HP)*SCL_CLK)) - 1 // 假设 SCL_LP=6, SCL_HP=4, SCL_CLK=100000 // TPR = 80,000,000 / (2*10*100,000) - 1 = 40 -1 = 39 I2C0->MTPR = 39; // 设置I2C时钟为约100kHz // 4. 配置中断（先关闭所有中断，再使能NVIC通道） I2C0->MIMR = 0x0000; // 屏蔽所有主中断 // 清除所有可能挂起的中断 I2C0->MICR = 0x07FF; // 写入1清除所有中断位 // 在NVIC中使能I2C0中断 NVIC->ISER[0] = (1 << (INT_I2C0 - 16)); // INT_I2C0需替换为实际值，如8 // 设置中断优先级（可选） // NVIC->IP[INT_I2C0] = ...; }

3.2 中断服务程序（ISR）设计与实��

一个健壮的ISR需要高效地识别中断源并进行处理。通常我们读取I2CMMIS寄存器来判断。

// I2C0中断服务程序 void I2C0_Handler(void) { uint32_t maskedStatus = I2C0->MMIS; // 读取屏蔽后的中断状态 // 处理主事务完成中断（包含在IM中，但通常我们通过查询状态机处理） // 更常见的做法是使能IM，然后在ISR中检查I2CMCS寄存器的BUSBSY和ERROR位 // 但根据手册，IM中断也代表“下一字节请求”，所以这里我们直接处理IM if(maskedStatus & 0x0001) { // IM位（位0）触发 // 清除IM中断 I2C0->MICR = 0x0001; // 检查传输状态，可以通过读取I2CMCS寄存器 uint32_t masterCtrlStatus = I2C0->MCS; if(masterCtrlStatus & 0x04) { // ERROR位被置位 // 发生错误，进一步判断错误类型 if(I2C0->MRIS & 0x0010) { // NACK发生 // 处理NACK错误，例如重试或报错 handleNACKError(); I2C0->MICR = 0x0010; // 清除NACK中断 } if(I2C0->MRIS & 0x0080) { // 仲裁丢失 // 处理仲裁丢失 handleArbitrationLost(); I2C0->MICR = 0x0080; // 清除仲裁丢失中断 } // 可能需要复位或停止当前传输 I2C0->MCS |= 0x02; // 发送STOP条件 } else if(!(masterCtrlStatus & 0x01)) { // BUSBSY位为0，传输完成 // 传输成功完成，可以设置标志位通知主程序 g_i2cTransferComplete = true; g_i2cError = false; } // 如果BUSBSY仍为1，说明是“下一字节请求”，需要继续处理数据 // 这部分逻辑通常结合TXIM/RXIM或FIFO来处理更高效 } // 处理NACK中断（如果单独使能了） if(maskedStatus & 0x0010) { // NACKIM位（位4） // 记录错误，停止传输 g_i2cError = true; g_i2cErrorCode = I2C_ERROR_NACK; I2C0->MCS |= 0x02; // 发送STOP I2C0->MICR = 0x0010; // 清除NACK中断 } // 处理仲裁丢失中断（如果单独使能了） if(maskedStatus & 0x0080) { // ARBLOSTIM位（位7） // 在多主系统中，可能需要重新尝试发送 g_i2cError = true; g_i2cErrorCode = I2C_ERROR_ARB_LOST; // 仲裁丢失后硬件会自动切到从模式，需要重新初始化为主模式？ // 通常需要软件干预恢复，具体看手册 I2C0->MICR = 0x0080; // 清除仲裁丢失中断 } // 处理FIFO中断（如果使能了） if(maskedStatus & 0x0400) { // TXFEIM位（位10） // 发送FIFO空，填充更多数据 fillTxFIFO(); I2C0->MICR = 0x0400; // 清除TXFE中断 } if(maskedStatus & 0x0800) { // RXFFIM位（位11） // 接收FIFO满，读取数据 readRxFIFO(); I2C0->MICR = 0x0800; // 清除RXFF中断 } }

3.3 主函数中的传输控制逻辑

在主程序中，我们配置传输参数，启动传输，然后等待中断回调。

// 全局变量，用于ISR与主程序通信 volatile bool g_i2cTransferComplete = false; volatile bool g_i2cError = false; volatile uint8_t g_i2cErrorCode = 0; uint8_t g_txBuffer[10] = {0x00, 0x01, 0x02, 0x03, 0x04, 0x05, 0x06, 0x07, 0x08, 0x09}; uint8_t g_rxBuffer[10] = {0}; void I2C_WriteRead_EEPROM(uint8_t slaveAddr, uint16_t memAddr, uint8_t *txData, uint8_t txLen, uint8_t *rxData, uint8_t rxLen) { // 1. 确保I2C总线空闲 while(I2C0->MCS & 0x01); // 等待BUSBSY位为0 // 2. 配置中断：使能主中断(IM)和错误中断(NACK, ARBLOST) // 对于简单轮询，可以不使能IM，但这里演示中断方式 // 先清除所有挂起中断 I2C0->MICR = 0x07FF; // 使能主中断、NACK中断、仲裁丢失中断 I2C0->MIMR = (1 << 0) | (1 << 4) | (1 << 7); // IM, NACKIM, ARBLOSTIM // 3. 发送从机地址（写模式）和内存地址高字节（假设16位地址） I2C0->MSA = (slaveAddr << 1); // 地址左移1位，最低位为0表示写 // 对于写入操作，数据寄存器存放的是要发送的数据 // 但第一次发送的是内存地址高字节 I2C0->MDR = (memAddr >> 8) & 0xFF; // 假设先发送高字节 // 4. 配置主控制器：启动条件、运行、不停止（因为后面还要发送地址低字节） // I2CMCS寄存器: [ACK=0, STOP=0, START=1, RUN=1, ...] I2C0->MCS = 0x0003; // START | RUN // 5. 此时，传输启动。主程序可以去做其他事情。 // 等待中断服务程序设置完成标志或错误标志 g_i2cTransferComplete = false; g_i2cError = false; // 6. 在实际应用中，这里应使用RTOS信号量或标志位进行任务同步，而不是忙等。 // 此处为简化演示，使用忙等。 while(!g_i2cTransferComplete && !g_i2cError) { // 可以进入低功耗模式，等待中断唤醒 // __WFI(); } if(g_i2cError) { // 处理错误 handleI2CError(g_i2cErrorCode); return; } // 7. 传输完成，继续后续操作（例如发送地址低字节、数据等） // 注意：实际流程更复杂，需要根据EEPROM的页写协议和中断响应逐步进行。 // 此处省略后续步骤的详细代码，重点展示中断配置和响应框架。 // 8. 传输结束后，可以选择屏蔽中断 I2C0->MIMR = 0x0000; }

4. 高级话题：突发传输、时钟超时与调试技巧

掌握了基础中断配置后，我们来看一些高级功能和实战调试中会遇到的问题。

4.1 突发传输模式与相关寄存器

突发传输（Burst）模式允许主机在一次通信序列中连续发送或接收多个数据字节，而无需为每个字节重复发送地址。这对于读写大块数据（如传感器数据块、显示缓冲区）非常高效。

• I2CMBLEN (Burst Length Register)：在启动突发传输前，你需要在此寄存器中设置本次突发传输的总字节数。手册强调，如果使能了突发模式，此寄存器必须设置为非零值，否则会产生错误。
• I2CMBCNT (Burst Count Register)：这是一个只读寄存器。当突发传输启动时，I2CMBLEN的值会被自动加载到这里，然后每成功传输一个字节就递减1。如果突发传输因错误（如数据NACK）提前终止，读取此寄存器可以知道已经成功传输了多少个字节。成功完成整个突发传输后，此寄存器值为0。

如何使用：

1. 配置I2CMBLEN为要传输的字节数N。
2. 在I2CMCS寄存器中设置BURST位（如果存在，需查阅完整手册确认位定义，输入资料未明确给出，但通常有此控制位）。
3. 启动传输。对于发送，你需要确保在TXFEIM中断触发时，有足够的数据可以填入FIFO；对于接收，RXFFIM中断会通知你及时读取数据。
4. 传输过程中，可以监控I2CMBCNT来了解进度。
5. 传输完成或出错后，通过IM中断或NACKIM中断等来处理。

4.2 时钟低超时保护机制

这是一个重要的总线可靠性特性。某些从机设备可能会通过拉低SCL线（时钟拉伸）来要求主机等待。但如果从机故障，一直拉低SCL，会导致整个I2C总线挂死。I2CMCLKOCNT寄存器就是用来防止这种情况的。

• 原理：该寄存器是一个12位计数器的高8位（低4位固定为0）。当SCL线被持续拉低时，计数器开始递减。如果在计数器减到0之前SCL被释放（变高），计数器会重新加载I2CMCLKOCNT的值。如果SCL一直被拉低直到计数器超时（减到0），则会触发时钟超时中断（CLKIM）。
• 计算与设置：超时时间T_timeout = (CNTL + 1) * 16 * T_sysclk？这里需要根据芯片数据手册的精确公式计算。通常，CNTL的值必须大于1。你需要��据系统时钟频率和你能容忍的最大从机等待时间来设置一个合理的值。例如，如果系统时钟为80MHz，你希望超时时间大约为10ms，经过计算可能需要设置CNTL为某个值（具体计算需参考时钟分频章节）。
• 处理：在时钟超时中断服务程序中，你应该采取恢复措施。一种常见的方法是：先尝试发送一个STOP条件（I2CMCS寄存器STOP位），如果无效，则可能需要暂时禁用I2C模块（清除I2CMCR的MFE位），强制释放GPIO引脚，然后再重新初始化I2C模块。

4.3 调试实战：常见问题排查指南

即使配置正确，I2C通信也常常出问题。以下是我在多年调试中总结的排查清单：

1. 无中断触发：

   • 检查NVIC配置：确认在NVIC中已使能对应的I2C中断向量（如I2C0_Handler）。这是最容易被忽略的一步。
   • 检查全局中断：确认使用了__enable_irq()或类似指令开启了CPU的全局中断。
   • 检查屏蔽寄存器I2CMIMR：确认你关心的中断位已被置1（使能）。
   • 查询原始状态I2CMRIS：即使没中断，也读一下这个寄存器。如果对应位为1，说明事件已经发生，只是被屏蔽了或NVIC没配置好。如果为0，说明事件根本没发生，问题出在传输启动或硬件连接上。

2. 中断持续触发（死循环）：

   • 绝对首要原因：忘记在ISR中清除中断标志！必须检查ISR是否对I2CMICR寄存器的相应位写了1。
   • 清除方式错误：确认是向I2CMICR写1，而不是I2CMRIS或I2CMMIS。向状态寄存器写1是无效的。
   • 事件持续发生：例如，如果你使能了TXFEIM（发送FIFO空中断），但ISR中没有填充新数据，那么FIFO会一直为空，导致中断清除后立刻又满足条件，再次触发。需要确保ISR逻辑能真正“解决”触发中断的条件。

3. 通信错误（NACK频繁）：

   • 从机地址：确认7位从机地址是否正确，并已在I2CMSA寄存器中左移1位（最低位存放R/W位）。
   • 从机电源和上拉：确认从设备已上电，且总线的SCL和SDA线有合适的上拉电阻（通常4.7kΩ-10kΩ）。
   • 时序问题：用示波器或逻辑分析仪查看SCL和SDA波形。检查时钟频率（I2CMTPR设置）是否在从机支持的范围内。检查START/STOP条件、数据建立/保持时间是否符合标准。
   • 从机忙：某些器件（如EEPROM）在内部写周期内会NACK，需要等待一段时间（查询或延时）再重试。

4. 总线锁死（SCL被拉低）：

   • 使用I2CMBMON寄存器：立即读取此寄存器，查看SCL和SDA的当前电平。如果SCL为0且长时间不变，说明总线被锁死。
   • 检查从机：逐一断开从机，定位故障设备。
   • 启用时钟超时：配置I2CMCLKOCNT并使能CLKIM中断，让硬件自动检测并恢复。
   • 软件恢复：在极端情况下，可以尝试切换GPIO引脚为普通输出模式，手动产生几个时钟脉冲（模拟SCL）来“喂”给从机，使其完成当前操作并释放总线，然后再重新初始化I2C。

5. FIFO/DMA数据错误：

   • 指针与长度：检查DMA或FIFO操作的内存地址和长度是否正确，是否存在缓冲区溢出。
   • 传输顺序：对于多字节读写，注意字节序（大端/小端）问题。
   • 并发访问：确保在主程序和ISR中访问共享数据（如缓冲区、状态标志）时，使用了 volatile 关键字或关中断等保护机制，防止数据竞争。

调试I2C，一个逻辑分析仪是必不可少的工具。它可以直观地展示总线上的每一个位、每一个字节、ACK/NACK、START/STOP条件，是定位协议层问题最快的方法。结合芯片的寄存器状态，可以快速定位是软件配置问题，还是硬件/从机问题。