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简介：面向电力电子与开关电源方向的研究生、课题组成员及DC/DC变换器工程师，从交错并联LLC谐振变换器的均流难题切入，梳理因励磁电感偏差与谐振参数离散导致的相间电流不均衡机理及应对思路。压缩包仅含1个PDF文件，约8.68MB，由太原理工大学杨玉岗整理，内容涵盖课题背景与研究意义、磁集成均流方案、全耦合电感器均流方案、变压器次级绕组分组连接均流方案及结论等章节，并配有工作模态波形、交流增益特性曲线与不平衡度实验数据。读者可据此对照LLC谐振网络等效电路与ZVS/ZCS工作区域划分，理解磁集成与全耦合电感器的参数设计及验证方法，也可为多相并联电源的均流方案比选提供参照。目前已有182人学习。

1. 交错并联LLC均流：为什么谐振参数只差几个点，电流就能跑偏一大截

两相LLC并联，谐振电感只差3%，满载时相间电流不平衡度就可能冲到接近10%——这个数字我第一次看到时是有点意外的。因为LLC不是靠占空比调压，而是靠频率调增益，谐振腔参数本身就是增益曲线的一部分，参数偏差直接改写这一相的交流增益，两相在同一母线电压下"抢"电流，谁增益高谁多干。交错并联解决的是大功率下的器件应力和轻载效率问题，但把两个本来独立的谐振腔绑到同一个输出节点上，均流就成了绕不开的硬约束。搞懂这件事的底层逻辑，比记住"要加均流电路"有用得多，因为后面所有方案——磁集成、全耦合电感、次级绕组分组——都是从同一个根上长出来的。

2. 均流失衡的根源：谐振腔增益、激励位置与IPOP约束

2.1 从增益曲线读出"电流为什么跑偏"

先把LLC的交流等效模型摆出来。谐振网络把原边方波基波送到变压器，副边折算回原边的等效电阻记为 $R_{eq}$，归一化频率 $f_n=f_s/f_r$，品质因数 $Q$、电感比 $h$ 是决定曲线的两个关键参数：

$$ Q=\frac{\sqrt{L_r/C_r}}{R_{eq}},\qquad h=\frac{L_m}{L_r},\qquad f_r=\frac{1}{2\pi\sqrt{L_r C_r}} $$

交流增益 $G_{ac}$ 随 $f_n$ 变化，工作区选在 ZVS1 区（感性区、能同时实现原边 ZVS 和副边 ZCS）。关键在于：$G_{ac}=f(f_n, Q, h)$，而 $Q$ 和 $h$ 都是由 $L_r$、$C_r$、$L_m$ 算出来的。两相并联时，输入电压相同、输出电压被钳在同一水平，于是每一相必须自己满足 $G_{ac,i}=V_o/(V_{in}/n)$。若两相的 $L_r$、$C_r$、$L_m$ 有偏差，同一开关频率下两相的 $G_{ac}$ 不同，而输出电压是同一个，结果只能是某一相自动"退让"——通过增大自身的等效阻抗来压低电流，另一相补上缺口。

这就是失衡的物理机制，也是一个反直觉点：不是电流分配出了问题，是增益匹配出了问题，电流只是被动结果。

2.2 激励位置的差异：交错并联特有的失配源

单看参数偏差还不够。交错并联的"交错"意味着两相驱动相位差180°，两相谐振腔在时间上错开半个周期工作，但共用同一个输入电容网络和同一个输出滤波节点。这带来两个后果：

第一，两相从输入母线取电流的时刻不同，母线上的电流纹波被部分抵消，这是交错并联降低输入滤波体积的收益来源；但同时也意味着每一相看到的实际输入电压含有另一相造成的纹波分量，两相受到的激励在细节上不再完全对称。

第二，输出侧两相整流后的电流在时间上交错叠加，输出电容看到的纹波频率翻倍，滤波压力下降，但两相对输出节点的"贡献权重"取决于各自的电流幅值，一旦幅值失衡，叠加波形的对称性被破坏，纹波抵消的好处也被吃掉一部分。

把这两点合起来看：交错并联的收益（纹波抵消、滤波缩小、轻载效率）和代价（均流敏感）是同一套拓扑结构的两面，不可能只挑收益。

2.3 IPOP 结构下的均流条件：为什么盯原边就够了

系统是输入并联、输出并联（IPOP）。两相输入电压相同、输出电压相同，理想情况下：

$$ V_{in1}=V_{in2}=V_{in},\quad V_{o1}=V_{o2}=V_o ;\Rightarrow; I_{o1}=I_{o2},\quad I_{in1}=I_{in2} $$

也就是说，只要控制住各相原边侧电流平衡，输出侧的均流自动成立——因为变比相同、输出并联，原边电流均衡必然对应副边电流均衡。这个推理是后面所有方案的靶心：均流控制的抓手在原边，不在副边。

衡量手段用不平衡度：

$$ CS_{error}=\frac{\max|I_i-I_j|}{I_o/(n-1)}\times 100% $$

分母是总输出电流按相数折算的单相理想值。这里有个容易被忽略的细节：分母除以的是 $n-1$ 而不是 $n$（对两相即等于 $I_o$），因为最大差值天然包含了"一相多、一相少"的对偶关系，用总电流归一化更直观。工程上一般希望把满载和半载两种工况下的 $CS_{error}$ 都压在 5% 以内，只测满载是不够的——轻载时谐振腔工作在更靠近 $f_r$ 的区域，增益曲线斜率更陡，同样的参数偏差会放大成更大的电流偏差，这是血泪经验里最常见的漏测项。

2.4 三类参数的敏感度不是一回事

把 $L_m$、$L_r$、$C_r$ 分别拉偏做扫描，结论差别很大：

$L_m$ 偏差影响小，原因在于 $L_m$ 主要决定死区期间的续流和增益曲线的"腰部"形状，在 ZVS1 工作区的正常工作点上，$L_m$ 对交流增益的一阶影响被 $L_m$ 与负载并联的分流关系稀释掉了。而 $L_r$ 和 $C_r$ 直接决定 $f_r$，$f_r$ 一偏，整条增益曲线沿着频率轴平移，同一 $f_s$ 下的工作点位置就变了，增益偏差是一阶的。

这个敏感度排序直接决定了工程上的公差分配策略：谐振电感和谐振电容要卡紧，励磁电感可以松一些。反过来说，如果方案能在物理结构上强制 $L_r$ 和 $C_r$ 匹配，均流问题就解决了一大半——这正是磁集成方案的出发点。

3. 磁集成均流：用耦合把两相谐振电感"焊"成一体

3.1 反向耦合的物理直觉

传统做法是两只独立谐振电感，绕制工艺限制导致电感量必然有偏差。磁集成方案换了个思路：把两相谐振电感绕在同一个磁芯上，让它们共享磁路。

两相谐振电感反向耦合（耦合系数为负），绕组匝数 $N_1=N_2=N$，稳态时两相原边电流 $i_{p1}=i_{p2}$。耦合的数学表达是引入互感 $M=k\sqrt{L_{r1}L_{r2}}$，两相电压方程耦合在一起：

$$ v_{r1}=L_{r1}\frac{di_{r1}}{dt}+M\frac{di_{r2}}{dt},\qquad v_{r2}=L_{r2}\frac{di_{r2}}{dt}+M\frac{di_{r1}}{dt} $$

反向耦合的含义是 $M<0$。当某一相电流试图增大时，它在共用磁路上产生的磁通变化会在另一相绕组中感应出阻止这种不平衡加剧的电压——这是一种被动的、无需采样的自平衡机制。

提示：耦合的方向（同向还是反向）必须和两相驱动相位差匹配。交错并联是180°相位差，配反向耦合；若误接成同向耦合，两相磁通在磁芯中叠加而不是抵消，不仅失去均流效果，磁芯还会因为直流偏磁叠加而饱和。

3.2 耦合之后的等效电路怎么算

引入耦合后，交流等效电路里的阻抗矩阵不再是两个独立的对角元。设：

$$ Z_1=\frac{1}{j\omega C_{r1}}+j\omega L_{r1}+j\omega L_{m1},\qquad Z_2=\frac{1}{j\omega C_{r2}}+j\omega L_{r2}+j\omega L_{m2},\qquad Z_M=j\omega M $$

两相电流由耦合方程组确定：

$$ \begin{cases} \dot V_{i1}=Z_1\dot I_{p1}+Z_M\dot I_{p2}\[4pt] \dot V_{i2}=Z_2\dot I_{p2}+Z_M\dot I_{p1} \end{cases} $$

解出来可以看到，耦合项 $Z_M$ 出现在两支路的交叉位置，相当于在两相之间插入了一个"阻抗弹簧"。当 $Z_1\ne Z_2$（参数有偏差）时，耦合项会把两相电流的差值往回拉，拉回的力度随耦合系数 $k$ 增大而增强。极端情况下 $k\to1$ 且 $L_{r1}=L_{r2}$，两相电流被完全强制相等——当然这只是理论极限，实际受漏感和工艺限制。

3.3 从理想模型到实际模型：漏感是不能忽略的那一笔

理想耦合假设磁通全部闭合在共用磁路里，但实际磁芯有漏磁。工程上把每相电感拆成激磁部分和漏感部分：

$$ L_{r1}=L_{k1}+L_{i1},\qquad L_{r2}=L_{k2}+L_{i2},\qquad M=k\sqrt{L_{i1}L_{i2}} $$

其中 $L_k$ 是漏感，$L_i$ 是参与耦合的激磁电感。这一步拆分的意义在于：漏感不参与耦合，它相当于串联在每一相里的一只"不可控"电感，会削弱耦合的均流力度，还会在两相之间引入额外的相位差。做磁集成设计时，漏感占比是核心工艺指标——漏感占比越大，耦合系数 $k$ 越小，均流能力越弱。

一套可复现的分析流程大致是：

# 两相磁集成 LLC 均流敏感度扫描（示意） import numpy as np def current_split(Lr1, Lr2, Cr1, Cr2, M, Vin_fha, fsw): """给定两相谐振参数与互感，解耦合方程组得到两相电流幅值比""" w = 2 * np.pi * fsw # 各相自阻抗（忽略 Lm 分流，仅看谐振支路，用于趋势判断） Z1 = 1/(1j*w*Cr1) + 1j*w*Lr1 Z2 = 1/(1j*w*Cr2) + 1j*w*Lr2 ZM = 1j*w*M # 解 [[Z1, ZM], [ZM, Z2]] @ [I1, I2] = [V, V] A = np.array([[Z1, ZM], [ZM, Z2]]) b = np.array([Vin_fha, Vin_fha]) I = np.linalg.solve(A, b) return abs(I[0]), abs(I[1]) # 基准参数 Lr, Cr = 30e-6, 33e-9 M0 = -0.8 * Lr # 反向耦合，k=0.8 for dev in [0.01, 0.03, 0.05, 0.10]: I1, I2 = current_split(Lr*(1+dev), Lr, Cr, Cr, M0, 100e3) # 不平衡度：两相电流差 / 总电流 err = abs(I1 - I2) / (I1 + I2) * 100 print(f"Lr 偏差 {dev*100:5.1f}% -> 不平衡度 {err:5.2f}%")

这段代码的作用是趋势验证，不是精确设计工具：它把 $L_m$ 的分流忽略掉，只保留谐振支路和互感的耦合关系，用来快速判断"耦合系数取多大时，能把某个参数偏差压到多少不平衡度"。实际设计中必须把 $L_m$ 并联支路、副边折算电阻 $R_{eq}$、死区效应全部纳入，用基波等效法逐点求解，再和仿真对账。第三行M0 = -0.8 * Lr里的负号就是反向耦合的标记，改成正号可以复现"耦合方向接错"的翻车场景，能直观看到不平衡度反而恶化。

3.4 磁集成带来的连带收益

把两只谐振电感合到一只磁芯上，均流只是收益之一。体积和重量下降是直接的——磁性元件在开关电源里占的体积比重大，两只变一只几乎是减半；磁芯损耗的分布也会变化，两相磁通反向抵消后，共用磁路的交流磁通幅值下降，磁芯损耗随之降低。另一层收益是绕组一致性：绕在同一只磁芯上的两个绕组，用同一根线、同一次绕制、同样的位置，一致性天然优于两只独立电感各自绕制，从源头上压小了 $L_r$ 偏差——这比事后靠耦合去补偿更根本。

这里有个设计取舍值得说清：耦合系数不是越大越好。$k$ 增大，均流能力强，但两相的动态过程被绑得更紧，一相的负载突变会通过耦合通道更快地影响另一相，动态响应的一致性要求提高；同时大 $k$ 意味着漏感小，而漏感在LLC里并非全无用处，它参与谐振、影响增益曲线的形态。常见的实现思路是把 $k$ 定在0.7～0.9区间，在均流强度和动态解耦之间取折中。

4. 全耦合电感与次级绕组分组：从"补偿偏差"转向"消除偏差"

4.1 全耦合电感器方案在解决什么

磁集成方案本质上是在参数已经有偏差的前提下，用耦合去把偏差的影响压下去——属于"事后补偿"。全耦合电感器方案往前走了一步：让两相的谐振电感耦合得更彻底，以至于两相的谐振电流在稳态下被强制同步，参数偏差对电流分配的影响被结构性消除，而不是靠耦合强度去"拉"。

它的代价在于耦合越彻底，两相越像一个整体，交错并联原本带来的"相位错开"收益会被削弱。交错并联的价值在于两相不同时工作，输入输出纹波互相抵消；耦合越强，两相的独立性越差，纹波抵消的效果就越依赖耦合本身的对称性。所以这类方案的适用边界很清楚：参数偏差是主要矛盾、纹波抵消是次要诉求的场合更合适；如果应用对输入电流纹波极其敏感，就要重新算这笔账。

4.2 变压器次级绕组分组连接的思路

前面的方案都在原边侧做文章，次级绕组分组连接换了个切入角度：通过改变变压器次级绕组的连接方式，让两相的输出电流在拓扑层面就被强制分配。

原理不复杂。两相变压器次级如果各自独立整流再并联，那么每一相的输出电流由该相自己的原边电流决定，原边不平衡直接传导到副边。而如果把次级绕组按组连接——比如两相次级串联后再整流，或者交叉连接构成特定的电流路径——那么副边的电流路径被拓扑强制约束，一相想多输出电流，就必须有另一条路径配合，均流变成了连接方式的自然后果，不需要额外的检测和控制。

这个思路的诱人之处在于它完全被动：没有采样、没有控制环路、没有附加元件，均流能力不依赖参数精度，也不引入动态稳定性问题。这正是前面提到的几种有源方案（移相变频控制、附加谐振电感、电流平衡单元、阻抗匹配）共同的软肋——它们要么需要额外的电流检测电路，要么引入附加元件增加损耗，要么控制复杂、动态稳定性难保证，要么像两相驱动同相位那样破坏了交错工作的本意。

代价同样存在：次级绕组分组连接会改变变压器的绕组结构，窗口利用率和绕制工艺复杂度上升；而且连接方式一旦确定就固化在硬件里，灵活性差，不能像控制方案那样在线调整。此外，分组连接对两相变压器的一致性提出了更高要求——它消除的是电流分配的自由度，但如果两相变压器本身的变比就有偏差，拓扑约束也无法完全吸收。

4.3 三种方案横向对照

三种方案的共同点值得单独拎出来：它们都放弃了"检测—比较—调节"的闭环思路，转而用磁路或电路拓扑本身去承载均流功能。这个转向背后的判断是——LLC的均流问题根源在参数不一致，而参数不一致是工艺问题，用控制去追工艺偏差，等于用高频的动态调节去对抗一个静态的、随温度和老化缓慢漂移的量，代价高、鲁棒性差。用无源结构去约束，反而更契合问题的性质。这是我认为整份材料里最值得咀嚼的设计取舍。

5. 避坑与排查：均流方案落地时最容易翻车的几处

5.1 只测满载不平衡度

现象：满载 $CS_{error}$ 做到 3% 以内，交付后轻载工况被反馈电流偏得厉害。

原因：轻载时 $Q$ 变小，工作点向 $f_r$ 靠近，增益曲线在该区域斜率更大，同样的参数偏差被放大成更大的增益差，进而放大成更大的电流差。满载时曲线平缓，偏差被"压"住了，形成假象。

解决：满载、半载、轻载三点都测，取最差点作为设计裕量的判据。若轻载不过关，优先收紧缩小 $L_r$、$C_r$ 的公差，而不是加大耦合系数硬压。

5.2 耦合方向接反

现象：换上磁集成电感后，不平衡度不降反升，有时甚至比两只独立电感还差。

原因：交错并联两相驱动相位差180°，必须配反向耦合让磁通在共用磁路中抵消。若绕组极性接成同向，两相磁通叠加，磁芯工作点偏移甚至饱和，耦合项起的是"助推"不平衡的作用。

解决：上电前用低压小信号测两相绕组的感应电压极性，确认反向；同时检查磁芯气隙设计是否按反向耦合的磁通抵消工况计算，避免按单相工况选型导致磁密超标。

5.3 忽略漏感占比

现象：仿真里耦合系数取0.9，均流效果很好，实物做出来只有0.6出头，均流能力大打折扣。

原因：实际磁芯的漏感不参与耦合，等效耦合系数被漏感拉低。绕制工艺（绕组分布、层数、气隙位置）直接决定漏感占比，而这一步在电路仿真里最容易被理想化。

解决：把漏感作为独立参数建进模型（$L_r=L_k+L_i$，$M=k\sqrt{L_{i1}L_{i2}}$），用有限元或实测反推 $L_k$；绕制上尽量让两相绕组对称分布、耦合紧密，气隙位置避开耦合路径。

5.4 死区时间与 ZVS 裕量被均流方案吃掉

现象：均流达标了，但轻载时原边开关管丢 ZVS，效率反而下降、EMI 变差。

原因：磁集成改变了谐振腔的等效电感，死区期间参与续流的电感量变化，若死区时间仍按原方案设定，励磁电流不足以在死区结束前把开关管结电容放电到零。均流方案优化的是稳态电流分配，ZVS 裕量是另一条独立的约束，两者会互相挤占设计空间。

解决：按新的等效电感重算死区时间，实测开关管漏源电压波形确认是否真正到零；若裕量不足，适当减小 $L_m$ 提高励磁电流，或调整死区，不要只盯不平衡度这一个指标。

5.5 用闭环均流去压静态偏差

现象：加了电流采样和调节环，稳态均流做到了1%以内，但动态负载跳变时两相电流出现明显的不一致振荡，恢复时间变长。

原因：LLC 的增益由频率决定，均流环通过微调频率或相位去改变某一相的增益，本质上是在和一个由工艺决定的静态偏差做动态对抗。环路带宽受限于 LLC 本身的动态特性，一旦负载突变，两相的瞬态响应不一致被环路放大。

解决：优先用无源结构（磁集成、绕组分组）把静态偏差压到可接受范围，控制环只做小量修正甚至不做；若必须用有源方案，把环路带宽压低、只处理慢漂移，别指望它处理瞬态。

6. 设计取舍的边界：什么时候该用无源均流，什么时候不该

把这几套方案放在一起看，会发现它们共享一个判断：LLC 交错并联的均流问题，本质是"参数不一致"这个静态工艺问题，用无源结构去约束比用有源控制去对抗更经济。这个判断成立，但有边界。

第一个边界是偏差的来源。如果偏差主要来自 $L_r$、$C_r$ 的制造公差，那是稳定的、可预测的、不随运行大幅漂移的，无源结构完全够用；但如果偏差来自温升导致的磁芯参数漂移、或者老化，那就带上了时变特性，无源结构只能保证"初始匹配"，长时间运行后的漂移它管不了。这时候要么在磁芯材料上选温度特性平的，要么保留一个慢速的修正环。常见的实现思路是把无源结构作为主手段、把有源修正作为兜底，而不是二选一。

第二个边界是功率等级和相数。两相的时候，耦合、绕组分组这些手段都还清晰可控；相数上去之后，耦合路径的数量按组合增长，磁集成从"一只磁芯两个绕组"变成多绕组共用磁路，漏感控制、绕组对称性、磁通抵消的设计难度都是非线性上升。这时候无源方案的工艺成本可能超过有源方案，需要重新算账。

第三个边界是交错并联的收益权重。如果这个应用采用交错并联主要是为了缩小输入输出滤波器（对纹波敏感），那强耦合方案会削弱这个收益，得权衡；如果主要是为了分摊器件电流应力、提升轻载效率（对纹波不那么敏感），强耦合方案的代价就小得多。同一个技术，在不同的收益权重下结论可能相反。

我一般的验证习惯是三步走：先做参数敏感度扫描，把 $L_m$、$L_r$、$C_r$ 各自的偏差容忍度画出来，确认主要矛盾在哪个参数上；再按主要矛盾选方案，$L_r$ 敏感就上磁集成，变压器一致性差就考虑绕组分组；最后满载、半载、轻载三点实测不平衡度，同时复查 ZVS 裕量和纹波抵消效果——两个指标一起看，因为均流方案很容易在改善一个指标的同时悄悄恶化另一个。

这套"先扫敏感度、再选结构、最后多指标对账"的流程，是从几次只盯不平衡度、结果在轻载和 ZVS 上翻车的经历里攒出来的。从那以后我每次评估均流方案，都强制走一遍敏感度扫描，不再凭"耦合系数调大点应该就好了"这种直觉下手。希望帮到你。

这份材料把两相 LLC 从增益曲线、敏感度分析一路推到磁集成、全耦合电感、次级绕组分组三条无源均流路线，参数扫描和不平衡度定义都给了可复现的口径，顺着推导走一遍，比看十篇综述更能建立判断力。

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