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又到了整理秋招笔试题的时候。IC方向的笔试题目来来去去就那些，LDO电路分析几乎每届都会出现，而且出现频率高得惊人。我帮导师带过几届找工作的师弟师妹，翻过不少公司的模拟IC笔试题和数字IC手撕题，十套卷子里至少有六套能碰到LDO，有的数字IC岗位笔试题也会冷不丁塞一道LDO功耗计算。这篇文章就把LDO笔试的核心考点、手撕题的解题套路、以及容易丢分的细节从头撸一遍，适合准备秋招的IC方向学生，也适合刚入行想补电源管理基础的朋友。

1. LDO在秋招笔试里的高出场率：面试官到底想考什么

1.1 从一道4.2V转3.3V的选型题说起

我这两年模拟面试最常用的一道开场题是“电池4.2V，要转3.3V给MCU供电，选DCDC还是LDO”。这道题在笔试题和面试题里都经常出现，因为它同时考察基础概念和工程判断。答案并不是非黑即白，而是看负载电流和噪声敏感度：小电流、噪声敏感、成本敏感的场合选LDO，大电流、追求效率的场合选DCDC。

举个典型例子：负载只有几十毫安时，LDO的效率大约是3.3V/4.2V等于78.6%，完全能接受，而且外围只要一个输入输出电容，纹波极小；负载到几百毫安以上时，压差损耗变成实实在在的发热，LDO效率会迅速变差，这时DCDC用储能电感换效率，能做到90%以上，代价是开关纹波和EMI。笔试题里如果出现“负载电流”“噪声敏感”这些词，就是在暗示选型方向。

这道引子题背后的所有讨论，最后都会落到LDO本身的电路分析上：压差、静态电流、效率、环路稳定性、电源抑制比，每一项都能单独拎出来出题。

1.2 高频考点与考察能力映射

我把刷题阶段见过的LDO相关题目归了个类，出题点高度集中在下面这些方向：

这张表也是我复习LDO时的提纲。数字IC方向的同学别觉得与自己无关，我见过不少数字岗位笔试题在功耗估算部分放一道LDO选型，让你判断某电压域用DCDC还是LDO供电更合理。LDO虽然看起来是模拟电路，但它作为电源管理的基础模块，是芯片系统里绕不开的一环。

2. 笔试版LDO基础：误差放大器、调整管与反馈分压是怎么协同工作的

2.1 三句话讲清LDO闭环

LDO本质是一个带功率输出级的串联负反馈稳压器。结构上就四块：误差放大器，调整管，反馈电阻分压器，基准电压源。输出Vout经过分压得到Vfb，误差放大器把Vfb和Vref的差值放大，再去调整调整管的阻抗，让输出回到设定值。

公式推导也直接。Vfb等于Vout乘以R2除以R1加R2，负反馈稳定之后Vfb等于Vref，所以Vout等于Vref乘以括号里1加R1比R2。这个公式是LDO笔试题第一步最常用的结论。要注意反馈分压电流和误差放大器输入偏置电流是两回事，题目如果给了“分压电流”这个条件，说明R1和R2有确定工作点，不要想当然认为分压电阻电流为零。

可以做一个生活化类比：LDO相当于一个带自动控制的水龙头，水压不稳时水龙头自动开大关小，保证稳定出水。误差放大器是大脑，调整管是阀门，反馈电阻是水位尺。理解了这个闭环逻辑，后面所有指标都好记：线性调整率是进水压力变化时的稳流能力，负载调整率是出水阻力变化时的稳压能力，稳定性是这套自动控制会不会震荡的问题。

2.2 笔试高频指标速查与易错点

笔试中LDO指标不外乎这几个，但每个都有坑。下面这个表是我复习时反复用过的速查表：

Dropout是最容易理解错的概念。LDO的低压差指的是调整管完全导通时所需的最小输入输出压差，PMOS型就是输出电流乘以导通电阻。题目给5V输入3.3V输出，很多人一看压差1.7V直接说没问题，但真正该查的是最小输入电压条件下、最大输出电流时，调整管是否还有足够的调节余量，以及热耗能不能接受。这两个问题才是工程关键。

效率也是重灾区。线性稳压器效率上限是Vout除以Vin，但实际输入电流还要加上Iq和反馈分压电流。输出10mA、Iq等于50μA时影响不大，输出1mA时Iq占比就到了5%，这就解释了为什么超低功耗场景里各家都在卷极低Iq。低频PSRR和线性调整率本质上是一回事：环路增益越高，输出对输入变化的抑制越强，所以提高误差放大器增益能同时改善这两项指标。

3. 调整管的四门流派：为什么PMOS型LDO是笔试默认答案

3.1 四种调整管拓扑背后的逻辑

LDO性能差异很大程度由调整管决定。笔试常出现的类型就四种：NPN达林顿、PNP、PMOS、NMOS。

NPN达林顿是7805时代的老方案，两个NPN管叠成达林顿对，导通压差至少两个Vbe加饱和压降，差不多1.5到2V，低压差根本无从谈起。好处是输出阻抗低、环路简单，坏处是静态电流偏高，体积也大。

PNP型用一个PNP管当调整管，Dropout降到Vce_sat，约0.1到0.3V，比NPN达林顿进步不少。缺点是基极驱动电流等于集电极电流除以β，负载1A时基极驱动就是几十毫安量级，轻载效率很难做好，所以推不动超低功耗需求。

PMOS型是CMOS工艺的自然产物。PMOS栅极是电压驱动，不需要持续基极电流，误差放大器输出一个电压就能控制，Iq可以做到微安级。Dropout等于导通压降Iout乘Rds_on，也可以做得很低。现代低压差LDO基本都是PMOS型，这也是笔试默认场景：看到PMOS调整管，源极接Vin、漏极接Vout、栅极接误差放大器输出。

NMOS型性能其实相当强，但栅极电压必须比输出高一个Vth，源极跟随器结构需要电荷泵或额外电源把栅极抬上去，电路复杂度自然增加。它的优点是瞬态响应好、Dropout压差可以做到非常小，笔试偶尔会以“对比NMOS与PMOS型LDO”的形式出现，答案核心就是NMOS需要抬高栅极驱动。

3.2 一张表解决拓扑选择题

这张表如果出现在解答题里，可以作为结论写上去。面试官真正想听的是一句话：调整管选型本质上是在Dropout、Iq、驱动复杂度、稳定性之间做权衡，PMOS恰好各项都占优，所以是主流。

3.3 拿到LDO电路图后的第一步

笔试手撕LDO题拿到电路图，我的习惯是先找调整管，判断它是什么类型，再判断栅极或基极驱动来源。这一步直接决定后续所有题目的方向。PMOS型会问“EA输出拉越低，输出电流越大”，PNP型会问“基极电流不能忽略”，NMOS型会问“为什么需要Charge Pump”。拓扑判断错了，后面怎么算都是白给。

4. 稳定性分析才是手撕主战场：极点、零点与补偿套路

4.1 为什么LDO的稳定性比普通运放更难

笔试里最容易拉开差距的是稳定性分析。LDO是一个闭环系统，必然有极点。普通运放输出级驱动固定电阻电容，极点位置基本稳定；LDO的输出负载电流可以从微安变到安培，负载电阻和输出极点随之大幅移动。输出极点f_pout等于1除以2π乘R_L乘C_out，负载电流1mA时等效R_L是3.3kΩ，300mA时只有11Ω，同样10μF电容下极点从48Hz变到1.45kHz，跨度接近两个数量级。

这意味着你不能设计一个固定补偿就覆盖所有工况，补偿策略必须保证整个负载范围内都有足够相位裕度。面试官出稳定题，想看的不是你会不会背“加ESR零点”这句话，而是你会不会分析这个随负载移动的极点。

4.2 手撕环路传递函数的基本功

稳定性手撕题的基本套路是建小信号模型。误差放大器增益写成A_EA，PMOS调整管跨导写成gm_pass，输出端等效负载是R_L，输出电容C_out带ESR。

环路增益可以近似写成：

T(s)等于A_EA乘gm_pass乘R_L乘β，再除以括号1加s比ω_pEA括号乘括号1加s比ω_pout括号，最后乘以括号1加s比ω_ESR括号。

其中β等于R2除以R1加R2，ω_pout等于1除以R_L乘C_out，ω_ESR等于1除以ESR乘C_out。这个近似模型够笔试用，不需要Spice精度，关键是考察会不会把环路拆成增益级、输出级、反馈网络三段。

算完直流增益之后画渐近Bode图：找到主极点，按每十倍频20dB下降，找到单位增益频率，再看单位增益频率处有哪些极点和零点贡献相位。相位裕度等于180度减去所有极点相位贡献，再加上零点相位贡献。

这里要提醒一句：手撕题里的零极点模型是简化模型，真实设计还要考虑功率管寄生电容、封装电感、片内ESR等，所以笔试答案把“趋势稳定或不稳定加理由”写清楚，比硬写一个数字更重要。

4.3 两类主流补偿：ESR零点与内部米勒补偿

LDO最经典的补偿是“借”输出电容的ESR电阻制造零点。零点频率f_ESR等于1除以2π乘ESR乘C_out，典型钽电容ESR在几十毫欧到几欧姆，零点落在几十k到几百kHz，正好可以放到单位增益频率附近把相位拉回来，这是老派LDO喜欢钽电容的原因。ESR太大或太小都不行：太大零点频率太低，低频相位被扳回来太早，会影响环路低频特性；太小零点跑到带宽外面，等于没补偿，还可能引入高频噪声。面试题常问“输出电容为什么必须选ESR在一定范围的钽电容”，对应就是这个原理。

现代LDO为了用陶瓷电容，因为陶瓷电容ESR只有几毫欧，ESR零点太高看不清，于是开始换内部米勒补偿。内部补偿把主极点放在误差放大器输出端，通过Miller电容把非主极点推到更高频，摆脱对外部电容ESR的依赖。笔试问到“为什么新LDO不需要钽电容”，答案就是内部补偿把零点制造在片内，外部电容选陶瓷电容也没问题。

4.4 一个稳定性判断的小例题

我用一个典型题干演示判断流程。假设输出3.3V、负载100mA、C_out等于10μF、反馈β等于0.36、EA增益60dB、PMOS跨导0.5A/V、输出电容ESR等于0.1Ω。输出等效R_L等于3.3V除以100mA等于33Ω，输出主极点f_pout等于1除以2π乘33乘10μ，约482Hz。环路直流增益约等于1000乘0.5乘33乘0.36，约5940，按单极点主导估算单位增益频率约2.86MHz。ESR零点f_ESR等于1除以2π乘0.1乘10μ，约159kHz，落在单位增益频率之前，能显著提升相位。如果EA输出极点放到5MHz，带宽附近主要由输出极点主导，加上零点回升，相位裕度趋势是够的。换成ESR只有0.01Ω的陶瓷电容，零点升到1.6MHz附近，补偿效果变弱，这时就必须靠内部Miller补偿。这个例题的结论不是让你背数字，而是掌握“找极点、找零点、看零点位置”的判断顺序。真实投片前一定还要跑环路稳定性仿真和蒙特卡洛，笔试答到这一层已经超过大多数人了。

4.5 稳定性题里的高频陷阱

最后总结几个我见过的高频陷阱。第一个是把输出极点当成固定参数，忘了负载电流变化会让它移动；第二个是看到ESR就以为一定有零点，ESR零点只有ESR和C_out都确定才存在；第三个是忽略误差放大器输出本身的高阻节点，很多LDO的第二极点就在EA输出级，带宽设计时要留余量；第四个是把“有零点”等同于“一定能稳定”，零点放错位置照样出问题。把这几个答出来，阅卷人会认为你真做过LDO，而不是只会背PPT。

5. 线性调整率、负载调整率与PSRR：计算题里的公式陷阱

5.1 三个“调整率”到底在描述什么

线性调整率和负载调整率是LDO开环增益的两种直观体现。线性调整率衡量输入电压变化ΔVin时输出变化ΔVout，负载调整率衡量负载电流变化ΔIout时输出变化ΔVout。低频PSRR和线性调整率本质是同一个东西，都是输入到输出的抑制能力，只是PSRR换成了dB单位。

笔试里刷到这三个概念，先写公式再代入：

• 线性调整率：ΔVout除以ΔVin约等于1除以A_loop乘β
• 负载调整率：ΔVout除以ΔIout约等于1除以gm_pass乘A_EA乘β
• PSRR：20倍lg括号ΔVin除以ΔVout括号，单位dB

低频频段下，PSRR的绝对值就是线性调整率的对数版本。提高环路增益能同时改善这三项，这就是LDO核心运放需要高增益的原因。严格推导线性调整率还要考虑调整管的电源直通路径，但笔试通常给的是简化模型，题目没给开环电源抑制比就按闭环增益近似写，问题不大。

5.2 一个会让人丢分的计算题：Iq和反馈分压电流

来一道几乎每年都在变形的题。输出3.3V，Vref等于1.2V，反馈分压电流定为10μA，Vin等于4.2V，Iout等于10mA，Iq等于30μA。求R1/R2、静态功耗和效率。

先求反馈网络。Vref等于Vout乘R2除以R1加R2等于1.2V，所以R2除以R1加R2等于0.3636。分压电流10μA，总电阻R1加R2等于3.3V除以10μA等于330kΩ，R1等于210kΩ，R2等于120kΩ。

再算静态功耗。LDO自身消耗的电流包括两部分：给定Iq等于30μA，还有反馈分压电阻从Vout到地流过的10μA。静态功耗等于Vin乘以括号Iq加反馈分压电流括号，也就是4.2V乘40μA等于0.168mW。很多人只把Iq算进去，漏掉反馈分压电流，这在低功耗题里会差出25%。

最后算效率。输出功率33mW，输入功率等于4.2V乘以括号10mA加30μA加10μA括号，约42.17mW，效率约78.3%。输入电流要把输出电流和所有从Vin汲取的电流加总，不能只算输出电流。反馈分压电流虽然是从Vout取的，但Vout的能量最终也来自Vin，功耗预算里不能省略。

5.3 负载调整率一步到位

负载调整率不用死背公式，可以现场推。负载电流突然增加ΔIout，输出电压有下降趋势，反馈环路发现Vfb变低，误差放大器增大调整管栅极驱动，让调整管多供电流。最终输出变化量取决于环路把这一变化拉回来的能力。

闭环输出阻抗约等于1除以gm_pass乘A_EA乘β。比如gm_pass等于0.5A/V，A_EA等于1000倍，β等于0.36，闭环输出阻抗约5.6mΩ，负载从0到300mA突变时，输出变化约1.7mV。这个量级和真实LDO的负载调整率对得上。算到这里，再解释“为什么高增益运放能改善负载调整率”就有底气了。

6. 一道经典LDO综合题的完整破题过程（手撕版）

6.1 题目还原

综合题最接近真实秋招手撕场景。题目文字描述如下：

输入电压范围4.8V到5.2V，目标输出3.3V，最大负载电流300mA。反馈基准Vref等于1.2V，设计要求反馈分压电流10μA。PMOS调整管Rds_on等于0.5Ω，静态电流Iq等于50μA，误差放大器增益60dB。输出电容10μF，ESR等于0.1Ω。要求完成四件事：求R1/R2；判断4.8V输入、300mA负载时能否正常稳压；求满负载效率；判断环路稳定性并给出补偿建议。

这个题干覆盖了反馈、dropout、功耗、稳定性四个维度，是典型LDO综合题。

6.2 分步解题

第一步反馈网络。β等于R2除以R1加R2，等于Vref除以Vout，也就是1.2除以3.3约等于0.3636。分压电流10μA意味着R1加R2等于3.3V除以10μA等于330kΩ。R2等于0.3636乘330kΩ约120kΩ，R1等于210kΩ。如果题目没给分压电流，一般会要求你设一个远大于Iq和负载最小电流的值，避免分压电流带来的漏电误差。

第二步稳压条件。不要只看5V减3.3V等于1.7V。最大负载300mA时调整管导通压降Dropout约等于Iout乘Rds_on，也就是0.3A乘0.5Ω等于0.15V。输入最低4.8V时稳态压降是1.5V，仍然大于0.15V，调整管没有进入Dropout限幅状态，环路控制有余量。最差条件是最低输入电压加最大负载电流，这时还能稳压才算数。

第三步效率。η等于3.3V乘0.3A，除以5V乘括号0.3A加50μA括号，约等于0.99除以1.50025，约66%。如果输入掉到4.8V，效率约3.3除以4.8等于68.75%。Iq在300mA面前几乎可以忽略，但题目给了这个条件，就要写进公式里展示细心。

第四步稳定性判断。先求输出等效负载R_L等于3.3V除以0.3A等于11Ω，输出主极点约1.45kHz。环路直流增益约等于1000乘0.5乘11乘0.3636约2000，也就是66dB。ESR零点等于1除以2π乘0.1Ω乘10μF约159kHz，落在主极点之后、单位增益带宽附近之前，能给环路补回足够相位。如果误差放大器输出极点放在5MHz以上，主导极点和零点构成的相位裕度是够的。但如果把输出电容换成ESR小于10mΩ的陶瓷电容，ESR零点会跑到1.6MHz以上甚至更高，补偿效果消失，环路可能在带宽附近出现相位裕度不足的问题。所以补偿建议是维持ESR在0.05Ω到0.2Ω范围的输出电容，或者改用带内部米勒补偿的LDO结构，外部配陶瓷电容就不能指望ESR救相位。

6.3 阅卷人眼里的得分点

这道题看似只要四个答案，真正决定分数的细节有五个：公式β最后代入数字而不是只摆符号；稳压条件用Vin_min而不是标称5V；效率把Iq加进分母；稳定性判断提到负载范围而不自说自话取一个固定R_L；补偿建议落到具体ESR范围。我见过的失分案例里，最常见的是第二步直接说“1.5V压差肯定没问题”，完全没提Dropout和Rds_on。这种答案看起来快，其实丢了最关键的系统判断。

把这道题当模板，你会发现所有LDO综合题都能拆成“反馈网络、最小工作条件、功耗、稳定性、补偿”五段。分步写清楚，阅卷人找分方便，你自己也不容易乱。

最后分享一个我自己的复习技巧：拿到LDO题先别急着算，先花10秒在电路图上圈出误差放大器、调整管、反馈网络三块，再给每个问题定位到对应模块。这个习惯能帮我避免一大半低级错误。LDO笔试考的不是记忆力，而是你拿到一个不熟悉的电源方案时，能不能快速把它还原成环路和器件两件事。把这两件事想清楚，再冷门的LDO变形题也绕不开这套逻辑。