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简介：本资源是基于STM32C8T6微控制器实现的IRIG-B时间码编解码完整工程，面向嵌入式系统开发者、电力/通信领域时间同步项目工程师及高校测控类课程实践者，解决高精度时间信号在资源受限MCU上的实时编码与双模式（int整型/uint8_t ASCII）解码难题。压缩包共302个文件，以70个.h头文件和68个.c源码为主干，辅以.o目标文件、.d依赖文件、.axf/.hex可执行镜像及keilkilll.bat等构建脚本，完整覆盖从底层定时器驱动（stm32f10x_tim.c）、IRIG-B帧解析逻辑到Keil MDK工程配置（uvprojx/uvoptx）的全链路实现。目前已有1040人学习下载，提供开箱即用的可编译工程，含TIMER模块专项调试文件、多版本备份（.bak/.sct.Bak）及PNG原理图等辅助材料，便于快速移植、功能验证与低功耗模式适配。

1. IRIG-B编解码合并包：STM32C8T6上跑通秒脉冲对时，不是调个RTC那么简单

你手头有一块最常见的STM32C8T6开发板，想让它精准同步到GPS/北斗授时模块输出的IRIG-B信号——不是靠串口发个时间字符串糊弄，而是真正解析B码帧结构、锁定PPS边沿、补偿传输延时、输出本地校准后的秒脉冲。很多人试过直接用HAL_UART_Receive_IT读串口数据，结果发现：波形看起来像B码，但解出的时间总差0.5～2秒；或者能解帧头，却卡在BCD校验位反复失败；更常见的是，用示波器一测，MCU输出的“同步秒脉冲”和输入B码PPS之间抖动高达±300μs，根本没法用于继电保护或时间戳打标。这个IRIG-B编解码合并.zip就是为这类真实工业场景打包的：它不是单个解码demo，而是一套可裁剪、带硬件验证、含完整时序补偿逻辑的STM32工程合集，专治IRIG-B在资源受限MCU上的“玄学失步”。适合电力自动化调试员、嵌入式时间同步模块开发者、以及正在啃IEC 61850对时规范的某高校实验室同学——别再从零写曼彻斯特解码器了，这里连DMA+定时器捕获+软件滤波的闭环都给你焊死了。

2. 为什么选STM32C8T6跑IRIG-B？硬件约束倒逼出的三重设计取舍

IRIG-B（AM调制型）信号本质是1kHz载波上叠加的曼彻斯特编码，每秒100帧，每帧含年、月、日、时、分、秒、天数、校验等字段。在STM32C8T6这种48MHz主频、20KB RAM、无FPU的芯片上硬解，必须直面三个物理现实：采样率不够、中断抖动大、RAM扛不住双缓冲。常见错误是照搬高性能平台方案——比如用ADC连续采样后FFT识别载波，或开100kHz定时器中断做比特判决。这在C8T6上必然翻车：ADC采样率顶多1MSPS，但曼彻斯特跳变边沿需至少5倍过采样才能可靠捕获；而100kHz中断本身就会吃掉30%以上CPU，更别说后续BCD转码、闰年计算、夏令时查表……所以本包所有设计都基于一个铁律：能用硬件外设搞定的，绝不用软件轮询；能用状态机简化的，绝不堆算法。

2.1 硬件层：复用TIM2+TIM3构建“边沿-电平”双触发捕获链

IRIG-B AM信号经运放调理后接入PA0（TIM2_CH1），同时将PA0通过施密特触发器反相后接PA1（TIM3_CH2）。这样设计不是为了炫技，而是解决C8T6的致命短板：单一定时器无法同时高精度捕获上升沿（PPS起点）和下降沿（曼彻斯特电平跳变）。TIM2配置为上升沿捕获模式，锁住每一帧的PPS时刻；TIM3配置为下降沿捕获+输入滤波（ICFilter=0x07），专门抓取载波过零点。两组捕获值存入环形缓冲区，由主循环按帧头特征（连续7个高电平bit）触发解析。关键参数如下：

// TIM2初始化：PPS上升沿捕获（精度±1个系统时钟周期） htim2.Instance = TIM2; htim2.Init.Prescaler = 47; // 48MHz / (47+1) = 1MHz计数频率 → ±1μs精度 htim2.Init.CounterMode = TIM_COUNTERMODE_UP; htim2.Init.Period = 0xFFFF; HAL_TIM_IC_Init(&htim2); HAL_TIM_IC_Start_IT(&htim2, TIM_CHANNEL_1); // 开启捕获中断 // TIM3初始化：载波下降沿捕获（带数字滤波抗干扰） htim3.Instance = TIM3; htim3.Init.Prescaler = 47; htim3.Init.CounterMode = TIM_COUNTERMODE_UP; htim3.Init.Period = 0xFFFF; HAL_TIM_IC_Init(&htim3); __HAL_TIM_SET_ICPRESCALER(&htim3, TIM_ICPSC_DIV8); // 8分频进一步降噪 HAL_TIM_IC_Start_IT(&htim3, TIM_CHANNEL_2);

提示：TIM_ICPSC_DIV8不是可有可无的配置。实测中若不启用输入预分频，电网谐波干扰会导致TIM3误触发，解码错误率从0.02%飙升至15%。这是某次现场调试血泪经验——换掉滤波参数后，同一块板子在变电站开关柜内连续72小时零误码。

2.2 协议层：精简IRIG-B DC码逻辑，砍掉所有非必要字段解析

标准IRIG-B DC码（直流偏置型）虽无载波，但本包默认适配AM型（因更常见），且主动放弃解析以下字段：

• 控制字段（Control Word）：C8T6无足够RAM存16字节控制字+校验逻辑，且多数工业设备不依赖此字段；
• 扩展年份（Extended Year）：仅支持2000–2099，用uint16_t存年份，省下4字节；
• 夏令时标志（DST）：国内统一用UTC+8，硬编码忽略该位，避免查表开销。

保留的核心字段仅5个：秒(0–59)、分(0–59)、时(0–23)、日(1–31)、年中第几天(1–366)。所有字段均以BCD格式存储，解码时用查表法替代除法运算（bcd_to_dec[100]数组仅100字节）。实测对比：软件除法解BCD平均耗时86μs/字节，查表法仅3.2μs/字节——这对每秒100帧、每帧100bit的实时性至关重要。

2.3 软件层：状态机驱动+双缓冲，把中断负载压到最低

整个解码流程不依赖FreeRTOS，纯裸机状态机实现。主循环只做三件事：检查新帧标志、调用irig_b_parse_frame()、更新RTC寄存器。关键设计是双缓冲+原子操作：TIM2/TIM3中断仅向capture_buf[2][CAPTURE_DEPTH]写入时间戳，不执行任何解析；主循环从buf_read_idx读取，解析完后原子更新buf_read_idx。缓冲区深度设为16（远大于理论最大帧率100Hz），彻底规避丢帧。代码逻辑如下：

// 全局双缓冲（volatile确保编译器不优化） volatile uint32_t capture_buf[2][CAPTURE_DEPTH]; volatile uint8_t buf_write_idx = 0; volatile uint8_t buf_read_idx = 0; // TIM2中断：仅存PPS时间戳 void HAL_TIM_IC_CaptureCallback(TIM_HandleTypeDef *htim) { if(htim->Instance == TIM2) { uint32_t ts = __HAL_TIM_GET_COUNTER(htim); capture_buf[buf_write_idx][write_pos++] = ts; if(write_pos >= CAPTURE_DEPTH) { write_pos = 0; buf_write_idx = !buf_write_idx; // 切换缓冲区 } } } // 主循环：安全读取并解析 while(1) { if(buf_read_idx != buf_write_idx) { // 有新数据 irig_b_parse_frame(capture_buf[buf_read_idx]); buf_read_idx = !buf_read_idx; // 标记已读 } }

注意：buf_read_idx与buf_write_idx切换必须用!而非++，否则在中断打断主循环时可能产生竞态。这是某次EMC测试翻车点——强磁场干扰下索引错位，导致解析出2100年的日期。

3. 编解码合并工程结构：从源码包到可烧录固件的六层落地路径

下载解压IRIG-B编解码合并.zip后，你会看到一个严格分层的工程目录。这不是IDE自动生成的混乱结构，而是按嵌入式交付标准组织的六层体系：硬件抽象→协议引擎→时间服务→应用接口→验证工具→烧录配置。每一层都对应一个可独立测试的模块，避免“改一行代码全崩”的灾难。下面带你逐层拆解，重点标注哪些文件必须改、哪些绝对不能碰。

3.1 第一层：Drivers/STM32F1xx_HAL_Driver/—— HAL库精简版（已裁剪83%）

原始STM32CubeMX生成的HAL库约4MB，但本包只保留4个核心文件：

• stm32f1xx_hal_tim.c：仅含HAL_TIM_IC_Start_IT()和HAL_TIM_IC_Stop_IT()，删掉所有PWM/OC功能；
• stm32f1xx_hal_gpio.c：仅保留HAL_GPIO_WritePin()和HAL_GPIO_ReadPin()，删掉EXTI相关；
• stm32f1xx_hal_rcc.c：仅含HAL_RCC_OscConfig()和HAL_RCC_ClockConfig()，删掉USB/SDIO时钟；
• stm32f1xx_hal.c：最小化初始化，禁用所有未用外设时钟。

提示：若你用其他F1系列芯片（如C6T6），只需修改Drivers/CMSIS/Device/ST/STM32F1xx/Source/Templates/gcc/startup_stm32f103xb.s中的启动文件名（xb→c6），其余无需改动。这是某导师带学生做课程设计时验证过的兼容方案。

3.2 第二层：Core/IRIG_B/—— 协议核心（含曼彻斯特解码器）

这是整个包的“心脏”，包含3个关键文件：

• irig_b_decoder.c：主解码逻辑，含irig_b_find_frame_header()（找7高电平同步字）、irig_b_decode_bitstream()（曼彻斯特解码）、irig_b_verify_crc()（16位CRC校验）；
• manchester_decoder.c：独立曼彻斯特解码器，输入TIM3捕获的下降沿时间戳数组，输出原始bit流。采用滑动窗口法：对相邻两个下降沿时间差Δt，若Δt∈[450μs,550μs]判为“0”，若Δt∈[900μs,1100μs]判为“1”；
• bcd_utils.c：BCD转十进制查表（bcd_to_dec[100]）和十进制转BCD（dec_to_bcd[100]），表长各100字节。

关键参数在irig_b_config.h中定义：

#define IRIG_B_BIT_WIDTH_US 500 // 标准位宽500μs（AM型） #define IRIG_B_TOLERANCE_US 50 // 允许±50μs抖动 #define IRIG_B_FRAME_RATE_HZ 100 // 每秒100帧 #define CAPTURE_DEPTH 16 // 捕获缓冲区深度

3.3 第三层：Core/TimeSync/—— 时间同步服务（含PPS补偿）

IRIG-B的PPS并非理想方波，从信号源到MCU引脚存在传输延时（PCB走线+运放延迟），本包提供两种补偿方案：

• 硬件补偿：在time_sync_hw.c中，通过HAL_TIM_OC_Start_IT(&htim1, TIM_CHANNEL_1)输出一路与PPS同频的校准脉冲，用示波器测量其与输入PPS的相位差，将该值填入TIMING_OFFSET_NS宏；
• 软件补偿：在time_sync_sw.c中，用HAL_GetTick()记录PPS中断到达时刻，与RTC当前值比对，动态调整RTC预分频器（RTC->PRER），实现亚毫秒级校准。

注意：TIMING_OFFSET_NS默认为0，首次使用必须实测！某次在长距离双绞线（50米）上传输时，测得延时为237ns，未补偿前时间偏差达±1.2ms。

3.4 第四层：Application/—— 应用接口（3种输出模式）

本包支持三种时间信息输出，按需启用：

启用UART输出时，波特率固定为115200（usart_init.c中硬编码），帧格式：$IRIG,2023,12,25,14,30,45*XX\r\n（XX为校验和）。

3.5 第五层：Tools/Validation/—— 验证工具（含Python脚本）

包内附赠validate_irig.py，用于离线验证解码正确性：

• 输入：logic_analyzer_capture.csv（Saleae Logic导出的PA0引脚波形CSV）；
• 输出：解码时间、帧率统计、CRC错误计数、PPS抖动直方图。
  运行命令：python validate_irig.py -i logic_analyzer_capture.csv -o report.html。
  该脚本会自动识别曼彻斯特编码、还原BCD字段、比对标准时间，是排查“解码正确但时间不准”问题的后悔药。

3.6 第六层：Project/MDK-ARM/—— Keil MDK工程（已配好全部选项）

Keil工程已预设：

• Target：STM32F103C8Tx，Flash大小64KB；
• Output：勾选Create HEX File，便于J-Link烧录；
• C/C++：-O2优化等级，-DUSE_FULL_LL_DRIVER启用LL库加速；
• Debug：J-LINK驱动，SWD接口，Reset and Run自动复位。
  重要：首次编译前，务必检查Project → Options → C/C++ → Define中是否含STM32F103xB（C8T6属于B系列），若误写为xC会编译失败。

4. 避坑指南：STM32C8T6跑IRIG-B的五个真实翻车现场

IRIG-B在C8T6上不是“能跑就行”，而是“差1μs就失效”。以下是某公司量产前踩过的5个坑，每一条都附带现象、根因和可立即执行的解决方案。别跳过——它们可能正等着在你板子上重现。

4.1 现象：示波器看PA0波形正常，但HAL_TIM_IC_CaptureCallback几乎不触发

原因：PA0引脚未配置为GPIO_MODE_AF_PP（复用推挽），而是GPIO_MODE_INPUT。C8T6的TIM2_CH1必须通过AFIO映射到PA0，普通输入模式无法触发捕获中断。
解决：检查MX_GPIO_Init()中PA0配置：

GPIO_InitStruct.Pin = GPIO_PIN_0; GPIO_InitStruct.Mode = GPIO_MODE_AF_PP; // 必须是AF_PP！ GPIO_InitStruct.Pull = GPIO_NOPULL; GPIO_InitStruct.Speed = GPIO_SPEED_FREQ_HIGH; HAL_GPIO_Init(GPIOA, &GPIO_InitStruct);

4.2 现象：解码出的时间秒数在0–1之间疯狂跳变，但分钟/小时稳定

原因：irig_b_decode_bitstream()中曼彻斯特解码窗口设置过窄。标准IRIG-B允许±10%位宽抖动（450–550μs），但代码中误写为[490,510]，导致部分“0”被误判为“1”，秒字段BCD校验失败后回退到上一帧的非法值。
解决：打开manchester_decoder.c，修改MANCHESTER_ZERO_MIN_US和MANCHESTER_ZERO_MAX_US：

#define MANCHESTER_ZERO_MIN_US 450 // 原490 → 改为450 #define MANCHESTER_ZERO_MAX_US 550 // 原510 → 改为550 #define MANCHESTER_ONE_MIN_US 900 // 原950 → 改为900 #define MANCHESTER_ONE_MAX_US 1100 // 原1050 → 改为1100

4.3 现象：烧录后板子不工作，Keil提示Error: Flash Download failed

原因：C8T6的Flash容量为64KB，但默认Keil工程链接脚本（STM32F103C8Tx_FLASH.ld）分配了128KB空间，导致地址越界。
解决：编辑链接脚本，将FLASH (rx) : ORIGIN = 0x08000000, LENGTH = 64K（原为128K）。或更简单：在Keil中Project → Options → Target → IROM1，Size改为0x10000（64KB）。

4.4 现象：UART输出时间正确，但PA8的PPS脉冲与输入PPS相位漂移越来越大

原因：未启用RTC校准。PA8脉冲由HAL_TIM_OC_Start_IT()生成，其基准是系统时钟（HSI/PLL），而IRIG-B解码后的时间存于RTC。若RTC未同步，OC输出只是“按自己节奏打拍子”。
解决：确保ENABLE_RTC_SYNC宏已定义，并在main.c中调用rtc_sync_from_irig()：

// main.c 中 while(1) 循环内 if(irig_b_frame_ready) { rtc_sync_from_irig(&decoded_time); // 此函数更新RTC寄存器 irig_b_frame_ready = 0; }

4.5 现象：在变电站现场测试时，解码错误率从0.01%飙升至20%

原因：未启用TIM3输入滤波。变电站强电磁干扰导致PA1引脚出现毛刺，TIM3误触发下降沿捕获。
解决：在tim.c中TIM3初始化后，强制启用数字滤波：

// 在 HAL_TIM_IC_Init(&htim3) 之后添加 __HAL_TIM_SET_ICPRESCALER(&htim3, TIM_ICPSC_DIV8); // 关键！ __HAL_TIM_ENABLE_IT(&htim3, TIM_IT_CC2);

5. 进阶技巧：用示波器+逻辑分析仪交叉验证IRIG-B解码精度

光让代码跑起来不够，工业场景要求可验证、可追溯。我一般会用三步法交叉验证：先看硬件信号质量，再验协议解析逻辑，最后测时间同步精度。这套方法帮我在某跨平台系统项目中提前两周定位出PCB布线导致的500ns延时偏差。

5.1 第一步：示波器抓原始信号，确认AM载波健康度

用示波器探头接IRIG-B信号源输出端（非MCU引脚），设置：

• 时基：200μs/div（看清单个bit）；
• 触发：上升沿，触发电平1.5V；
• 测量：开启“周期”和“峰峰值”自动测量。
  合格标准：
• 载波频率 = 1.000kHz ±0.01%（即999–1001Hz）；
• 调制度 ≥ 60%（峰峰值≥2.4V，谷值≤0.4V）；
• PPS上升沿时间 ≤ 100ns（若>200ns，需加终端电阻匹配）。
  若载波失真，所有后续解码都是空中楼阁——此时应检查信号源、运放供电、PCB阻抗匹配，而非改代码。

5.2 第二步：逻辑分析仪抓MCU引脚，验证捕获精度

用Saleae Logic（8通道款）同时抓PA0（输入B码）和PA8（输出PPS），设置：

• 采样率：20MHz（满足奈奎斯特采样定理）；
• 记录时长：1秒；
• 导出为CSV供validate_irig.py分析。
  关键看三组时间差：
  | 对比项 | 理论值 | 实测容忍范围 | 工具 |
  |--------|--------|--------------|------|
  | 输入PPS到TIM2捕获中断延迟 | 0μs | ≤1.5μs | Saleae时间标记 |
  | TIM2捕获到RTC更新延迟 | 0μs | ≤50μs |HAL_GetTick()打点 |
  | RTC更新到PA8输出PPS延迟 | 0μs | ≤200μs | Saleae通道间测量 |
  若任一环节超限，说明硬件配置或中断优先级有误。

5.3 第三步：NTP服务器比对，量化长期同步精度

将MCU的UART时间报文接入树莓派，用chrony同步到公共NTP服务器（如cn.pool.ntp.org），运行：

# 树莓派上执行 sudo chronyd -d -n -Q '210.72.145.44' # 国家授时中心IP # 同时用Python脚本解析UART报文，计算与chrony时间差 python irig_ntp_compare.py --serial /dev/ttyUSB0 --server cn.pool.ntp.org

输出示例：

[2023-12-25 14:30:45.123] IRIG-B time: 2023-12-25 14:30:45.000 [2023-12-25 14:30:45.123] NTP time: 2023-12-25 14:30:45.002 Offset: +2.0ms (std dev: 0.3ms over 60s)

验收红线：连续60秒内，平均偏移≤±5ms，标准差≤1ms。若超限，优先检查TIMING_OFFSET_NS是否准确，其次检查RTC晶振负载电容（C8T6推荐12.5pF）。

从那以后我每次调试IRIG-B，都强制走一遍这三步交叉验证——哪怕客户只要求“能显示时间”。因为时间同步不是功能，而是可信度。希望帮到你。

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