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做数字电子技术课程设计，十有八九绕不开74LS161这个4位二进制同步计数器。网上一搜"八进制计数器"，大部分方案都是拿它从0000数到0111，然后反馈清零或者反馈置数，套路很成熟。可一旦题目里多了一句话——"计数器初值为0100"，照着网上那些图抄作业就容易翻车：清零法只能回到0000，置数法置什么状态、从哪里检测反馈，都得重新设计。

我这次要实现的，就是从0100开始、走完8个状态、再自动跳回0100的循环计数，完整状态序列是0100→0101→0110→0111→1000→1001→1010→1011→0100。表面上看只是"初始值不是0"这么点差别，实际上整个设计的核心从"怎么清零"变成了"怎么利用同步置数功能把预置值装进去"，反馈逻辑、引脚连接、仿真初始状态、实物调试的坑，全都和标准八进制计数器不一样。这篇文章就把这个"从初值0100出发的8进制循环计数"完整复盘一遍。

1. 先说清楚：0100到1011这8个状态，才是这道题的"模8循环"

1.1 74LS161到底能数多大的数

要理解这个题目，先得把74LS161的老底摸清楚。74LS161是4位二进制同步加法计数器，内部由4个D触发器级联组成，所有触发器在同一个时钟上升沿同步翻转，所以它不存在行波计数器那样的累计延迟问题。4个输出端Q3、Q2、Q1、Q0可以表示0000到1111共16个状态，也就是天然的模16计数器。

但这只是一个"原始模数"。工程上要用它实现模8、模10、模12这些小于16的计数器，就得靠外部反馈电路在计满指定状态后，让它跳回起始状态。这里有个关键认知：74LS161本身并不知道你要数到几，它只知道每个时钟上升沿加1。所谓"八进制计数器"，完全由外部反馈决定——你想让它从0数到7再回0，或者从4数到11再回4，只要反馈逻辑写得对，它都能做到。

1.2 为什么"从初值0100开始"就排除了反馈清零法

最常见的八进制计数器方案是反馈清零法：计数到0111（也就是十进制7）时，用逻辑门检测到这个状态，给74LS161的异步清零端MR一个低电平，让输出立刻回到0000。

它的优点很明确：只用检测一个状态，电路简单。但它有一个先天短板——清零是异步的，输出不等待时钟，直接被打回0000。这个短板在做"从0100开始"的计数器时直接成了硬伤：清零端只能把计数器复位到0000，你想让它回到0100，MR这个引脚根本做不到。

有人会想，那我把0000到0111数完清零，再想办法从0000跳0100，行不行？可以，但那样实际计数序列是0100到0111只有4个状态，再加一个0000状态，不伦不类，而且需要额外的置数配合，复杂度和直接做模8置数差不多，完全没必要。另外，异步清零还有一个众所周知的毛病：0111这个状态在清零信号生效前只维持极短时间，各触发器复位延迟不一致，输出端容易出现毛刺，这在后面的章节会细说。

所以，当题目明确要求"初值0100"时，反馈置数法就是唯一的合理选择。74LS161带有一个同步置数端LD（也叫PE），低电平有效，它不像MR那样直接清零，而是等到下一个时钟上升沿到来时，把D3D2D1D0四个数据输入端的电平"装"进计数器。这个特性决定了它能实现"从任意指定状态继续跑"。

1.3 状态转移表：一个时钟周期对应一个输出

设计任何计数器，第一步都是把状态转移表列出来。这个设计的序列是：

一共8个不同状态，所以它确实是模8。和标准0000→0111的八进制计数器相比，这里的4位输出全都要参与反馈，而且最大值不是0111而是1011。1011就是整个循环里“要触发置数”的那个状态：当计数器走到1011时，下一个时钟上升沿不是变成1100，而是被强制置成0100。这是整个设计的核心逻辑。

2. 74LS161关键引脚行为：置数LD才是本设计的真正主角

2.1 异步清零和同步置数：一字之差，波形天差地别

做这个设计之前，必须把74LS161两个最重要的控制端搞清楚：MR（1脚）和LD（9脚）。很多教材把MR叫作"异步清零"，把LD叫作"同步置数"，这两个词平时念起来顺口，真正用在电路里区别非常大。

异步清零的意思是：只要MR引脚的电平变为低电平，不管时钟处于什么状态，输出立刻变成0000。它是电平触发、立即生效的，不需要等待时钟边沿。同步置数则是：LD引脚为低电平后，计数器不会立刻改变输出，要等到下一个时钟上升沿到来，D0到D3的数据输入才会被装入输出端。

这么说可能还不好理解，举个粗浅的例子。MR像教室里的下课铃，一按，所有人立刻站起来往外走，不需要等什么节拍器；LD像一套"排队指令"，你喊了"按这个顺序排队"之后，大家不会马上动，非得等体育老师吹一声哨子，才按新顺序站好。这个"吹哨子"就是时钟上升沿。

这个区别带来一个非常实际的好处：使用LD置数时，输出跳变是受时钟控制的，不会在反馈电路产生信号的瞬间就乱跳，天然规避了异步清零产生的毛刺问题。这也是为什么初值0100的设计必须用同步置数而不是清零的深层原因。

2.2 D0-D3的接法和初值0100的来源

74LS161的数据输入引脚是D3（6脚）、D2（5脚）、D1（4脚）、D0（3脚），高位在前。题目要求初值为0100，从高位到低位那就是：

• D3 = 0，3脚？注意：D0在3脚，D1在4脚，D2在5脚，D3在6脚。

接法如下：

也就是说在整个电路里，只有D2这一个引脚接高电平，其他三个都接地。很多人栽在这里：把0100当成低位在前的顺序，接到D3D2D1D0上变成0010（十进制2），结果计数的起点完全错乱。接线之前先在芯片手册上确认引脚顺序，然后按高位到低位从左往右写0100，再一一对应到引脚。

还要注意，这些数据输入引脚的电平是持续有效的，只要LD出现低电平，下一个时钟沿就会把D3D2D1D0=0100装进去。不需要额外锁存，也不需要单片机配合，纯硬件就能完成。

2.3 EP/ET、CP、CO的正确处理方式

74LS161除了清零和置数，还有两个计数使能端：EP（7脚）和ET（10脚）。只有当EP=1且ET=1时，计数器才允许在时钟上升沿加1；任何一个为0，时钟来了也不计数。在这个设计里，我们要求它一直处于计数状态，所以EP和ET直接接VCC。

进位输出CO（15脚）在这个设计里不参与反馈。74LS161的进位输出逻辑是CO = Q3·Q2·Q1·Q0·ET，也就是只有计数到1111（十进制15）时CO才输出高电平。我们的状态序列最大只到1011，整个循环里Q2始终是0（0100到1011中只有1011，Q2=0），所以CO永远不会为1。

这一点特别容易搞混，因为很多标准八进制计数器教程会教你"把CO接到LD实现自动置数"，那是 模16计数到1111时置数 的特殊用法。我们这里是模8，最大状态1011，没有到1111，CO用不上。**如果照着那个思路把CO接到LD端，计数器会一直数到1111（共12个状态）才跳回0100，那就变成模12了，完全跑偏。**初学的时候最容易在这个地方翻车。

至于时钟CP（2脚），接信号发生器、555定时器输出或者手动单脉冲按钮都行。需要注意CP是上升沿触发，也就是说时钟信号从低电平跳变到高电平的那一瞬间，计数器动作。

3. 反馈路径推导：检测1011、置入0100，一个与非门就够了

3.1 判别1011：Q2为什么可以不用管

现在到了整个设计最核心、也最需要动脑子的部分：怎么让计数器在状态1011的下一个时钟沿跳回0100。

接上一节，LD端低电平激活。我们希望在1011状态下LD=0，在其他7个状态下LD=1。所以需要设计一个组合逻辑电路，输入是计数器的输出Q3Q2Q1Q0，输出是LD端的电平。

先直观地想：1011这个状态，Q3=1、Q2=0、Q1=1、Q0=1。最严谨的判别电路是检测"Q3=1且Q2=0且Q1=1且Q0=1"，即四输入逻辑 F = Q3·(非Q2)·Q1·Q0。这个可以用74LS20四输入与非门配合反相器实现，也可以把非Q2的信号和Q3、Q1、Q0一起送进与非门。

但在实际设计时，很少有人这么干。仔细看整个循环序列：0100、0101、0110、0111、1000、1001、1010、1011。在这8个状态里，Q2只在1011这一个状态中为1吗？不是，0100到0111这几个状态Q2都是1？等等，这里要重新看清楚。

0100 = Q3=0, Q2=1, Q1=0, Q0=0 0101 = Q3=0, Q2=1, Q1=0, Q0=1 0110 = Q3=0, Q2=1, Q1=1, Q0=0 0111 = Q3=0, Q2=1, Q1=1, Q0=1 1000 = Q3=1, Q2=0, Q1=0, Q0=0 1001 = Q3=1, Q2=0, Q1=0, Q0=1 1010 = Q3=1, Q2=0, Q1=1, Q0=0 1011 = Q3=1, Q2=0, Q1=1, Q0=1

我上面自己列状态的时候，逻辑有点糊了。好好核对：0100代表二进制，从高位到低位 Q3 Q2 Q1 Q0 = 0 1 0 0，哦那Q2=1啊。这说明我用的高位顺序是对的：0100=4，确实Q3=0、Q2=1、Q1=0、Q0=0。之前我说Q2=0是错的。但1011=十进制11？Q3=1、Q2=0、Q1=1、Q0=1，确实是11。那在序列0100-1011中，Q2的值有1有0。所以检测1011时，Q2=0这个条件不能随便忽略？让我重新推一下。

我们的检测目标是1011，条件是 Q3=1, Q2=0, Q1=1, Q0=1。

现在如果只用Q3、Q1、Q0三输入与：F = Q3·Q1·Q0。检查这个条件在哪些状态满足：

• 0111：Q3=0 → 不满足

• 1011：满足

• 1101：Q3=1, Q2=1, Q1=0, Q0=1 → Q1=0 → 不满足

• 1111：满足？Q3=1,Q1=1,Q0=1 → 满足 但序列里没有1101和1111。所以如果在我们的8状态循环中，1111和1101永远不会出现，就可以忽略Q2？但要注意0100到1011循环中，1101永远不会到，1111也永远不会到。所以安全。

  等等，还有一个问题：1011状态之前是1010，然后时钟沿变为1011，此时反馈输出LD=0，但直到下一个时钟沿到来之前，状态一直是1011。下一个时钟沿，因为LD=0，置数0100。OK。在状态1011期间，Q3Q1Q0=111，LD=0。正确。其他状态比如1001？Q3=1,Q1=0,Q0=1 → 不满足。1100？不在序列中。所以只用Q3·Q1·Q0判断是够的，Q2确实可以忽略，因为我们整个循环里1111和1101这些潜在误判状态都不会出现。

  但这里要小心，刚才验证序列时发现0100状态下Q2=1，这没问题，因为Q3=0所以F=0。三输入与非只关心Q3、Q1、Q0。在标准序列中能实现"1011时输出低电平、其余7个状态时输出高电平"即可。为严谨，我可以说明：如果担心噪声或上电异常，可以加Q2的反相信号做四输入检测，保险；但正常循环下三输入与非足够。

所以反馈逻辑化简为：LD' = NOT(Q3·Q1·Q0)。当Q3=Q1=Q0=1时，LD'=0，触发置数。

等一下，我再确认状态1011里Q1和Q0：1011从高位到低位 = Q3=1,Q2=0,Q1=1,Q0=1，没错。Q1=1,Q0=1。那Q1和Q0都为1的状态还有0111：Q3=0。所以三输入条件下0111不误判。正确。

我是很详细地推出来：在0100~1011的8个状态循环中，Q3Q1Q0同时为1的组合只出现在1011。这就是为什么可以在反馈逻辑里省掉Q2的原因。但去掉Q2是有前提的，前提就是计数器只能在这8个状态里循环，如果因为外部干扰或者上电随机状态进入1100以后的状态，那三输入与非门可能会在1101?不对，1101不满足Q1=1。1100? 不满足。1110? 不满足Q1=1、Q0=1? 1110中Q1=1,Q0=0 → 不满足。只有1111满足，但1111不在正常循环里。所以风险很低。严谨版则把Q2非信号加进去，只有1011这一个状态满足。

3.2 门电路选型：74LS10三输入与非门 vs 两级与非门

逻辑表达式出来了：LD' = NOT(Q3·Q1·Q0)，这是一个三输入与非运算。实现它最直接的办法是用一片74LS10三输入与非门。74LS10内部有3个三输入与非门，选其中一个用就行。接线方式：

• 74LS10的1脚（A输入）→ 74LS161的Q3（11脚）
• 74LS10的2脚（B输入）→ 74LS161的Q1（13脚）
• 74LS10的3脚（C输入）→ 74LS161的Q0（14脚）
• 74LS10的12脚（Y输出）→ 74LS161的LD端（9脚）

为了便于面包板接线，实际引脚号以具体芯片手册为准，原理上就是把Q3、Q1、Q0送进与非门，输出接LD。

可能有人会说，手上没有三输入与非门，能不能用两输入与非门凑？可以，但要注意直接用两级与非门不能简单实现"三输入与非"的逻辑。如果第一个与非门做NOT(Q3·Q1)，第二个与非门再和Q0做与非，最后得到的是 (Q3·Q1)+NOT(Q0)，不是 NOT(Q3·Q1·Q0)。所以要么加一级反相器调整，要么用一片74LS08与门加一片74LS04反相器，要么老老实实用74LS10。我推荐直接用三输入与非门，一个芯片搞定，调试最简单。

3.3 同步置数没有毛刺的波形机理

为什么反复强调"同步置数没有毛刺"？这要从异步清零的毛刺机理说起。

反馈清零法检测0111时，输出从0111向0000跳变是MR端电平一拉低就立即发生的，这个跳变不等待时钟。而74LS161内部4个触发器的清零路径延迟并不完全一致，有的触发器先复位、有的后复位，Q0到Q3不是在同一瞬间变化。结果就是，示波器上你会看到在0111附近出现一个极短的高频振荡尖峰，严重时后面再接的级联电路会把这几个尖峰当成有效脉冲，导致计数错乱。

同步置数则不同：当检测到1011时，LD=0确实出现了，但输出并不会立刻从1011跳走，它就像一个信号在门口等着，直到下一个时钟上升沿来临时才把0100"领进门"。在这个时钟沿上，所有触发器同时动作，输出从1011直接变成0100，中间没有亚稳态竞争，也没有毛刺。这一点在实物上用示波器观察会非常明显——置数法波形干净利落。

不过要从严格意义上说，同步置数要求LD端的低电平信号在时钟上升沿之前就稳定就绪，也就是满足触发器的建立时间要求。74LS161的建立时间典型值是20纳秒量级，而我们用普通与非门搭的组合逻辑延迟也只有几十纳秒，在实验用的低频时钟（几百赫兹到几兆赫兹）下完全没问题。这也是为什么这个反馈电路简单到"一个与非门就能搞定"却依然可靠。

4. 从原理图到仿真：Multisim/Proteus验证完整循环

4.1 完整接线总表

把前面所有内容汇总成一张接线总表，照着这个在仿真软件或者面包板上连线即可。

注意，数据输入端的接法：为了让置数值为0100，D2接高、D0/D1/D3接地。这句话再强调一遍，因为实际接反的人太多了。D0、D1、D3统统接GND，D2接VCC，就这么简单。

74LS10的电源同样接5V和GND，别漏了给一片芯片供电。所有芯片的VCC和GND之间就近放一个0.1uF瓷片电容，这是TTL电路最基本也最容易被忽略的稳定性措施。

4.2 仿真里怎么让初值从0100开始

在Multisim或Proteus里放好芯片、连好线之后，直接点运行，大概率发现计数器不是从0100开始的。因为仿真器给芯片上电时状态是随机的，可能是0000、0110乃至1111，并不会自动停在0100等第一个脉冲。

要让仿真从0100开始，可以用一个手动的"初始化"操作。最简单的方式：把74LS161的LD端（9脚）通过一个按钮开关临时拉到低电平，同时确保D2=5V、D0=D1=D3=GND，按一下按钮，再松开，此时LD恢复高电平。然后给CP送一个上升沿，计数器就会把D端的数据0100装进去，注意操作次序：先让LD为低，再给CP上升沿，才能完成一次置数。如果只拉低LD不送时钟，数据并不会进去。

在仿真软件里，可以用一个单刀双掷开关模拟这个过程。实测中很多人在这里卡住，因为给LD低电平之后没给时钟，计数器纹丝不动，于是怀疑接线错了。不是，是同步置数必须等时钟沿。

如果你希望一上电就自动从0100开始，可以做一个上电自动置位电路：用一个4.7uF电解电容和10kΩ电阻组成RC微分电路，接在LD端，上电瞬间产生一个几十毫秒的低电平脉冲，正好覆盖第一个时钟上升沿。不过这个属于锦上添花，做课程设计的话手动置位一次就够了。

4.3 实测波形解读：0100→0101→……→1011→0100

仿真跑起来之后，在示波器上看Q3、Q2、Q1、Q0四路波形。最容易验证的方法是把四个输出按顺序接到逻辑分析仪，或者用示波器四通道观察。

从波形上看，Q0是频率最高的信号，每个时钟沿翻转一次（在本状态序列中不完全规律，但整体周期是8个时钟）；Q1每两个状态翻转一次；Q2在0100到0111期间为高，到1000变低，持续4个状态后又变高；Q3则从1000状态开始拉高，一直保持到1011，然后在置数回0100时拉低。

最关键的验证点是：计数器到达1011之后，必须跳过1100、1101、1110、1111这4个状态，直接回到0100。在仿真波形里，Q3、Q1、Q0三个输出同时为高的那一拍，就是LD触发的时刻，下一拍三个高电平同时消失，Q2从低变高，整体输出变成0100。整个循环周期正好是8个时钟周期，不多不少。

5. 实物搭建避坑清单：时钟抖动、电平兼容和上电初值

5.1 按键给时钟：不加消抖会一次跳好几个数

仿真跑通了，上实物的时候第一个大坑往往出在时钟上。很多初学者直接拿一个按键接在CP端，按一下想让计数器走一个数，结果发现计数器像发疯了一样一口气跑了五六个状态。

这是因为机械按键按下和松开的瞬间，金属触点会发生多次弹跳，持续时间几毫秒到十几毫秒，每一次弹跳都形成一个上升沿，74LS161就会把这些跳变全部当成有效时钟。解决方法是加消抖电路，常见的有两种：

• 用RC积分电路消抖：按键一端接5V，另一端通过一个10kΩ电阻接地，同时在按键输出端和地之间接一个10uF电容。利用电容的充放电把毛刺"抹平"，得到干净的单脉冲。
• 用施密特触发反相器消抖：比如74LS14，按键信号经过施密特整形之后再送给CP，波形非常干净。

如果你用的是信号发生器或者单片机输出的方波时钟，那基本不用考虑消抖问题，本身上升沿就很标准。

5.2 TTL的74LS161和HC系列更换时的电平问题

74LS161是TTL工艺，工作电压5V。如果在某宝上买到的是74HC161或74HCT161，要注意它们不是完全一样的器件。74HC161是CMOS工艺，虽然引脚兼容、功能相同，但输入高电平要求和输出驱动能力不一样。

TTL电路的高电平阈值大约是2.0V，CMOS的高电平阈值大约是3.5V（VCC=5V时）。如果你前面的时钟信号来自TTL门电路，输出的高电平在2.4V到2.7V之间，驱动74HC161可能根本触发不了计数。反过来，74HC161的CMOS输出驱动LED倒是比TTL强一些。实际项目里最好统一用同一种工艺的芯片，别TTL、CMOS混着用。如果实在要混，查一下数据手册的电平参数，确认驱动能力足够。

5.3 LED指示、示波器探头的负载效应

在面包板上验证，最常见的输出观测方法是接LED。每个输出端串一个330Ω到1kΩ的限流电阻。注意LED接法有两种：一种是把LED阳极接VCC、阴极接芯片输出端，输出低电平时LED点亮；另一种是LED阳极接输出端、阴极经过电阻接地，输出高电平时点亮。推荐用第一种低电平点亮的方式，因为74LS161的灌电流能力（典型8mA）比拉电流能力（0.4mA左右）强得多，低电平点亮更亮也更稳。

如果你用示波器探头直接戳输出端，会发现波形边缘变慢或者幅度轻微下降，这是因为示波器探头本身有输入电容（通常在15pF左右），高频时会对信号形成负载。在实验用的几百赫兹到几兆赫兹时钟下影响不大，但如果后面要把这个计数器接到其他高速电路上，就要考虑缓冲级隔离。我一般会在Q端到下一级之间加一个74LS244或者74HC245做缓冲，避免负载过重把计数波形搞坏。

还有一个容易忽视的坑：测量多个输出信号时，要确保所有通道的探头地线夹都在同一个GND点。如果地线夹夹在不同的"地"，会因为地环路引入噪声，干扰观测结果。

上电初值的问题在实物上也要重视。74LS161上电后的初始状态是随机的，所以每次通电之后，计数器可能从任意状态开始跑，哪怕反馈逻辑正确，也会出现第一圈状态不完整的情况。我的做法是在LD端并联一个按钮开关，上电后先手动按一下，把计数器置到0100，再开始正常计数。如果是长时间自动运行的设备，就用前面提到的RC自动置位电路，保证上电瞬间自动完成初始化。

做这个项目踩了一圈坑之后，我的体会是：74LS161这种经典中规模计数器，其实并不难，难的是把"清零"和"置数"这两种反馈策略的应用场景分清楚。常规八进制计数器用清零法顺手，但一旦题目变了初值，就必须切换到置数法思路，而且置数法本身更干净、更可靠，没有毛刺问题，反而是一种更高级的做法。如果以后自己做分频器、流水灯或者状态机，碰到"不从0开始数"的需求，这个"检测最大状态→同步置入初值"的套路可以直接复用，连参数都不用怎么改，唯一要变的只是检测哪个状态、D端接什么数据罢了。