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很多人在第一块驱动板上看到“图腾柱”这个词，都以为它和功率因数校正里的图腾柱PFC是一回事。其实不是，至少在PWM驱动芯片这个语境里，图腾柱指的是输出级一种非常经典的晶体管结构：上面一个管子负责“推”，下面一个管子负责“挽”，配合起来把PWM信号变成能驱动功率级的大电流、快边沿信号。

这些年我调试过风扇调速、LED闪烁驱动、MOS管驱动、电机半桥，几乎每一个和PWM强相关的电路里都能看到图腾柱的影子。很多新手喜欢用单个NPN三极管去驱动MOS管栅极，然后把PWM频率一提高，管子就发热得不敢摸。换了图腾柱之后，同样的频率、同样的负载，温度立刻正常。这篇文章就把这件事彻底讲明白，重点拆开两个方向：NPN+NPN同型图腾柱和NPN+PNP互补图腾柱，说说它们各自的脾气、适用场景，以及你在抄电路图时必须注意的那些坑。

1. 先搞懂图腾柱到底在“柱”什么：一个推、一个挽

1.1 结构骨架：两只管子串在电源和地之间

图腾柱输出级的名字很形象，两个晶体管上下堆叠，中间引出输出节点，看起来就像一根柱子。最常见的形式是这样的：上面一只管子接VCC，下面一只管子接GND，两只管子的连接点是输出端。输出端再接负载，比如MOS管的栅极、风扇电机、LED灯串。

上下两只管子分工明确：

• 上管导通时，把输出节点往VCC方向拉，输出高电平，这个过程叫“推”。
• 下管导通时，把输出节点往GND方向拉，输出低电平，这个过程叫“挽”。

两个管子交替工作，输出端就能在高低电平之间快速切换。这和单个三极管加一个集电极电阻的开路输出方案完全不同，图腾柱在高电平时不是靠电阻慢慢“拉”上去的，而是直接由管子“推”上去，所以它的输出阻抗可以做得很低。

1.2 PWM信号为什么离不开低阻输出

PWM的本质是固定频率、可变占空比的方波。方波要足够“方”，上升沿和下降沿都要陡，否则问题就来了。拿最常见的MOS管栅极驱动来说，MOS管的栅极相当于一个电容，栅源之间的等效电容Ciss从几百皮法到几十纳法不等。要给这条电容快速充放电，驱动源就需要能够在极短时间内提供较大的瞬态电流。

单个GPIO引脚或单个三极管的驱动能力是有限的。假设栅极电容是1nF，PWM电压是12V，如果希望在100ns内完成充放电，需要的平均电流大致是： $$ I = C \times \frac{\Delta V}{\Delta t} = 1nF \times \frac{12V}{100ns} = 120mA $$

这是一个不小的瞬时电流，普通单片机的GPIO根本给不出来。而图腾柱输出的上管和下管，在导通过程中相当于把电源和地之间的低电阻直接接到输出端，可以在几十纳秒内灌入或抽走几百毫安甚至几安培的电流。

这也是为什么把PWM直接接到MOS管栅极时容易发热的根本原因。GPIO驱动能力不足，栅极电压上升缓慢，MOS管会在线性区停留较长时间，管子上压降和电流同时存在，损耗自然大。用了图腾柱驱动之后，边沿变陡了，MOS管快速穿越线性区，开关损耗直线下降。

1.3 两种图腾柱的流派划分

按照管子的极性和驱动方式，图腾柱主要分成两派：

• NPN+NPN同型图腾柱：上下两只管子都是NPN型，型号可以完全一样。这种结构在TTL逻辑芯片里非常常见，也是很多半桥驱动芯片输出级的“祖先”。
• NPN+PNP互补图腾柱：上面一只管子是NPN还是PNP，具体怎么摆，业界常说的“互补”一般指上管PNP、下管NPN，或者上管NPN、下管PNP两种变体。最流行的是上管PNP、下管NPN的组合，因为它直接用一根PWM信号线就能驱动，不用额外反相。

这两种结构看起来都是上下叠放、中间输出，但驱动逻辑、开关速度、电路复杂度差得非常多。下面分开细拆。

2. NPN+NPN同型图腾柱：高频利器，但驱动它需要额外手段

2.1 基础电路与驱动逻辑

NPN+NPN图腾柱的基本连接方式如下：

• Q1（上管）：NPN，集电极接VCC，发射极接输出OUT。
• Q2（下管）：NPN，集电极接OUT，发射极接GND。

要让Q1导通，必须在它的基极和发射极之间加上大于0.7V的电压。可是Q1的发射极不是固定地，而是输出端OUT。当OUT被Q2拉低时，Q1的基极只要比地高0.7V就能导通；但当OUT已经上升到接近VCC时，想让Q1继续保持导通，Q1的基极电压就得比VCC更高。

这就是同型图腾柱核心的难点：上管NPN需要“高于电源”的驱动电平。

在TTL芯片内部，这个问题是通过“有源上拉”解决的，但芯片外面有很多偏置电路帮忙，比如上拉到VCC、发射极输出等。TTL的高电平输出通常不是满摆幅，例如5V供电的74LS系列输出高电平大概只有3.4V左右，就是这个原因。

2.2 用自举电容解决高边驱动：实操电路

如果你自己搭两个NPN做图腾柱，想让上管输出接近VCC的满幅高电平，最常见的方法是加一个自举电路，结构大概是：

• Q1基极通过一个限流电阻接到自举电容的一端。
• 自举电容的另一端接OUT。
• 自举电容通过一个快恢复二极管接到VCC。
• 同时PWM信号通过一个二极管或射极跟随器，控制Q1的基极电流。

工作过程是这样的：当PWM输出低电平，Q2导通，OUT被拉到接近地。此时VCC通过自举二极管给自举电容充电，电容电压被充到约VCC减去二极管压降。随后PWM转为高电平，Q2截止，自举电容下端被接在OUT上。由于之前电容已经充到接近VCC，此刻电容上端相对地的电压就约等于VCC加上OUT的电压，叠加起来高出VCC，Q1基极电位被“抬”上去，于是Q1可以深度导通，输出被推高到接近VCC。

自举方案有几个硬限制：

• 占空比不能长期接近0%或100%。如果占空比接近100%，自举电容长时间得不到充电机会，电压会慢慢掉，Q1就会退出饱和。
• PWM频率不能太低。频率太低，自举电容在关断期间可能通过基极回路漏电，维持不住电压。
• 自举二极管要选快恢复型，普通整流二极管反向恢复时间太长，高频下会发热。

这就是为什么很多做分立电路的工程师一看到两个NPN的图腾柱就头疼。它不是说不能用，而是外部辅助电路比想象中多。

2.3 同型结构的独特优势：两管对称性极好

尽管驱动麻烦，NPN+NPN在同频率、同功率下有两个很突出的优点：

第一，NPN管和NPN管的工艺特性一致。电荷存储效应、饱和压降、开关时间都接近，不容易出现一快一慢的不对称问题。这对高频PWM至关重要，因为上下管的开关时间如果差太多，就可能出现同时导通的瞬间，形成电源到地的直通短路，严重时直接炸管。

第二，NPN管通常是性价比最高的选择。NPN的高频大电流型号远比PNP丰富，同等封装下NPN的饱和压降更低、特征频率更高。在几百kHz甚至MHz级别的PWM驱动中，同型图腾柱更占优势。

所以你会发现，很多高速MOSFET驱动芯片或者开关电源控制芯片的内核，本质上都带有两个NPN图腾柱的影子，只是内部把自举电路也一起做进去了，用户不需要操心。

3. NPN+PNP互补图腾柱：电路简单，但PNP的“慢”是硬伤

3.1 性价比最高的分立驱动拓扑

NPN+PNP互补图腾柱的分立电路，是我在项目里用得最多的方案，因为它真的简单。以下是最经典的一种接法：

• Q1：PNP管，发射极接VCC，集电极接OUT，基极通过电阻接PWM输入。
• Q2：NPN管，发射极接GND，集电极接OUT，基极通过电阻接PWM输入。

当PWM信号为低电平时，Q1的基极相对发射极是负压，Q1导通，OUT被拉向VCC；Q2的基极相对发射极低于0.7V，Q2截止。当PWM信号为高电平时，Q2导通，Q1截止，OUT被拉到GND。整个逻辑就是：同一根PWM信号，高电平控制NPN导通，低电平控制PNP导通。

我见过很多新手第一次看到这个电路，都会惊讶：为什么要用一只PNP做上管？答案是这样做可以绕开NPN高边驱动的自举难题。PNP的发射极直接接VCC，基极只要比VCC低0.7V就能导通，也就是说，用一个低电平就能把高边管打开。这在单电源、低压系统里极其方便。

3.2 寄生参数才是真正的重点

互补图腾柱虽然驱动简单，但在高频PWM里有一项绕不过去的物理短板：PNP管的开关速度通常比NPN管慢。

双极型晶体管的电流由两种载流子承载：NPN主要靠电子，PNP主要靠空穴。空穴的迁移率大约只有电子的三分之一，这意味着同样的结构、同样的掺杂浓度下，PNP管在关断时储存电荷的清除速度更慢，特征频率fT也更低。实际表现就是下管NPN已经关断，上管PNP还没完全反应过来；或者上管PNP关断慢，下管NPN已经导通了。

这两个管子一拖沓，就容易在切换瞬间形成直通电流，也就是“shoot-through”。直通电流会导致电源电压瞬间被短路，轻则芯片发热、效率下降，重则直接烧管。

解决的办法有几种：

• 在基极回路串联不同阻值的电阻，让NPN和PNP的导通、关断时间错开。
• 增加RC延时，故意让下管晚一点导通。
• 选择开关速度更快的PNP型号，比如2N3906、SS8550这类小信号高频管。

这些方法本质上都是在制造“死区”，避免两只管子在同一时刻同时导通。

3.3 饱和压降和配对问题

另一个容易被忽略的点是PNP管的饱和压降通常比NPN管高。这里说的饱和压降是集电极和发射极之间的VCE(sat)。在相同封装和相同额定电流下，PNP管往往需要更大的基极电流才能进入同样深度的饱和。

这意味着互补图腾柱输出的高电平和低电平并不完全对称。输出低电平时可能只有0.1V到0.2V，而输出高电平时可能比VCC低0.3V甚至更多。这个差异在给MOS管栅极驱动时问题不大，但如果用来给精密模拟电路供电或者做电压基准，千万要留意。

还有配对的问题。NPN和PNP是两种完全不同的器件结构，它们的Vbe和电流增益β天然就不匹配。想找到一组“门当户对”的互补对管，需要看厂家手册里专门标注的complementary配对型号。如果你随手拿一颗S8050和一颗S8550凑成一对，虽然封装和电气参数看起来差不多，但实际幅度关系和延时响应会有细微差别，批量生产时一致性也难控制。

4. 实战对比：同型与互补到底差在哪几个硬指标

4.1 波形实测：上升沿和下降沿明显不一样

我搭建过两组实际电路做对比，电源电压12V，上下管都用贴片小信号管，输出端接一个10nF电容模拟MOS管栅极负载。PWM频率设为50kHz，输入信号是3.3V方波。

NPN+PNP互补图腾柱的输出波形显示，下降沿很漂亮，大约几十纳秒就能把输出拉到底；但上升沿比下降沿慢了不少，肉眼可见地“拖”了一下。这就是PNP上管在关断和导通时天生比NPN慢造成的。

NPN+NPN同型图腾柱搭配自举驱动，波形对称性明显更好。两个管子的开关延时接近，上升沿和下降沿的差异很小。这在高频PWM下尤其重要，因为上下管开关速度不对称，最终会反映到PWM占空比精度上。

4.2 输出摆幅：不一定都是满幅

很多人以为图腾柱一定输出满摆幅，实际上不一定。NPN+NPN在没有自举的情况下，高电平最多到VCC减去一个Vbe，也就是4.3V（5V供电时）。如果你直接把这个信号送给阈值电压较高的MOS管，可能会有导通不完全的风险。

NPN+PNP互补结构如果选型合理、基极驱动电流足够，输出摆动可以非常接近VCC和GND。但要记住，PNP的饱和压降会“偷走”一点高电平幅度。

来看整理好的对比表：

4.3 功耗差异也要计算

图腾柱的损耗不只来自饱和压降，还包括开关损耗。以12V供电、输出端等效负载电容10nF、PWM频率100kHz为例：

• 每次开关过程消耗的能量大约是0.5×C×V²，即0.5×10nF×144V²=0.72μJ。
• 100kHz下每秒开关次数按20万次算，单是电容充放电损耗就是0.144W。

如果你用的是PNP+NPN互补结构，PNP关断慢，高边管在切换过程中有更长时间处于线性区，实际损耗会比理论值高不少。因此在大功率MOS管栅极驱动、高频率PWM调速的场景下，我更倾向选择同型NPN图腾柱或增加专门加速关断的电路，而不是单纯堆互补对管。

5. PNP的“拖尾”问题究竟怎么治：实用提速方案

5.1 一个回路拆成两个回路

如果你还是想用NPN+PNP互补结构来降低电路复杂度，那就要接受PNP慢的现实，并想办法“治”它。第一个实用的办法是把两个基极回路拆开，不要用同一个基极电阻同时驱动两个管子。

给PNP上管一个较小的关断加速回路，比如在基极并联一个电容，或者用“基极-发射极电阻”给关断时的存储电荷提供一条快速泄放通