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搞过开关电源的朋友，应该都体会过那种憋屈：功能调试一切正常，效率纹波都达标，结果把样机往接收机上一放，传导或者辐射某一个频点直接顶破限值线，整改几天毫无头绪。这时候，老工程师往往会问一句：“变压器是怎么绕的？”一句话点醒梦中人。没错，开关电源EMI的根源和优化手段，很多时候都集中在那个不起眼的高频变压器上，而“三明治绕法”就是其中流传最广、效果最立竿见影的一招。

这篇内容就是围绕“三明治绕法”展开的实战总结。我会把为什么它有用、什么时候用、具体怎么绕、绕完需要注意什么坑，以及我用它通过认证测试的真实过程写清楚。适合正在做反激电源、适配器、充电器设计，或者已经被EMI整改折磨得焦头烂额的电源工程师、硬件工程师参考。

1. 三明治绕法为什么能降EMI：干扰路径的底层逻辑

1.1 先搞清楚EMI噪声是怎么从变压器跑出去的

很多工程师一上来就学三明治绕法的操作，但没搞懂原理，结果换个项目、换个功率段就不会用了。这里我先把底层逻辑掰开揉碎讲清楚。

反激式开关电源中，MOSFET以几十到上百kHz的频率开关，变压器初级绕组上就会有高压方波（比如宽电压输入的反射电压加漏感尖峰，常常达到600V以上）。这个跳变电压会对次级绕组、磁芯、以及外部散热器形成强烈的电场耦合，也就是分布电容耦合。高频干扰电流通过这些分布电容形成回路，一部分在机内内部循环，另一部分就会流到输入线缆上，最终被LISN（线性阻抗稳定网络）测量出来，这就是传导EMI的来源之一。

这里有个关键概念，很多教科书不会强调：变压器初、次级之间的寄生电容 Cp，才是共模干扰传导到输出线和输入线的核心通道。初级跳变电压通过Cp把干扰电流耦合到次级，次级再通过与大地之间的杂散电容闭合回路，形成共模电流。干扰电流大小约等于 Cp × (dv/dt)，所以降EMI无外乎就两条路：一是降低dv/dt，也就是放慢MOSFET开关速度；二是降低Cp，也就是减少初、次级间的耦合面积。

三明治绕法，本质就是围绕第二条路径做文章。但这里有个反直觉的地方：三明治绕法其实增加了初、次级间总的耦合面积，理论上的Cp反而变大了，那它为什么还能改善EMI呢？关键在于，它改变了耦合电压的分布。

1.2 普通顺序绕法的问题：高压绕组直接对次级的强耦合

普通反激变压器通常的做法是：先绕初级整个线包（比如40圈），再绕次级（比如9圈），最后绕辅助供电绕组。这种“初级在内、次级在外”的结构，次级完全包裹在初级外围，次级所有线圈都暴露在初级高压绕组的强电场中。

更要命的是，初级绕组的电位分布并不均匀。靠近MOSFET漏极的那一端，电压是高压方波，幅度极高；而靠近母线正极那一端，电压相对平稳。如果次级刚好和初级高压端重叠，那么Cp上承受的差模电压接近满幅方波，注入次级的共模噪声就非常大。

实践中用示波器探头勾次级输出对地的噪声电压，普通绕法的机器往往一上电就能看到几百毫伏甚至伏级的共模毛刺，这个毛刺经过后续Y电容、共模电感处理后依然可能余量不足。

1.3 三明治绕法的本质：串联分压降低有效耦合电压，抵消电容面积增大的副作用

那三明治绕法是怎么解决的呢？它把初级绕组拆成两段，比如总圈数40圈，先绕左半段16圈，然后绕次级9圈，再绕初级右半段24圈，最后绕反馈绕组。合上磁芯后，初级两段在磁路上串联，电位却分布在两个不同的物理位置。

因为次级被夹在两段初级中间，次级所面对的每一个位置，几乎都有两段初级在同时施加电场。关键在于，两段初级上的瞬时电位变化方向不同、幅度也不同，它们在次级上耦合出的噪声电流方向相反，会互相抵消一部分。这就是三明治绕法的核心价值：利用“电场分压”原理，在局部减小了初、次级之间的有效充放电电位差。

说白了，普通绕法相当于一个高压源直接对次级放电；三明治绕法相当于高压源被两个串联电容分压，中间抽头位置接次级，次级感受到的电位变化幅度大幅下降。所以，虽然总的耦合面积增大了，但有效工作电压降得更明显，最终注入的噪声电流反而更小。

1.4 漏感代价：为什么不能过度追求“更多层”

听到这里，肯定有人会问：“既然这么好，那我是不是可以绕成五明治、七明治？”

理论上，更多的分段确实能进一步降低次级感应的电位梯度，但代价也非常明确：漏感会增加。因为初级被分成好几段后，磁芯窗口里不同位置的绕组之间磁耦合变弱，磁力线不能完全穿透所有绕组，未耦合的能量就会形成漏感，在关断瞬间产生尖峰电压，既增加MOSFET应力，又会引起振铃，振铃本身就是辐射和传导的高频噪声源。

实践下来，反激电源最常用的是“单层三明治”，也就是把次级完整包在两个初级段之间。这也是本文重点讨论的结构。功率稍大的，可以用“双层三明治”，比如次级先绕一半、初级夹在两层次级之间，但绕制复杂度、绝缘和漏感控制难度会成倍上升，新手不建议一上来就玩这种。

2. 三明治绕法的实操要点：线包结构、绝缘与屏蔽的配合

2.1 单层三明治的标准线包结构

以40W、输出19V/2.1A的反激适配器为例，常见的PQ2620磁芯，初级电感量大约800uH，初级匝数40T，次级匝数9T，辅助绕组7T。三明治绕法的标准顺序为：

1. 初级内层（16T）：先绕初级内侧线包，边缘加挡墙或使用三层绝缘线保证爬电距离；
2. 隔离层：初级与次级之间垫2~3层聚酯薄膜胶带（常用0.025mm厚度）；
3. 次级绕组（9T）：完整绕制，注意出线方向与骨架PIN脚对应；
4. 隔离层：次级与初级外层间同样需要足够绝缘；
5. 初级外层（24T）：绕结束后与初级内层起始脚连接；
6. 辅助绕组（7T）：放在最外层，对EMI影响较小，同时便于调整；
7. 最外层包胶带，磁芯接地或悬空按方案需要处理。

有个细节很容易踩坑：初级内层被包裹在里面，散热条件差，温升测试时内层绕组的温度通常比外层高10~15℃。如果电源工作在满载且环境温度较高（比如户外或密闭壳体），绕组的额定载流密度就必须留更大余量，线径能粗就粗，千万不要按理想散热条件计算线径。

2.2 电位分布设计：把“热端”藏起来

三明治绕法之所以能降噪声，还依赖一个关键操作：初级两段各自的热端（也就是MOSFET漏极端）要朝着远离次级的方向放置，或者用屏蔽手段挡住。

如果初级内层把热端放在面对次级的那一侧，相当于特意把高压噪声源紧贴次级，EMI反而会恶化。正确做法通常有两种：一种是初级内层绕完后，最后一圈（也就是靠近次级那侧）接母线正极或反射电压相对平稳的点；另一种是借助“起始脚位”的排针设计，让MOSFET漏极引线从骨架内侧通道走，被铜箔屏蔽层覆盖，从而屏蔽热端。

在PCB Layout阶段就要规划好骨架PIN脚定义。比如把初级内层的起始脚定义为母线正极，收尾脚定义为MOSFET漏极；外层正好相反，起始脚接近次级或辅助绕组区域，收尾脚接母线正极。这样可以在磁芯窗口内，把高dv/dt节点尽量藏在线包内部或靠近磁芯处，让外层电场相对平稳，叠加到次级上的干扰自然小。

2.3 屏蔽层的使用：什么时候加铜箔，什么时候不加

这是三明治绕法应用中最容易被玄学化的部分。有人习惯在初级和次级之间绕一圈铜箔屏蔽层，接初级地（通常是母线负极或大电解电容地），用来短路初级向次级泄漏的电场。这个思路在反激电源中是有效的，能显著降低共模传导。

但注意，屏蔽层并不是万能的。尤其是在三明治绕法中已经降低了次级感应电位的前提下，屏蔽层如果再处理不好，可能引入新问题：铜箔边缘尖端会在高压下产生局部放电，或者屏蔽层的“悬浮”状态反而成了天线的寄生振子，使得辐射测试的某个频段变差。

我的建议是：

• 60W以下的反激适配器，只要三明治结构绕得好，多数情况下可以不加屏蔽层；加了反而增加绕制复杂度和成本。
• 对EMI裕量要求高、或者多次整改后仍有余量不足的情况，再考虑在初级最外层加一圈铜箔屏蔽并可靠接到初级静点。
• 屏蔽层宽度必须略窄于线包宽度，边缘不得翻边，铜箔端部要倒圆角或打磨，防止尖端放电。
• 屏蔽层的引出线要短而粗，直接焊接在初级地铜箔上，不能指望一段细长的漆包线来“接地”，那样高频阻抗太高，基本没用。

2.4 辅助绕组位置与线圈顺序对噪声的影响

辅助绕组（给控制IC供电的绕组）通常放在最外层，这既方便调节匝数，也有利于它和初级共地，共模噪声路径在控制IC内部会有所抵消。但是如果辅助绕组和初级外层共用一段地线从底部走到顶部，地线上流过的脉冲电流会耦合到辅助绕组，引起VCC电压波动，严重时甚至会导致打嗝或误触发保护。

处理这类问题，关键在骨架PIN脚规划：辅助绕组的同名端和初级外层的同名端最好相邻或对称分布，让两者之间的环路面积尽量小，避免在PCB走线和PIN脚间形成大电流环路。我见过很多工程师绕线包没问题，却因为辅助绕组的地线绕了大半个骨架，VCC纹波高达几百毫伏，还以为是IC的供电设计有缺限，其实是绕组布局出了问题。

3. 实例解析：一款24W反激适配器的EMI调试实录

3.1 电源基本参数与变压器设计

这里用一个实际做过的24W适配器作为实例，输出12V/2A，宽电压输入90~264Vac，控制芯片用的是OB2273（一款常用的内置高压启动的反激控制器），开关频率65kHz。

最初版本变压器没有采用三明治，而是常规顺序绕法，磁芯EE22，初级0.21mm漆包线绕124匝，次级0.4mm三层绝缘线绕14匝，辅助绕组7匝。传导预扫描结果：150kHz~300kHz低频段余量尚可，但3MHz~8MHz频段的中频噪声明显顶线，最高点超出准峰值限值约9dB。这个频段的噪声源，绝大多数来自初、次级分布电容耦合，因为频率再高一点就会进入共模电感的谐振抑制区。

整改方向就是在尽量不打乱常规生产工艺的前提下，用三明治绕法重做变压器。

3.2 三明治绕法的具体计算与绕制步骤

这里给出一个可以直接参考的绕制方案。原初级124匝拆分成内层50匝和外层74匝，次级14匝完整夹在中间，辅助绕组7匝放在最外层。

具体参数如下：

绕制的关键在初级内外层连接点的引出。建议在骨架上选一个中间空PIN作为折返焊盘，内层收尾先焊到这个PIN，外层起始再从这个PIN引出，这样既能保证电气串联，又不至于让两个线头在磁芯窗口中形成大面积悬空环线，悬空环线会在磁场中感应出环流，增加损耗和噪声。

3.3 实测效果对比：传导余量普遍提升5dB以上

把改制后的变压器装入同一套样机，不动PCB任何元件，重新做传导预扫描。结果非常直观：

• 3MHz~8MHz中频段准峰值噪声最高点从原来的约62dBuV降到52dBuV，余量从-9dB变成了+1dB左右；
• 150kHz~500kHz低频段的噪声也略有下降，不过这个频段更多由初级电感电流纹波和Y电容参数决定，改善不如中频段那么明显；
• 10MHz以上的高频段，由于三明治结构缩短了绕组间连线、减小了环路面积，辐射噪声也有所改善，但没有传导改善那么显著。

这里补充一个有趣的观察：换上三明治绕法后，MOSFET漏极尖峰电压比之前高了一点（约高了12V左右）。这正是漏感略微增大的代价。好在24W这个功率档位，MOSFET的耐压余量本来就充足，增加12V尖峰完全不影响可靠性。但这也提醒我们：如果设计时MOSFET耐压余量卡得比较紧，采用三明治绕法的同时就要考虑适当增加吸收电路的钳位能力，或者选用耐压高一档的管子。

3.4 不加Y电容的情况下能否直接过认证？

很多工程师关心的是“三明治绕法到底能不能省掉Y电容”。按照标准IEC 62368-1对应用设备的需求，反激电源的初次级隔离电容基本上回避不了，但Y电容太小会导致共模阻抗过高、噪声泄放路径不足；Y电容太大又会让漏电流超标，对医疗设备或手持设备尤其敏感。

三明治绕法的价值在于，可以减小对Y电容容值的依赖。正常设计时，一颗2.2nF Y电容加上共模电感，配合常规顺序绕法，或许能勉强压线过测试；换上三明治绕法后，同样的2.2nF可能余量很大，这时候可以尝试降到1nF，甚至在某些外壳全塑、无接地要求的适配器中，配合好的变压器，可以做到只用共模电感就能通过CLASS B的传导测试。

但我不建议完全零Y电容设计。除了EMI，Y电容还承担着稳定次级共模电位、抑制输出高频波纹的作用。省掉它可能引发次级IC误动作或共模振荡。我的原则是：先保守地保留一个1nF安全容值，多次验证合格后再酌情优化，绝不为了物料清单好看而拿认证风险赌博。

4. 三明治绕法的常见问题与排查技巧

4.1 现象一：改用三明治绕法后，低频段噪声反而更差了

这不是三明治绕法本身有问题，而是低频段（150kHz~500kHz）的噪声主要来源于初级电流的基波和高次谐波，它们通过输入端的差模路径传播，靠的是X电容和差模电感来抑制。变压器绕法对这部分影响很小。

如果你发现换三明治后低频变差，多半是绕线过程中改变了初级绕组的起始线头位置或PCB走线方向，无意中增大了输入回路的环路面积。排查方法：把初级内层的首尾对调，或者调整初级接地铜箔的路径，让输入大电解电容到MOSFET源极的回路面积尽量小，问题往往就消失了。

4.2 现象二：高频段（30MHz以上）噪声升高

三明治绕法压缩了中频传导噪声，但有时会让高频段辐射变差。原因通常是：多一个绕组分段就会多处一次层间跳线和折返，这些额外的连接线在磁芯窗口周围形成了微型环形天线，高频电流流过时向外辐射。

处理办法：第一，折返线尽量短、尽量紧贴骨架壁，不要悬空；第二，三层绝缘线或漆包线不要剥皮留太长，裸露铜线是最常见的高频辐射源；第三，如果辐射频段集中在特定频点，可以在外层绕组的悬空端串磁珠或并一个小电容到地，消除振荡。

4.3 现象三：绝缘耐压测试不通过

三明治绕法的绝缘结构需要特别严密。因为初级被分成两段，初级与次级之间的绝缘层变成两处（内层对次级、外层对次级），而初、次级之间总共只有上下两层绝缘胶带厚度。如果绝缘带重叠不够，或者绕制时胶带边缘起皱，爬电距离就可能在胶带边缘急剧缩短。

高端电源产品进行3750Vac耐压测试时，这个现象很常见。我的做法是：绝缘层至少用两层0.025mm聚酯膜，且每层宽度比骨架槽宽多出2mm以上，确保边缘能翻过骨架槽壁；次级和初级各层之间再刷一遍绝缘漆；打耐压时，尤其是样机阶段，要同时监测泄漏电流曲线，如果电流在升压过程中出现台阶式上升，就说明绝缘处于临界状态，绝不能放过去。

4.4 现象四：三明治绕法后VCC电压跌落或纹波偏大

这个排查思路我前面提过一部分，多半问题出在辅助绕组的位置和出线。三明治绕法后，磁芯窗口内的磁场分布有变化，辅助绕组的耦合状态也随之改变。如果辅助绕组匝数不变但VCC在满载时偏低，最简单的方法是把它移到次级同一层位置，或者多加一两圈作为补偿。

但要注意，辅助绕组匝数增加会导致轻载时VCC过高，可能触发OVP。所以更稳妥的做法是，在辅助绕组两端并联一只12V~15V的稳压管（或TVS）到地，给出一个泄放通路，避免辅助绕组感应电压过高时损坏IC。

4.5 问题排查速查表

5. 从认证角度反推绕法选择：不同产品该怎么做

5.1 适配器/充电器这类小功率产品

十几瓦到六七十瓦的手机充电器，最大的痛点是体积小、结构紧凑，几乎没有额外空间放滤波器件。这种情况下，三明治绕法几乎是标配。因为次级和初级之间的分布电容得到控制后，共模电感的体积可以缩小一两号，X电容也可以适当减小，对产品的小型化帮助非常明显。

与此配套的经验是，这类产品优先保证初次级间的绝缘厚度和三层绝缘线的选型，不需要额外屏蔽层，最多在初级最外层绕半圈铜箔接地即可。铜箔不要绕满一圈，否则会形成短路环，在磁芯气隙附近产生涡流发热。

5.2 工业电源和LED驱动这类高可靠产品

工业电源和LED驱动对耐压、温升、寿命的要求远高于消费类。这类产品我反而不太建议激进的多段三明治，因为绕组分段越多，绝缘层数就越多，绕组填充率下降，磁芯窗口利用率变差，最终导致铜损上升、温升超标。

实践中，工业电源更常见的做法是保持初级整绕，在初级与次级之间直接加入完整的屏蔽铜箔，并把屏蔽层可靠接到初级地的低阻抗点。这样虽然初、次级间耦合面积没有减小，但屏蔽层能把电场拦截下来，效果同样不错，且对绕线工艺的要求更低、一致性更好。曾经有一个60W LED驱动项目，就是因为三明治绕法一致性不好（手动绕制的层间张力有差异），导致批量生产时传导测试离散性太大，后来改成加屏蔽层的整绕方案，反而稳定通过认证。

5.3 快充这类高频化应用

氮化镓快充把开关频率提到100kHz~200kHz甚至更高，这时候dv/dt极快（GaN的开关速度可以做到几十纳秒以内），EMI问题比传统硅MOSFET严峻得多。三明治绕法是必须的，而且往往需要在结构上继续叠加手段：

• 初级两段需要更精确的分匝比例，通常内层35%~45%、外层55%~65%会取得比较好的平衡；
• 增加静点屏蔽层，甚至在线包底部外加一匝铜箔屏蔽层阻断磁芯耦合；
• GaN器件对外部PCB走线的寄生电容极其敏感，所以变压器次级出线到同步整流MOSFET之间的环路必须极短，否则即使变压器绕得再好，PCB环路也会把噪声辐射出来。

这类高频化项目的EMI整改，往往是变压器、PCB布局、器件选型三方联动的系统工程，单独靠绕线方式很难包打天下。

6. 自己动手绕制与打样验证的建议

6.1 手绕样机时怎么保证参数一致性

很多工程师第一次验证三明治绕法，喜欢直接手绕两三个样机去测。这里有个容易犯的错：手绕时张力不稳定，导致首尾两段的绕组松紧度不同、层间厚度变化，反映到电气上就是初级电感量漂移、漏感离散性大，甚至传导测试结果都不可重复。

我的建议是：

• 手绕时给漆包线施加恒定张力，史诗级的方法是用手指夹住线慢慢送线，不要一紧一松；
• 每次绕完一层都要用胶带压紧，保证层间紧密贴合，减少层间空隙；
• 绕完立刻测初级电感量和漏感（次级短路后的初级电感），记录在样品上，对比多批样品的数值，波动超过5%就要检查工艺细节；
• 如果条件允许，首件打样可以交给变压器厂用机器绕制，虽然前期沟通成本高一点，但能直接验证量产工艺能不能落地。

6.2 样机测试的顺序和关注点

拿到三明治绕法样机后，不要急着先看EMI。先按常规步骤做功能验证：输入电压从90V到264V扫一遍，关注VCC电压、满载效率、动态负载响应；然后测MOSFET漏源电压波形，确认漏感尖峰在吸收电路兜得住；最后用热像仪看变压器本体温度，确定线径余量是否足够。

确认这些电气参数都正常后，才进入EMI预扫描。预扫描时建议把接收机或频谱仪设为峰值检波、准峰值和平均值一起看，先看中频段有没有整体下压，再逐段分析残余噪声的频谱特性。如果中频段余量在6dB以上，基本说明绕法选择正确；如果某个频段的噪声像钉子一样孤立突起，通常不是变压器绕法的问题，而是PCB布局和地环路的问题，需要回到布局层面排查。

6.3 与变压器厂沟通的沟通要点

量产时绕法定了并不意味着万事大吉，变压器厂的理解和执行力同样重要。下单时一定要在规格书里写清楚以下内容：

• 磁芯材质、气隙大小、电感量和允许公差（通常初级电感公差控制在±5%以内）；
• 每层绕组的匝数、线径、线种（漆包线还是三层绝缘线）；
• 绝缘胶带的层数和厚度，绝缘材料的品牌等级；
• 起始脚和收尾脚的PIN定义，内外层折返连接的焊盘位置；
• 三明治分段比例（如初级内层50T、外层74T）；
• 挡墙的有无、宽度和材质；
• 铜箔屏蔽层的宽度、圈数、接地引脚的指定位置。

变压器厂给你送回样时，除了看外观，还要着重确认一个容易被忽略的细节：骨架PIN脚的共面度。很多自动插件工艺里，变压器引脚稍有歪斜就会导致PCB插装不良，而这种问题到了SMT贴片线上才暴露，代价就大了。

7. 关于三明治绕法的几个“越早知道越好”的体会

做电源这些年，踩过最大的坑就是只盯着绕法本身，而忽略了绕法背后的电位分布、绝缘结构和工艺一致性。三明治绕法之所以能成为反激电源EMI优化的“万金油”，不是因为它能凭空消除噪声，而是它用最经济的方式重新分配了变压器内部的高频电位，让噪声更难找到往外传播的路径。

我个人现在设计变压器的习惯是：先按功率和拓扑确定磁芯和匝数，然后根据输出功率、耐压等级、外壳结构三件事，决定用三明治绕法还是屏蔽层方案。做适配器、充电器这类空间紧张、认证期限紧的产品，我默认上手就是三明治；做工业电源或对温升和一致性要求极高的产品，我会更谨慎地评估分段数，必要时用屏蔽层替代。

最后再分享一个小技巧：验证三明治绕法是否有效，不必等到完整装机。我常备一只拆掉二次侧整流管的裸板，在变压器次级输出端引出一根短探针，直接看次级绕组上的共模噪声电压。普通绕法通常能测到明显的方波脉冲串，而三明治绕法的电平通常能压低一半甚至更多。这个几十块钱成本的预处理，能在设计阶段就帮你把绕法方向定下来，到了认证测试阶段，你会感谢当初这个蠢办法帮了大忙。