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开关电源送去实验室测EMC，第一轮就超标的情形，做电源的同行应该都不陌生。大家的第一反应往往是加大共模电感、换更好的X电容，或者在后级加磁珠，调来调去发现频谱图就是纹丝不动。我在反复踩坑之后才真正明白：开关电源EMC不过关的根子，十有八九出在两处——PCB布局和变压器。这不是玄学，而是由高频开关电路的本质决定的，PCB上的走线、铜皮、器件摆放，变压器的绕组结构、屏蔽、出线方式，每一处都在参与寄生电容和寄生电感的“编程”。这篇文章不谈空泛的原理，只讲我实际项目里反复验证过的东西，希望能给正在被EMC测试折磨的电源工程师、PCB工程师和整改人员一些可以直接用的思路。

1. EMC问题的主战场：为什么PCB和变压器最先“背锅”

1.1 高频开关动作就是天生的噪声源

开关电源内部不存在“干净的波形”。以最典型的反激式开关电源为例，MOSFET的开关动作把直流母线电压斩成方波，这个方波的dV/dt可以达到几十kV/ms级别，而电流的dI/dt同样陡峭。任何一个有dV/dt的导体都相当于发射天线，任何一个有dI/dt的环路都相当于磁场天线。这就是为什么开关电源天然是EMI的产生者——你没办法消除开关这个动作，只能控制它产生的噪声被“看见”的路径和幅度。

你可能在示波器上见过反激开关电源的Vds波形，关断瞬间会出现尖峰和振铃，振铃频率通常落在几十MHz到上百MHz。这段振铃不是只在示波器里好看，它会沿着输入线、输出线往外传播，也会通过空间辐射出去。传导测试从150kHz看到30MHz，辐射测试从30MHz看到1GHz，Vds振铃如果谐振在30MHz以上，辐射超标几乎是定局。

所以我在项目一开始就会先看MOSFET的Vds波形，不急着立项成败，先把振铃频率、幅度记录下来。这个习惯帮我省掉了很多后期整改的工夫。如果你发现Vds上有长尾振荡或者大幅度的振铃，不要指望后级加个磁珠就能盖住，源头在PCB和变压器的寄生参数里。

1.2 共模电流终究要回到源头，路径都是PCB和变压器画的

先回答那个很多新手都会问的问题：共模电流最终回到哪里？答案是它会回到噪声源，也就是开关管的开关节点。共模电流不按“正常设计回路”走，它走的是杂散电容通路：MOSFET漏极的高频电势通过变压器初、次级绕组之间的寄生电容Cps，耦合到次级绕组，再经过次级线路、输出线、负载对地的寄生电容，流向保护地，然后沿LISN或电网阻抗回到输入端的L/N线，再经过整流桥和母线回到MOSFET漏极。

这条路径的每一段，都是PCB和变压器“画”出来的。变压器绕组之间的寄生电容大小决定了共模传导的强度；PCB上开关节点焊盘的大小、走线长度、散热器接地方式决定了漏极对地的高频通路好坏；Y电容放置的位置决定了共模电流是就地回流还是绕一大圈再回。你不把这段寄生路径搞清楚，加再多的滤波器件也可能是给噪声铺路。

1.3 滤波器件只解决“剩余”，PCB和变压器决定“底线”

很多整改工程师的习惯是：实测超标了，就拼命加共模电感感量，从10mH加到30mH，X电容从0.1μF加到0.47μF，结果高频段还是压不下来。原因很简单，滤波电感存在自谐振频率，电感量越大，分布电容越大，谐振频率越低。到几十MHz以后，大感量共模电感已经“失效”甚至呈容性，根本起不到滤波作用。而真正的高频噪声，恰恰是PCB走线和变压器绕组的分布参数直接送出去的。

我用一个生活化的类比来解释：PCB和变压器相当于房间的墙体，滤波器件相当于室内的空气净化器。墙体的缝隙和开孔没堵住，净化器功率再大，外面的灰尘还是往里灌。所以处理EMC正确顺序一定是先治PCB和变压器，再谈加滤波器件。

2. PCB布局：间距、环路和铜皮是三个见效最快的方向

2.1 整流后310V的间距要求：先满足安全，再谈EMC

很多人在画220V整流之后的PCB时，只盯着“这是310V”，却忽略了安规对电气间隙和爬电距离的要求。注意这里有个常见误区：310V指的是220Vac经桥式整流、电容滤波之后的峰值电压，也就是220V×1.414≈311V。可安规里查爬电距离看的是工作电压和污染等级，通常不是简单按“310V直流”来套的，要考虑最大瞬态过电压和污染等级。实际项目中，一次侧的L-N、整流桥正负极之间，污染等级2条件下，基本绝缘的爬电距离至少也要2.5mm到4mm；而一次侧与二次侧之间通常要求加强绝缘，爬电距离做到6mm以上，很多高端电源直接做到8mm。

我画板时的做法是：整流桥输出正负极之间，保持至少3mm电气间隙；反激变压器原副边之间开槽，PCB上刻出至少两处宽度6mm以上的隔离带；光耦和Y电容跨过隔离带的位置，Y电容下方开槽，避免焊盘之间形成沿面放电通路。这些间距不仅是安规要求，也是EMC的晴雨表——间距不足往往意味着你把高压大dV/dt节点和敏感输出节点放在了一起，通过PCB表面漏电流和寄生电感耦合噪声。先满足间距，再谈布局优化，顺序不能倒。

关于间距还有一个细节：AD、嘉立创EDA这些工具里都有爬电距离检查规则（Creepage/Clearance），但很多设计文件默认不开启。你要手动设置规则：把网络类别分成一次侧、二次侧、接机壳、备用网络，再对两类网络设置最小爬电距离和电气间隙，DRC才能自动报警。我接手过好几个“画完了都不知道哪里间距不够”的项目，最后都是DRC规则没配置全，整改时一个个人工量，太痛苦了。

2.2 功率环路面积是辐射和传导的双重放大器

开关电源里有几个关键高频环路，你可以把它们看成噪声的“发射天线”。对反激拓扑来说，最核心的是这个回路：母线电容正极→变压器初级绕组→MOSFET漏极→源极→采样电阻→母线电容负极。MOSFET导通时，电流从母线电容出发，沿这个环路流过初级；关断时，漏感能量通过钳位电路消耗，电流路径又会变。环路面积越大，这个“天线”的辐射效率越高，传导测试里的差模分量也越难抑制。

我调试过的板子里，凡是EMC特别难处理的，基本都是MOSFET和变压器、母线电容三者距离拉得很远，形成一个大包围圈。整改时第一件事就是看环路，把这三个器件尽量靠一起，采样电阻尽量贴近MOSFET源极，母线电容紧贴变压器初级和MOSFET漏极的节点。有时候仅仅是移动了电容位置，传导测试在1MHz附近的超标点就能降掉5dB以上。

这里给一个实用原则：高频环路优先按“电流脉冲顺序”摆放器件，而不是按原理图从左到右摆。原理图上母线电容在左边，变压器在中间，MOSFET在右边，那是为了方便阅读；PCB上你首先要保证MOSFET、变压器、母线电容围出的三角形面积最小。先摆放功率器件，再走信号线，最后才覆铜。你真按“原理图顺序”放，EMC能一次过的概率很低。

2.3 大铜皮不是越多越好：涡流损耗和天线效应都要防

热词里有一条“电机上面铺铜会导致高EMC”，我猜你第一反应是“铺铜不是能屏蔽和散热吗，怎么会增加EMC？”恰恰相反，大面积铜皮如果处在高频交变磁场中，就会感生出涡流。涡流不仅带来额外损耗——铜皮越厚、频率越高、磁通变化越剧烈，涡流损耗越大，而且涡流本身构成了新的环路电流，这个环路电流的流向是随机的，于是铜皮从“屏蔽层”变成了“辐射天线”。

开关电源里最容易犯这个错误的位置有这么几个：一是MOSFET漏极焊盘周围铺了大片铜皮，本意是散热，结果漏极的高dV/dt通过铜皮产生位移电流，噪声直接辐射出来；二是变压器磁芯下方或周边铺了闭合铜皮环，磁芯漏磁在铜皮里感应涡流；三是电机驱动板或功率板上，电机相线附近大面积铺地，相线上陡峭的dI/dt在铺铜里感应出涡流，反而向空间辐射干扰。

我的处理习惯是：MOSFET漏极焊盘尽量小，只保留满足载流和散热的必要面积；如果非要加大铜皮散热，务必在铜皮上开“米”字形狭缝，割断涡流环路，让感应电流没有闭合通路。变压器下方的PCB铜皮尽量镂空，或者在磁芯投影范围内不要铺实心铜，铺成网格状也可以减少涡流。这个细节看着小，但实测对30MHz以上辐射有决定性影响。

2.4 四层板层叠：参考平面不是“无脑铺GND”就完事

四层板在开关电源里越来越常见，因为可以提供完整的参考平面，减少环路面积。但参考平面铺得不对，反而会加剧EMC问题。最常见的设计是：顶层放功率器件和变压器，第二层完整铺GND，第三层走信号，底层铺GND或PGND。这里的关键是——GND平面要完整，不要被走线或过孔分割成碎片。开关电流从MOSFET源极流过GND平面回到母线电容负极，如果GND平面中间被一条信号线横穿隔断，高频电流就得绕行，绕行的路径就划出一块更大的环路面积，环路辐射自然变差。

第二层GND虽然完整，但要注意它不能把一次侧高压区和二次侧低压区“连成一片”。如果一次侧和二次侧的GND在平面层短接，高压侧的开关噪声直接灌到次级，输出的Y电容再怎么处理都难救。层叠设计时最好把一次侧GND和二次侧GND在平面层物理分开，只在Y电容或者光耦下方用一个窄桥连接，这样把噪声限制在可控路径上。

另外我提醒一句：四层板中间层尽量别放敏感信号线穿越高dV/dt的功率区。比如反馈信号、电流采样信号如果在第二层或第三层横穿变压器正下方、MOSFET下方这类重灾区，你相当于给噪声搭了一座桥。这样画出来的板子，加再大的输入滤波器也没用。

3. 变压器：你以为是变压，其实它在“传噪声”

3.1 变压器不是理想变压器：寄生电容Cps才是共模噪声的桥

从EMC角度讲，变压器绝不是一个只有“变比和漏感”的理想元件。原副边绕组之间隔着绝缘层，但绝缘层再厚也是介质，两层绕组加上介质就是一个平板电容器，这就是所谓的绕组间寄生电容Cps。它的典型值可以从几pF到几十pF，取决于绕组排列、绝缘层厚度、绕线长度和骨架窗口宽度。

共模传导噪声最经典的一条路，就是从MOSFET漏极（也就是变压器初级绕组的热端）通过Cps直接跳到次级绕组，再流向次级地和输出线。Cps越大，高频共模电流越容易穿过去。所以对EMC敏感的设计，Cps不是越小越好就是必须“可控”。你不能等到变压器打样回来才发现共模噪声扑不灭，那时候能做的只有加屏蔽层或者换变压器，代价和周期都受不了。

3.2 绕组结构：顺绕、三明治和屏蔽层之间的取舍

变压器的绕法直接决定Cps和漏感之间的平衡。我用一个表格给你看实际工程里的选择逻辑：

实际项目里，反激电源做PFC+LLC+SR这类高功率密度方案，通常逃不开三明治绕法，因为漏感直接决定MOSFET尖峰和整机效率。代价就是Cps变大，这时几乎一定要加屏蔽层或者调整Y电容位置来对冲。

3.3 屏蔽层接初级地还是次级地？这决定了成败

接地点选错是整改中最常见也最隐蔽的错误。屏蔽绕组的作用是拦截初次级之间的位移电流，让噪声提前回到源端，而不是跑到次级去。因此屏蔽层应该接初级侧的低噪声电位点，通常也就是母线电容负极或初级GND。如果你把屏蔽层接到次级地，噪声反而被“引入”次级，相当于告诉共模电流“这边有近路”，结果就是30MHz以上的辐射不降反升。

我在一个反激项目上踩过这个坑：变压器加了铜箔屏蔽，原边和副边都留了引出脚，让供应商把屏蔽层两端都引出，我以为这样“接地更稳”。测试结果让人傻眼——传导测试从1MHz到10MHz有所下降，但30MHz附近反而冒出一个尖刺。后来我把远离初级的另一端悬空，只用靠近初级GND的那一端接地，那个尖刺直接消失，整条频谱线降了将近8dB。屏蔽层的另一端悬空并不是浪费，它在原边电容里不需要闭合回路，闭合了就成了环路天线。

所以给变压器厂出制作要求时，你要写清楚：屏蔽层一端引出，且务必指定接到初级GND；不要把屏蔽层的两端都并在一起。这个要求要落到图纸里，口头沟通容易出偏差。

3.4 变压器磁芯接地和涡流损耗的现实问题

磁芯本身是铁氧体，不导电，所谓“磁芯接地”其实是指磁芯表面涂敷导电漆，或者包一层铜箔，再把导电层引出来接地。这种做法常见于屏蔽要求高的产品。但要注意：给磁芯包铜箔不是为了好看，是为了给漏磁通的电场分量一个低阻抗回流路径。磁芯表面的铜箔同样是一个高频环路，如果铜箔没有形成闭合导电环，它就只是“半截天线”；如果闭合但只一端引出接地，则还可能产生涡流损耗。

涡流损耗在高频下不容忽视，频率越高，涡流损耗越大（大致与频率的平方成正比）。开关电源里变压器工作频率动辄几百kHz，漏磁在大铜皮或磁芯屏蔽层上感应的涡流，不仅导致局部发热，还会把一部分磁场能量变成热耗散，同时涡流本身又产生反向磁场，带来不可控的寄生效应。你如果观察过变压器附近的PCB温度，会发现紧贴磁芯投影区域的铜皮局部偏热，很多时候就是涡流引起的。

我建议在PCB布局时，把变压器下方的铜皮做网格化处理或直接镂空，既能减涡流，也能减少变压器附近铜皮对绕组磁场的耦合。磁芯表面如果要加屏蔽层，位置尽量贴近绕组外侧，但出线从原边侧走，并且这个屏蔽层和变压器原边的屏蔽绕组最好不要同时使用，否则多一层金属就多一层电容，反而把噪声耦合通道变复杂了。

4. 实测超标之后的排查与整改实录

4.1 先学会看图：从频谱曲线分辨共模还是差模

拿到传导测试结果，第一件事不是动手焊元件，而是先判断超标频段属于共模噪声还是差模噪声。判断方法不复杂：差模噪声集中在开关频率的低次谐波附近，通常低频包络随负载电流变化明显，且主要出现在150kHz到几MHz；共模噪声频带较宽，往往在几MHz到30MHz呈宽带趋势，而且受Y电容、变压器屏蔽等“接地方案”影响更大。

我常用的验证手法是：在没有改变任何参数的情况下，分别测量L线对地和N线对地的干扰频谱，比较两者是否一致。差模噪声在L和N之间形成，表现为两者相减；共模噪声则是L和N对地同相位的。如果L和N的频谱几乎一样，基本都是共模主导。再有就是利用LISN和近场探头配合：近场探头靠近变压器和MOSFET时，读数变化明显的，说明噪声源在这附近；如果探头靠近输入线缆读数变化大，更可能是共模沿线路辐射。

这些判断基本功决定了你整改时是在“拆弹”还是在“盲拆”。我在给团队做培训时反复强调：在频谱图上看不出门道之前，不配动手改板。

4.2 按顺序处理：Y电容、X电容、共模电感的正确使用姿势

整改顺序我很明确：

第一步，先处理源头的振荡。在MOSFET的G极驱动回路加适当的栅极电阻（比如10Ω到47Ω之间，按驱动损耗和开关速度折中），在Vds上并联RC吸收或RCD钳位，把尖峰和振铃先压住。源头稳了一点，后续滤波才好发力。

第二步，处理差模。输入端加X电容，通常先从小值开始试，X电容放置要紧贴输入端接线端子或保险丝之后。X电容和共模电感之间的位置关系是：共模电感靠输入侧，X电容靠整流桥侧，二者组成π型滤波，效果比单独一个大X电容更好。

第三步，处理共模。共模电感的感值和绕法要留裕量，但别指望一味加大。Y电容从一次侧跨接到二次侧，容量在不超过安全漏电流的前提下试验，常见范围1nF到4.7nF。Y电容的放置位置不要跨得太远，引脚越短越好，要直接跨在变压器原副边的隔离带附近；更优的做法是把Y电容接在“变压器次级地”和“输入L/N线的中点”之间，但要注意安全要求。

第四步，如果高频仍然压不住，回过头去看变压器的屏蔽层，必要时加外层屏蔽磁芯接地，或者调整原边绕组起始脚。

这些步骤对我而言是“由内向外”的思路：先抑制源头振荡，再管理差模，再管共模输出路径，最后才考虑屏蔽罩。很多工程师一上来就买屏蔽罩，那是治标不治本，成本还高。

4.3 真实案例：加了屏蔽层反而更差，问题出在哪

我之前负责过一个反激适配器项目，批量做EMC预测试时，30MHz附近辐射超标大约4dB。我想当然地判断是变压器原副边耦合太强，于是让供应商在初次级之间加了一层完整的铜箔屏蔽层，并把屏蔽层两端短接后接到初级地。再测，30MHz那个点确实降了，但测试报告里25MHz到40MHz之间出现了新的鼓包，整体反而更难办。

后来我把近场探头沿着变压器的外表面扫，发现鼓包来自变压器引脚处的屏蔽层引线，引线太长，本身就是一根鞭状天线。整改方法是让屏蔽层引出线尽可能短，直接从屏蔽层边缘焊到骨架脚上，同时把另一端悬空。就这么一个变化，鼓包消失，30MHz老问题也控制住了。项目后来复盘时我才意识到，屏蔽层不是越完整越好，引线和接法才是关键。

这种“加了元件反而更差”的案例在EMC整改里很常见。原因是你改动了一个寄生参数，就会改变原有噪声路径的走向，噪声不会消失，它只是换了一条路走。整改时不要怕反复试，但要带着“这条改动改变了哪条路径”的思路去试，而不是盲目排序。

4.4 用好仿真工具，把问题往前移

进了实验室再整改，成本高、周期长，我现在更愿意在上机前用仿真去验证PCB和变压器的寄生参数。LTspice这类工具可以做变压器模型，核心是要把漏感、分布电容这些非理想参数拎出来单独建模。你可以把变压器的模型设成：理想变压器+初级串联漏感+原副边并联分布电容+层间电容，几个重要元件。

有人觉得仿真EMC不靠谱，因为寄生参数本身是预估的。我的观点是：仿真不是用来精确预测频谱曲线的，而是用来验证“相对变化”的。比如你把Cps从10pF改成3pF，仿真结果里共模噪声是变好了还是变坏了；把MOSFET的栅极电阻加大，振铃频率怎么移动。这些趋势判断很准，能帮你在电绘阶段就砍掉不合理的寄生参数组合。

另一个实用工具是近场探头加示波器，以近场场强来判断板上的哪个位置辐射最集中。我会在改板之前先做“热点扫描”，把探头从变压器、MOSFET、输出整流二极管、输入线端口逐个扫过去，记录峰值。热点排名和EMC测试的超标频段一对应，整改点就非常明确了。

5. 给下次设计用的总结：能提前画掉的问题就别留到测试

5.1 电路板设计阶段的自检清单

我给自己项目收敛了一套清单，每次投板前过一遍，能筛掉大部分EMC隐患：

这张表对应的是我踩过坑最多的地方。你按这个顺序自检，起码能在投板前解决七成EMC隐患。

5.2 变压器规格书里要写清楚的几条要求

变压器虽然通常是外发制作，但它的EMC属性完全由你定义。我写变压器规格书时才总结出几条硬性要求：

第一，明确绕组顺序和起始脚。顺绕还是三明治，要在图纸里画出来，不要只写“按常规绕法”，因为你认为的常规和供应商理解的常规可能不是一回事。

第二，规定屏蔽层的引出方式。单端引出、接到初级GND、引线长度不超过某值，这些都要写进图纸和打样要求里。屏蔽层就算不用，也要说明“本变压器不设屏蔽层”。

第三，给出分布电容的管控范围。比如原副边分布电容Cps控制在10pF以内，或者要求供应商提供Cps实测值。虽然很多变压器厂不常测这个参数，但你在规格书里提了，对方就会注意工艺一致性。

第四，漏感的管控。反激电源的漏感直接影响MOSFET尖峰和振铃频率，不要只给一个“越小越好”的模糊要求，而是根据你实际电路给出上限值，比如“初级漏感≤5%的初级电感量”。变压器样品的实测值要留档，方便你做批次一致性复盘。

5.3 从设计前端就把“EMC设计”当作流程的一部分

最后再说一个工作流层面的经验：EMC不是测试阶段的事，而是方案阶段就要介入的。我在确定拓扑和功率器件之后，第一件事就是和PCB工程师一起画“噪声地图”——把高dV/dt节点、高dI/dt环路、敏感采样信号线、输入输出端口的位置标出来，然后才根据这个地图布局。变压器供应商也是方案阶段就介入，先确定绕组结构、屏蔽方式、出线方向，再画PCB，而不是PCB画完再让变压器厂“配合一下”。这个流程倒过来，你会发现很多EMC问题在设计阶段就消失了，根本轮不到送实验室整改。

实际送测之外的另一个“治本”动作是：每次都把预测试频谱图、整改记录和最终方案存档。几次项目下来，这些数据会让你形成自己的“干扰区间数据库”，下次遇到一个相似频谱，你大概能判断出是变压器Cps偏大还是MOSFET散热铜皮问题。这种经验积累比任何标准曲线都实用。

我个人到现在还记得最早做反激电源时，为了过EMC把X电容、共模电感、磁珠轮番换了一遍，折腾了快一个月，最后发现是变压器的原副边引脚顺序反了，导致Cps被放大了好几倍。从那以后，我在每块电源板的设计里都把PCB和变压器看作一个整体系统，而不是两个独立的模块。这个习惯带给我的最大收益就是——测试室出来的好消息变多了，而返工变少了。