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芯片老化预测与在线自测试(LBIST/Margin Test)

副标题：NBTI/HCI老化、在线LBIST与性能裕度监测

在先进工艺 7nm/5nm/3nm 节点，晶体管阈值电压偏移、互连线电迁移、栅氧击穿等老化效应不再是"出货后10年才发生"的后端问题，而成为决定良率、寿命与功能安全等级的核心因素。汽车电子 ISO 26262 ASIL-D、数据中心 7×24 服务器、5G 基站 SoC 对"零缺陷 + 长期可靠性"的要求，使得传统的出厂 HTOL（High Temperature Operating Life）加速老化抽检已经无法覆盖全生命周期的随机失效。业界正在形成一套**“离线老化模型预测 + 在线 LBIST 定期自检 + 实时性能裕度(Margin)监测 + 系统级健康管理(PHM)”**的多层防护体系。本文从物理机理、架构设计、EDA 工具、代码实战、模型校准到未来趋势，系统地阐述芯片老化预测与在线自测试的工程落地方法。

一、芯片老化与寿命预测概述

1.1 浴盆曲线(Bath-Tub Curve)与三段失效期

芯片的全生命周期失效率通常用经典的浴盆曲线描述，分为三个阶段：

• 早期失效期(Early Failure / Infant Mortality)：t = 0 ~ 几十小时，主要由制造缺陷（栅氧针孔、金属短路/开路、颗粒污染）导致，失效率