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做射频数传模块这几年，我越来越觉得选对一个模块能省下一半的研发时间。PW1-928 RF Data Transceiver Module 是我最近一个远距离数据采集项目里用到的核心器件，它工作在 928MHz 附近的 Sub-GHz 频段，负责把现场的传感器数据无线传回中控机。这个模块我前后调了小两周，中间踩了不少坑，从天线匹配到电源纹波再到上位机配置都折腾了一遍。写这篇东西，主要是想把 PW1-928 从选型到落地的完整过程记录下来，给正在做无线数传、遥测遥控或者物联网采集项目的朋友一个可以直接参考的案例。

不管你是刚接触射频的嵌入式工程师，还是在 Sub-GHz 频段选型的老手，这篇文章里涉及的频率规划、射频链路设计、电源处理、固件配置和实测排障思路，应该都能给你一些启发。尤其是电源纹波对 ADC 的影响、RF Data Converter 工具版本兼容这些细节，很多文档里根本不会写，但实际调试时它俩能让你怀疑人生。

1. 项目定位与整体设计思路

1.1 为什么选 928MHz 这个频段

先说频段选择。PW1-928 这个名字里的“928”就是指中心频率约 928MHz。在 Sub-GHz 频段里，常见的还有 315MHz、433MHz、868MHz、915MHz 这些。不同国家和地区对 ISM 频段的划分有差异，比如 868MHz 是欧洲常用，915MHz 是北美常用，而 928MHz 则经常出现在一些专用无线数传设备上，比如无线条码枪、工业数据采集器、遥控器等领域。

我当时选 928MHz 而不是 2.4GHz，核心原因是远距离和穿透性优先。2.4GHz 频段拥挤，蓝牙、Wi-Fi、ZigBee 全挤在里面，实测在厂房里 2.4G 的链路衰减非常快，而且干扰严重。Sub-GHz 频段波长更长，绕射能力强，同样的发射功率下，空旷环境通信距离能比 2.4G 翻好几倍。对我这个项目来说，传感器节点分布在半径一公里左右的厂区，中间还有不少钢结构设备，Sub-GHz 是更合理的选择。

另外，928MHz 在射频器件选型上也有优势。配合合适的射频前端，这个频段不需要特别昂贵的微波板材，普通的 FR4 就能做出性能不错的微带天线和匹配网络，BOM 成本可控。

1.2 PW1-928 模块的核心能力拆解

PW1-928 本质上是一个半双工的射频数据收发器模块，它内部集成了射频收发芯片、PA、LNA、射频开关、时钟源以及必要的滤波匹配网络。用户侧只需要通过 UART 或者 SPI 接口灌入数据，模块就会自动完成组帧、调制、发射，或者接收解调后把数据吐出来。

我用的这颗模块几个关键参数如下：

选型时我特别关注的是接收灵敏度和发射功率的组合。-118dBm的灵敏度配合+20dBm发射功率，理论上在空旷环境能实现数公里的通信距离，当然实际工程中还要考虑天线增益、馈线损耗、环境衰减等因素，后面我会详细说实测数据。

注意：发射功率并不是越大越好。功率提高 3dB，通信距离只增加约 1.41 倍，但功耗和发热会明显上升，还可能因为频谱掩膜超标带来合规问题。户外长续航项目建议按需配置功率等级。

2. 射频链路设计：从天线到数据端

2.1 收发链路架构与关键指标

射频数传模块的链路设计，其实可以拆成发射链路和接收链路两条路径来看。

发射链路：基带数据 → 调制器 → 频率合成器 → PA 功率放大 → 匹配网络 → 天线。这个链路里我最关注的指标是发射频谱纯度和谐波抑制。PW1-928 内部有谐波滤波，但外部仍然建议预留一个低通滤波器位置，尤其是当你的天线离金属结构很近或者需要过认证的时候，谐波（比如 928MHz 的二次谐波 1856MHz）很容易超标。

接收链路：天线 → 匹配网络 → LNA 低噪声放大 → 混频器 → 中频滤波 → ADC → 解调。接收链路里，灵敏度受制于噪声系数，而噪声系数又和前端 LNA 的增益、噪声以及后级 ADC 的动态范围密切相关。这里就是很多项目容易出问题的地方：信号功率过大时接收机饱和，信号过小时淹没在噪声里，需要根据实际距离调整 LNA 增益或者 AGC 阈值。

我调试时习惯先用频谱仪看发射端的频谱包络，确认载波频偏和调制带宽是否正常，再用信号源加衰减器测接收端的 BER 曲线，这样能快速定位问题是出在发射端还是接收端。

2.2 ADC/DAC 与 RF Data Converter 的配合

如果你用的是纯模拟超外差方案，那 ADC 可能只出现在中频解调部分，和 PW1-928 模块本身关系不大。但如果你的系统是带射频直采的架构，比如 Xilinx RFSoC 配合外部射频前端，那么“RF Data Converter”这个概念就绕不开了。

先解释一下 RF Data Converter 是什么。传统射频接收链路是天线 → LNA → 混频 → 中频 → ADC，而射频直采架构直接让 ADC 在射频频率附近采样，省掉一级或者多级混频。Xilinx 的 RFSoC 器件里内置了高速 ADC/DAC 和高性能 RF 前端，使用RF Data ConverterIP 核来配置采样率、通道模式、数字下变频、抽取滤波等参数。

这里有个实际问题是，很多第一次用 RFSoC 的人会卡在版本兼容性上。比如Vivado 2020.1 里生成的 RF Data Converter IP 核，直接用 Vivado 2022.2 去打开，大概率会报版本不匹配或者 IP 定义冲突。我当时是在 2020.1 下完成的工程，后来同事升级到 2022.2，结果仿真和综合全部闹脾气。解决办法有两个：一是保持工程工具链版本一致，统一用 2020.2 或 2022.2；二是如果非要跨版本，需要打开 IP Catalog，右键 RF Data Converter，选择 "Report IP Status" 然后逐个升核。

另外，RF Data Converter 配置里有一堆让人头晕的参数，比如 ADC 的Decimation Factor、Sample Rate、Nyquist Zone选择。实际使用中，建议先把采样率确定好，再反推抽取系数，不要凭感觉乱填，否则数据带宽和 FPGA 逻辑时钟很容易对不上。具体来说，ADC 采样率和抽取因子决定了 DDR 侧的数据位宽和时钟频率，这个要按 Xilinx 的 JESD204B 接口协议来算，很多人就是栽在这里，FPGA 侧时序违规。

2.3 天线设计与阻抗匹配的实战要点

天线是整个射频链路里最容易被低估的环节。PW1-928 模块预留的是 50Ω 阻抗的射频输出口，可以外接天线。但 50Ω 是模块端的承诺，天线那边是不是 50Ω，完全取决于你的设计。

我先说结论：天线和模块之间的馈线越短越好，如果必须用长馈线，请选用低损耗同轴电缆，比如 RG178 或 RG316。你如果随便用一根普通导线把天线延长十几厘米，SWR（电压驻波比）会飙升，发射功率大部分会反射回来，轻则通信距离大幅缩水，重则烧掉模块的 PA。

天线匹配调试我建议分三步走：

1. 先把天线接到网络分析仪上看 S11 曲线，确认谐振点在 928MHz 附近，反射系数小于 -10dB（即 SWR 小于 2:1）。
2. 如果谐振点偏了，就调整匹配网络的电容电感值。微带天线的辐射体长度偏长，谐振点会偏低，这时需要适当缩短辐射体或者减小匹配串联电感。
3. 实装后一定要做整机测试，因为外壳、金属支架、电池、螺丝都会改变天线的谐振频率。我这里就出现过裸板测试完美，装进塑料外壳后灵敏度掉了 3dB 的情况，最后发现是外壳内部一根螺丝刚好靠近天线馈电点。

实操心得：天线附近半径 1/4 波长（约 8cm）之内，尽量不要铺地铜、走高频信号线或者放置金属屏蔽罩。这个区域是天线近场区，金属物体既影响辐射方向图，又会吸收能量，让效率直线下降。

3. 电源与信号完整性：容易被忽略的射频杀手

3.1 ADC 电源纹波为什么是重中之重

提到电源，很多人觉得只要模块能工作就行了。但在射频系统里，电源噪声会直接调制到射频信号上，尤其是对接收链路里的 ADC 和锁相环，影响非常致命。

为什么 ADC 对电源纹波这么敏感？原理其实很简单：ADC 转换过程中需要比较输入模拟电压和一个基准电压，如果供电或者基准上叠加了纹波，比较阈值就会被“抖动”。这个抖动反映到采样值上，就变成了量化噪声和杂散。对高速高精度的 ADC 来说，电源纹波还会通过内部放大器的电源抑制比（PSRR）漏进来，形成带内杂散。举个例子，如果 DC-DC 的开关频率是 1MHz，它产生的 1MHz 纹波在混频后就会在频偏 1MHz 的位置出现一对杂散，直接劣化接收机的灵敏度和抗干扰能力。

我的经验是，射频模块供电严禁直接使用 DC-DC 输出。哪怕 DC-DC 标称纹波只有 10mV，也要用 LDO 做二次稳压，并且在 LDO 前后都加电容阵列滤波。

3.2 LDO 滤波方案与电容选型

PW1-928 模块的供电我采用的是DC-DC 12V → LDO 3.3V → LC滤波 → 模块电源脚的结构。具体如下：

这里有一个细节：陶瓷电容的容值会随直流偏置电压下降。比如一个 10uF/16V 的 X5R 陶瓷电容，在 3.3V 偏置下实际容量可能只有标称的 50%~60%。所以如果要精确稳定地滤波，选电容时留 1.5~2 倍容值余量，或者干脆用钽电容、聚合物电容这些偏置特性更稳定的类型。

实测下来，用这个四级电源结构，模块接收灵敏度在 -118dBm 的基础上只损失了约 0.5dB；而如果不加 LC 滤波，直接用 DC-DC 供电，灵敏度会恶化 3~4dB，通信距离直接打七折。这种差异在近距离测试时几乎看不出来，但一到极限距离就原形毕露了。

3.3 PCB 布局布线的几条血泪教训

在一块同时有射频模块、MCU、DC-DC 的 PCB 上，布局布线比原理图设计更考验功力。我总结了几条自己踩过坑的规则：

第一，射频模块尽量靠板边放置，天线区域伸出板边，避免被地平面和外壳铜皮屏蔽。我见过不少设计把天线放在 PCB 角落但周围铺了一大片地，结果天线成了“地天线”，辐射效率极低。

第二，射频走线用共面波导或微带线结构，并确保走线下方的地平面完整，不要在射频走线正下方走其他信号线。928MHz 的波长约 32cm，一般 PCB 走线长度远小于波长，很多人以为不用讲究，但微小的阻抗不连续也会引入反射。

第三，数字地和射频地分开，单点汇接。MCU 的 SPI、UART 信号很脏，如果他们走线穿过了射频区域，开关噪声会通过地回路耦合到射频前端。建议用 0Ω 电阻或者磁珠在电源汇合点单点连接模拟地和数字地。

第四，DC-DC 电感远离射频模块。电感是近场辐射体，它的磁场会干扰射频走线和天线，这种干扰用频谱仪看是找不出固定杂散的，但就是会降低灵敏度。

注意：PCB 板材也很关键。928MHz 用 FR4 没问题，但要注意 FR4 的介电常数随频率变化，微带线阻抗计算时要使用 4.2~4.4 的有效介电常数，而不是低频下的值。如果做 2.4G 以上或者对阻抗一致性要求极高，建议换 Rogers 板材。

4. 固件配置与调试工具链

4.1 模块初始化与寄存器配置流程

PW1-928 支持透传模式和寄存器配置模式。透传模式下，模块内部自动处理一切，连接简单，适合快速验证；但要做精细化的频率、功率、速率调整，必须进入寄存器配置模式，通过 SPI 或者串口命令读写内部寄存器。

我的建议是：量产固件里一定要把关键寄存器显式配置一遍，而不是依赖模块默认值。因为不同批次模块的出厂默认值可能有细微差异，显式配置可以保证一致性。下面是典型的初始化流程：

1. 上电后等待模块内部晶振稳定，至少延时 50ms。
2. 复位模块（拉低复位脚或发送复位命令）。
3. 配置频点：写入 928MHz 对应的频率合成器寄存器，注意频率步进和锁相环分频系数要算准。
4. 配置调制参数：调制方式 GFSK，频率偏移 ±25kHz，数据速率 50kbps。
5. 配置发射功率：根据场景选择 +14dBm 或 +20dBm。
6. 配置接收滤波器带宽：设置为与数据速率匹配的带宽，比如 50kbps 速率对应 150kHz 带宽。
7. 开启中断或状态输出，进入待机模式。

这个流程里，最容易被忽略的是接收滤波器带宽和数据速率匹配。带宽太宽，噪声进来多，灵敏度下降；带宽太窄，有用信号被滤掉一部分，误码率升高。经验公式是：带宽 ≥ 2 × (数据速率 + 频偏)。比如 50kbps 速率，频偏 25kHz，带宽设 150kHz 是合理的。

4.2 Vivado RF Data Converter 版本兼容问题

如果你使用 Xilinx RFSoC 配合外部 RF 前端，就绕不开 RF Data Converter IP 核。前面说过 Vivado 2020 和 2022 版本之间的兼容问题，这里再展开讲讲。

RF Data Converter IP 在 Vivado 里被当作标准 IP 管理，但它内部又包含了很多子 IP 和仿真模型，版本跨度大了之后，IP 的.xci文件可能无法被新版工具直接加载。我遇到的情况是：先用 Vivado 2020.1 建了一个 RFSoC 工程，配置好 RF Data Converter，生成比特流，板级工作正常。后来同事用 Vivado 2022.2 打开这个工程，工具弹窗提示：

[IP_Flow 19-3657] IP 'rf_data_converter_0' is locked.

这个报错的意思就是 IP 被旧版本锁定，需要升级。操作路径是Reports → Report IP Status → 勾选该 IP → Upgrade Selected。但升级后一定要重新验证配置参数，因为新版 IP 可能调整了部分寄存器默认值，参数含义也会有细微变化。

除了版本升级，还有一个更隐蔽的坑：RF Data Converter IP 的仿真模型和实际硬件行为不完全一致。有时候仿真跑得很完美，上板后 ADC 数据全是不定值，这时候先别怀疑硬件，优先检查 IP 配置里ADC Tile、Sample Rate和Decimation是否和时钟约束匹配。

4.3 RFSoC 裸机开发需要 PMU 文件吗

这个问题在论坛上被问过很多次：“Xilinx RFSoC 裸机开发到底需不需要 PMU 文件？”

先说什么是 PMU。PMU（Platform Management Unit）在 Xilinx 的 Versal 和部分 MPSoC/RFSoC 平台里负责上电时序、电源管理、安全启动等功能。裸机开发时，PMU 固件一般由 BootROM 自动加载，或者由 FSBL（First Stage Boot Loader）加载。如果你用的是官方评估板，启动镜像里通常已经包含 PMU 固件，不需要额外操心。

但如果你的板卡是自己设计的，或者使用了非标准启动流程，那就必须检查 FSBL 和 PMU 固件的匹配情况。具体来说，在 Vitis 里创建裸机工程时，平台工程（Platform Project）的 Boot Domain 配置里要确保PMU FW被包含进启动镜像。如果漏了它，上电后 CPU 能跑起来但外设访问会卡死，尤其是涉及电源域的寄存器，读回来全是 0xDEADBEEF 这种特征值。

我处理过一个情况：RFSoC 裸机工程里，PMU 固件版本和 FSBL 版本不一致，导致 DDR 初始化不稳定，跑一段时间就随机死机。后来把 Vitis 里xilpm库升级到与 FSBL 相同的版本，问题才解决。

实操心得：不要把 PMU 当成可有可无的东西。如果你的 RFSoC 板卡上电后系统在 U-Boot 之前就卡住，优先检查 PMU 固件。启动日志里如果出现PMU Firmware version mismatch之类的提示，基本就是它的问题。

5. 实测效果与问题排查实录

5.1 空口测试：距离、速率、误码率

模块调通之后，我在三种场景下做了空口测试：开阔地、厂房内部、有遮挡的半户外环境。测试条件是：PW1-928 模块 + 1/4 波长单极天线（约 8cm 长），发射功率 +20dBm，通信速率 50kbps，GFSK 调制，接收端用频谱仪监测。

这个结果验证了一个经验公式：对于 Sub-GHz 窄带数传，路径损耗近似符合自由空间 + 经验衰减因子模型，远距离后信号衰落明显，和距离的 3.5 次方成正比。所以不要指望 1km 和 2km 只差 6dB，实际差值往往超过 12dB。

在测试时，我还特意用频谱仪观察了接收频点的底噪。开阔地环境底噪约 -115dBm，到了厂房内部，底噪升到 -105dBm 左右，这直接影响灵敏度，即使信号强度相同，误码率也会差很多。这说明现场干扰环境对通信距离的影响非常大，设计链路预算时一定要留足余量。

5.2 常见问题速查表

我把调试过程中遇到的问题整理成了表格，方便后面直接查：

这张表里，前两个问题是我这次项目中真实遇到的，后几个是我在其他射频项目中亲历或者帮别人排查过的。射频调试最容易犯的错误是“一次只改一个变量”做不到，总是心急同时动多个参数，结果问题没定位到，反而引入了新问题。

5.3 踩坑记录：电源纹波、晶振频偏、天线驻波

最后聊聊这次项目里最有价值的三次踩坑。

第一次是电源纹波导致的接收灵敏度劣化。我最初图省事，直接用 12V 转 3.3V 的 DC-DC 给模块供电。室内 20m 测试一切正常，但到户外 500m 测试时 BER 明显升高，数据重传频繁。我用频谱仪看接收底噪，发现带内多了一簇杂散，频率间隔正好等于 DC-DC 的开关频率。后面加了 LDO 和 LC 滤波，底噪立刻恢复正常。这个经历让我彻底明白了：射频系统的性能上限往往不是芯片决定的，而是电源决定的。

第二次是晶振频偏问题。模块用的是普通无源晶振，温漂比较大，在 25℃ 下校准很好，但环境温度降到 5℃ 时，载波中心频率偏了约 8kHz。对 50kbps 的窄带通信来说，这个频偏还不至于致命，但会明显恶化误码率。后来把普通晶振换成了 TCXO，这个问题就消失了。如果你的系统要在宽温度范围内使用，晶振成本千万别省。

第三次是天线驻波问题。我一开始把天线直接焊在 PCB 上，然后盖了一个金属外壳，结果发射功率基本出不去。用网分实测 S11，在 928MHz 处只有 -4dB，也就是 40% 的功率被反射回来。后来重新设计了天线座的位置，把天线辐射体伸出外壳 1cm 以上，S11 才恢复到 -18dB。这个教训告诉我：射频天线和结构外形是强耦合的，任何金属结构变更后都要重新测量天线参数，不能只靠仿真或者上一次的经验。

6. 总结一：一份可直接复用的射频数传设计清单

与其说总结，不如我直接把这次项目的可复用经验整理成一份清单，后面你拿到类似模块也能少走弯路：

• 频段选择：优先考虑 868/915/928MHz 等 Sub-GHz 频段，根据当地法规和应用场景定，不要盲目追新。
• 模块选型：发射功率、接收灵敏度、调制方式、接口类型、成本都要列成权重表，用表格对比打分。
• 电源设计：模块供电必须经过 LDO 再进模块，并加 LC 滤波，严禁 DC-DC 直接供电。
• 天线设计：预留匹配网络位置，实装后必须实测 S11，外壳和结构变更后要复测。
• 固件配置：显式配置所有关键寄存器，特别注意接收滤波带宽和数据速率的匹配。
• 工具链：RF Data Converter 这类 IP 要保持 Vivado 版本一致，跨版本升级后要完整回归验证。
• 裸机启动：RFSoC 裸机工程不要漏掉 PMU 固件，版本也要和 FSBL 匹配。
• 测试方法：先单点调通，再测距离；先测发射频谱，再测接收灵敏度；一次只改一个变量。

7. 总结二：我的真实感受与后续计划

这次 PW1-928 模块的项目做下来，我最大的感受是：射频这行，把基础做扎实比堆参数重要得多。很多人拿到模块就急着调参数、跑数据，结果问题全都出在那些不起眼的地方——电源纹波、天线匹配、晶振选型、工具链版本。而这些恰恰是数据手册上写得最少的部分，也是量产时最致命的部分。

最让我意外的是，这个模块在 2km 开阔地的表现超出了我最初的预期，但前提是电源和天线都处理到位。如果只看参数表，PK1-928 的 -118dBm 接收灵敏度并非顶级，但配合良好的工程实现，它依然能做到非常可靠的远距离通信。这也再次印证了一个道理：射频系统的性能是“木桶效应”，最短的板决定最终效果。

后续我会在这个项目基础上评估 LoRa 扩频方案和跳频机制，看看能不能再提升抗干扰能力，同时把低功耗模式做得更细。如果你也在做 Sub-GHz 数传，或者正在被 RFSoC 的电源和时钟问题折磨，欢迎在评论区分享你的调测经历，咱们一起把那些藏在细节里的坑都趟平。