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1. 项目概述：为什么我们要深究共模抑制比？

在模拟电路设计的江湖里，运算放大器（运放）绝对是当之无愧的“内功心法”。无论是做信号调理、精密测量，还是音频处理、电源管理，你几乎都绕不开它。而评价一个运放“内功”是否深厚，除了开环增益、带宽这些耳熟能详的指标，还有一个参数至关重要，却常常被初学者忽视，那就是共模抑制比。

我第一次被这个参数“教育”，是在做一个热电偶温度采集的小项目时。电路板焊接好，代码也调通了，但读回来的温度值总是在几十毫伏的范围内无规律跳动，远达不到设计精度。排查了半天电源、基准和布线，最后才发现问题出在运放上——我随手选用的一款通用运放，其共模抑制比在工频（50Hz）附近急剧下降，而我的电路前端恰巧没有做好屏蔽，引入了微弱的工频干扰。这个干扰作为共模信号加在了运放输入端，由于共模抑制能力不足，被转换成了差模误差，最终体现在了输出上。那次经历让我深刻意识到，不理解CMRR，你的精密电路设计就永远隔着一层纱。

简单来说，共模抑制比衡量的是运放“无视”两个输入端相同变化的能力，而只放大它们之间差异的能力。在一个充满各种电磁干扰的现实环境中，共模信号无处不在：电源纹波、地线噪声、空间辐射耦合……一个高CMRR的运放，就像是一个经验丰富的裁判，能完全忽略赛场边嘈杂的欢呼声（共模噪声），只专注于判断两位选手微小的动作差异（差模信号）。因此，读懂CMRR，不仅是读懂一个参数，更是掌握了一种在嘈杂环境中提取微弱真实信号的关键设计思想。接下来，我们就从最根本的原理出发，一层层剥开共模抑制比的神秘面纱。

2. 核心概念解析：差模、共模与CMRR的定义

要理解共模抑制比，我们必须先厘清差模信号和共模信号这一对核心概念。这是分析所有差分放大电路的基础。

2.1 差模信号：我们真正想放大的“有用信号”

差模信号，指的是加在运放同相输入端（V+）和反相输入端（V-）之间，大小相等、极性相反的信号分量。它是我们希望运放进行放大和处理的目标。

我们可以用数学公式来精确定义。假设运放同相输入端电压为 (V_+)，反相输入端电压为 (V_-)，那么差模电压 (V_{id}) 定义为： [ V_{id} = V_+ - V_- ]

举个例子，在一个典型的传感器接口电路中，比如称重传感器的惠斯通电桥输出，或者热电偶的两端电压，其有效输出就是差模信号。运放的核心任务，就是以极高的增益和线性度，将这个微弱的 (V_{id}) 放大到适合后续电路（如ADC）处理的电平。

2.2 共模信号：我们需要极力抑制的“背景噪声”

共模信号，指的是同时、同等地加在运放两个输入端的信号分量。它通常是我们不希望的干扰或无用信号。

其数学定义为共模电压 (V_{ic})： [ V_{ic} = \frac{V_+ + V_-}{2} ]

共模信号的来源非常广泛：

1. 地线噪声：由于PCB布局不当或接地系统不纯净，传感器端的地和运放电路端的地之间存在电位差，这个电位差会同时作用于两个输入端。
2. 电磁干扰：空间的电磁场（如电源线、电机、无线电）耦合到输入信号线上，由于两条走线通常平行且靠近，耦合进的噪声电压近似相等。
3. 传感器本身的偏置：许多传感器（如电桥）的输出本身就建立在一个共模电压之上。例如，一个由5V供电的电桥，其输出差分信号可能叠加在2.5V的共模电平上。

一个理想的运放应该对 (V_{ic}) 完全无动于衷，其输出不应随共模电压的变化而变化。

2.3 共模抑制比的定义与量化

既然理想运放能完全抑制共模信号，而实际运放做不到，我们就需要一个指标来衡量它“做得好不好”。这个指标就是共模抑制比。

共模抑制比定义为：运放的差模电压增益 (A_{vd}) 与共模电压增益 (A_{vc}) 之比的绝对值，通常用分贝（dB）表示。 [ CMRR = \left| \frac{A_{vd}}{A_{vc}} \right| ] [ CMRR(dB) = 20 \log_{10}\left( \frac{A_{vd}}{A_{vc}} \right) ]

这里需要深入理解一下：

• 差模电压增益 (A_{vd})：这是我们熟知的开环增益。指在开环条件下，输出变化量 (\Delta V_o) 与输入差模变化量 (\Delta V_{id}) 的比值。对于一个通用运放，(A_{vd}) 通常在 (10^5) （100dB）量级。
• 共模电压增益 (A_{vc})：这个参数在数据手册中通常不直接给出。它指的是输出变化量 (\Delta V_o) 与输入共模变化量 (\Delta V_{ic}) 的比值。对于一个设计良好的运放，(A_{vc}) 远小于1，理想情况下为0。

因此，CMRR越大越好。一个CMRR为100dB的运放，意味着其放大差模信号的能力是放大共模信号能力的10万倍。如果有一个1mV的差模信号和一个1V的共模信号同时输入，那么共模信号在输出端产生的效果仅相当于0.01mV的差模信号产生的效果，干扰被极大地抑制了。

注意：CMRR是一个频率相关的参数。绝大多数运放的CMRR在直流和低频时很高，但随着频率升高会显著下降。数据手册中通常会给出直流CMRR值和随频率变化的曲线图，这在高速或射频应用中必须仔细审查。

3. CMRR的物理根源：运放内部的不对称性

为什么实际运放无法完美抑制共模信号？其根本原因在于运放内部晶体管级的物理结构不可能做到绝对对称。我们可以从运放最经典的内部简化模型——差分输入级来理解。

3.1 差分对管：运放的“心脏”

几乎所有电压反馈型运放的输入级都是一个差分放大器，由一对精心匹配的晶体管（BJT或FET）构成。这对晶体管被称为“差分对管”。它们共享同一个尾电流源，如下图所示（一个简化的BJT差分对）：

Vcc | Rc Rc | | +----Vo+-----+ | | Q1 Q2 | | V+ -| |- V- | | +----I_尾-----+ | GND (或负电源)

它的理想工作原理是：

1. 尾电流源 (I_{尾}) 恒定。
2. 当 (V_+ = V_-)（纯共模输入）时，Q1和Q2的电流相等，各为 (I_{尾}/2)。由于集电极电阻 (R_c) 相等，两个集电极电压 (V_{c1}) 和 (V_{c2}) 也相等，因此差分输出 (V_o = V_{c1} - V_{c2} = 0)。共模信号被完美抑制。
3. 当 (V_+ > V_-)（差模输入）时，Q1的电流增加，Q2的电流等量减少，总和仍为 (I_{尾})。这导致 (V_{c1}) 下降，(V_{c2}) 上升，产生一个与 (V_{id}) 成正比的差分输出电压。

3.2 失配是如何导致CMRR下降的？

理想很丰满，现实却很骨感。在半导体制造过程中，无法保证两个晶体管以及两个集电极负载电阻 (R_c) 的参数完全一致。这种不一致就是“失配”。

• 晶体管失配：Q1和Q2的电流放大系数 (\beta)、基极-发射极开启电压 (V_{BE}) 可能存在微小差异。
• 负载电阻失配：两个 (R_c) 的阻值不可能绝对相等。

这些失配会带来一个严重后果：共模输入电压的变化，会导致尾电流 (I_{尾}) 在两个晶体管之间的分配比例发生微小变化。即使 (V_+ = V_-)，由于器件参数不同，流过Q1和Q2的电流也不再严格相等。这个电流差会在失配的负载电阻 (R_c) 上产生一个差分输出电压。

也就是说，一个纯粹的共模输入 (V_{ic})，由于内部不对称，被转换成了一個微小的等效差模输入 (V_{id, eq})，进而被运放的高增益 (A_{vd}) 放大，出现在输出端。这个等效转换关系，就是共模增益 (A_{vc}) 的来源。

量化分析：假设由于失配，共模输入变化 (\Delta V_{ic}) 产生了一个等效差模输入 (\Delta V_{id, eq})。那么共模增益可以表示为： [ A_{vc} = \frac{\Delta V_o}{\Delta V_{ic}} = A_{vd} \cdot \frac{\Delta V_{id, eq}}{\Delta V_{ic}} ] 定义共模抑制比为： [ CMRR = \frac{A_{vd}}{A_{vc}} = \frac{\Delta V_{ic}}{\Delta V_{id, eq}} ] 这个公式给出了CMRR的另一种理解：CMRR等于共模输入变化量与由此产生的等效差模输入变化量之比。例如，CMRR = 100dB（(10^5)），意味着1V的共模变化，在输入端看起来只相当于10μV的差模变化。

3.3 从数据手册读懂CMRR参数

在实际选型时，我们主要通过数据手册来了解运放的CMRR性能。你需要关注以下几点：

1. 典型值与最小值：数据手册会给出在特定条件（通常是直流、室温）下的CMRR典型值（Typ）和最小值（Min）。设计时，尤其是对可靠性要求高的场合，应基于最小值进行考量。
2. 测试条件：CMRR的测试通常在规定的电源电压和共模电压范围内进行。例如，“CMRR = 120dB (Vcm = ±12V, Vs = ±15V)”。
3. 共模电压范围：CMRR并非在整个输入电压范围内都保持恒定。当共模电压接近正负电源轨时，CMRR通常会急剧下降。数据手册中的曲线图会清晰地展示这一点。
4. 频率响应：这是最容易被忽视也最关键的一点。几乎所有运放的CMRR都像一个低通滤波器，随着频率升高而下降。手册中会有一张“CMRR vs. Frequency”的曲线图。例如，一款运放在DC时CMRR为130dB，但在10kHz时可能已经降到80dB，在100kHz时只剩60dB。这意味着你的电路对高频共模噪声的抑制能力远不如低频。

实操心得：不要只看直流CMRR值。如果你的信号带宽是10kHz，那么你必须确保在10kHz处，运放的CMRR仍然满足系统对噪声抑制的要求。否则，高频噪声（如开关电源的纹波噪声）会轻易侵入你的信号链。

4. CMRR对电路性能的实际影响

理解了CMRR的原理，我们来看看它在实际电路中是如何“捣乱”的。这种影响通常表现为两种形式的误差：直流失调误差和交流噪声误差。

4.1 将共模误差折算到输入端

分析CMRR影响最有效的方法，是将其造成的输出误差，折算成一个串联在运放输入端的电压源，称为共模抑制误差电压。这样，我们可以把它和运放本身的输入失调电压（Vos）一并考虑。

计算公式如下： [ V_{error, cmrr} = \frac{V_{ic}}{CMRR} ] 这里CMRR是数值比（不是分贝值）。例如，若 (V_{ic} = 5V)， CMRR = 100dB（即 (10^5)），则： [ V_{error, cmrr} = \frac{5V}{10^5} = 50\mu V ] 这50μV的误差电压，会像真正的输入信号一样，被运放的闭环增益放大。如果电路闭环增益为100倍，那么在输出端就会产生5mV的直流误差。

案例分析：电桥测量电路假设有一个压力传感器电桥，由5V参考电压驱动。电桥平衡时，输出两端电压都是2.5V。这个2.5V就是运放需要承受的共模电压 (V_{ic})。

• 如果选用CMRR为86dB（20000倍）的普通运放，误差电压为 (2.5V / 20000 = 125\mu V)。
• 如果选用CMRR为110dB（316000倍）的仪表放大器，误差电压为 (2.5V / 316000 \approx 8\mu V)。 对于满量程输出仅为10mV的传感器来说，125μV的误差占了满量程的1.25%，这可能是无法接受的。而8μV的误差仅占0.08%，性能就好得多。

4.2 在典型运放配置中的影响

CMRR的影响与运放的外部电路配置密切相关。

1. 反相放大器：

   Vin ---R1---+--- Vout | R2 | GND

   在理想反相放大器中，运放的同相输入端接地（(V_+ = 0)）。由于“虚短”，反相输入端 (V_- \approx 0)。因此，两个输入端的电压都被强制在0V附近，共模电压 (V_{ic} \approx 0)。在这种配置下，运放自身的CMRR几乎不引入误差。这是反相放大器的一个巨大优势。

2. 同相放大器/电压跟随器：

   Vin --- V+ | +--- Vout | 反馈网络

   在同相放大器中，根据“虚短”，(V_- \approx V_+ = V_{in})。因此，共模电压 (V_{ic} = V_{in})。CMRR引入的误差直接与输入信号 (V_{in}) 相关。如果 (V_{in}) 是一个大幅值信号，这个误差可能非常显著。电压跟随器是同相放大器的特例（增益为1），其CMRR误差分析完全相同。

3. 差分放大器： 这是受CMRR影响最直接、也最需要仔细分析的电路。一个由单运放构成的经典差分放大器，其输出不仅取决于电阻匹配（这决定了电路的“差分增益”和“共模增益”），也取决于运放自身的CMRR。总体的共模抑制能力是运放CMRR和电阻网络匹配程度共同作用的结果。在实际设计中，往往电阻失配带来的影响会先于运放自身的CMRR成为瓶颈。因此，在需要极高共模抑制的场合（如仪表测量），通常会使用集成仪表放大器，其内部通过激光修调确保了电阻的高精度匹配，并集成了高性能的运放。

注意事项：当你使用同相放大器或任何让运放输入端跟随信号变化的电路时，必须评估信号中的共模分量（包括直流偏置和交流噪声）以及运放在该频率下的CMRR，计算可能产生的误差。对于电池供电的便携设备，信号地可能浮动，共模电压范围可能很大，此时CMRR的选择尤为关键。

5. 如何测量与评估运放的CMRR？

虽然数据手册提供了参考，但在一些精密应用或需要验证电路板性能时，我们可能需要自己测量CMRR。这里介绍一种经典的直流CMRR测试方法。

5.1 测试电路与原理

我们可以将运放接成一个**单位增益缓冲器（电压跟随器）**来测试。因为在这种配置下，输出等于输入，且输入端的共模电压等于施加的测试电压，便于计算。

测试电路如下：

1. 将运放接成电压跟随器（输出直接接反相输入端，信号从同相输入端输入）。
2. 在同相输入端施加一个可变的直流电压 (V_{test})。这个电压应在运放规定的共模输入电压范围内选取几个点，例如从负电源到正电源，每隔1V测一次。
3. 测量运放的实际输出电压 (V_{out})。

5.2 测试步骤与计算

1. 搭建电路：确保电源稳定，运放工作在线性区。
2. 施加测试电压：使用一个高精度的电压源（如六位半台式万用表的源功能）施加 (V_{test})。记录其精确值 (V_{test1})。
3. 测量输出电压：使用另一台高精度万用表测量运放输出端电压 (V_{out1})。对于一个理想运放，(V_{out1}) 应等于 (V_{test1})。
4. 改变测试电压：改变 (V_{test}) 至另一个值 (V_{test2})，测量对应的 (V_{out2})。
5. 计算：
   • 共模输入变化量：(\Delta V_{ic} = V_{test2} - V_{test1})
   • 输出变化量：(\Delta V_o = V_{out2} - V_{out1})
   • 由于电路是单位增益，差模增益 (A_{vd} \approx 1)（闭环）。因此，测得的共模增益为： [ A_{vc(measured)} = \frac{\Delta V_o}{\Delta V_{ic}} ]
   • 计算CMRR： [ CMRR = \frac{A_{vd}}{A_{vc}} \approx \frac{1}{A_{vc(measured)}} ] [ CMRR(dB) = 20 \log_{10}\left( \frac{1}{|A_{vc(measured)}|} \right) = -20 \log_{10}(|A_{vc(measured)}|) ]

5.3 注意事项与误差来源

• 输入失调电压的影响：运放自身的输入失调电压 (V_{os}) 会叠加在输出上，但它是一个固定偏移。我们通过测量电压变化量((\Delta V_o) 和 (\Delta V_{ic})) 来计算CMRR，可以消除 (V_{os}) 的直流影响。
• 测试设备精度：测试的精度极限取决于你的电压源和万用表的精度。对于测量120dB以上的CMRR，需要极其精密的仪器。
• 电源抑制比的影响：在测试中，改变输入共模电压可能会引起电源电流的微小变化，如果电源有纹波或噪声，可能会通过PSRR（电源抑制比）影响输出。因此测试应在非常干净、稳定的电源下进行。
• 温漂：CMRR本身也随温度变化。精密测量需要在恒温环境下进行。

这种方法主要测量直流或低频CMRR。要测量CMRR的频率特性，需要一个能输出纯净交流共模信号的低失真信号源，并配合网络分析仪或频谱分析仪来测量不同频率下输出与输入的比值，过程要复杂得多，通常只在芯片验证阶段进行。

6. 设计实践：如何为你的电路选择CMRR合适的运放？

理论最终要服务于设计。面对琳琅满目的运放型号，如何根据CMRR这个指标做出选择？你需要一个系统化的评估流程。

6.1 确定系统的共模抑制需求

这是第一步，也是最关键的一步。你需要问自己几个问题：

1. 我的信号源是什么？是浮地的（如热电偶、变压器）、单端接地的，还是本身就有大的共模电压（如电桥、高压分压）？
2. 我的应用环境噪声有多大？是安静的实验室，还是充满电机、继电器、开关电源的工业现场？噪声的主要频率成分是什么（工频50/60Hz，开关频率几十kHz）？
3. 我的系统精度要求是多少？总误差预算是多少？允许多少误差分配给CMRR？

量化计算示例： 假设你设计一个电子秤，使用输出灵敏度为2mV/V的称重传感器。在5V激励下，满量程差分输出为10mV。你希望系统的总精度达到0.1%（即满量程的0.1%，对应10μV）。

• 传感器电桥的共模电压是2.5V。
• 假设环境中的工频干扰在传感器端引入的共模噪声峰值为100mV。
• 你的信号调理电路总增益为500倍（将10mV放大到5V）。

现在来分配误差预算。假设你允许由CMRR不足导致的误差不超过总误差预算的1/3，即约3.3μV（折算到输入端）。

• 对于直流共模电压（2.5V）：所需CMRR > (2.5V / 3.3\mu V \approx 7.6 \times 10^5)，即约117dB。
• 对于工频共模噪声（100mV）：所需CMRR > (0.1V / 3.3\mu V \approx 3.0 \times 10^4)，即约90dB。

注意，这里对直流CMRR要求（117dB）远高于对工频CMRR的要求（90dB）。但你必须查看心仪运放的CMRR-频率曲线，确保它在50Hz/60Hz处确实能达到90dB以上。

6.2 运放选型对比要点

根据计算出的需求，去筛选运放。在数据手册中，重点关注：

选型建议：

• 前端缓冲/高阻抗采样：如果信号源阻抗高，首先考虑输入偏置电流小的JFET或CMOS输入型运放，同时关注其CMRR。
• 直流精密放大：优先选择“精密运放”，其Vos、CMRR、PSRR等直流指标都经过优化。
• 直接连接传感器电桥：仪表放大器通常是首选。它用一个运放和几个高精度电阻解决了差分放大、高输入阻抗和高共模抑制的难题，设计更简单，性能更可靠。
• 高频应用：必须仔细查看CMRR vs Frequency曲线，选择在信号带宽内CMRR衰减不大的型号。

6.3 外部电路设计技巧

即使选对了运放，糟糕的电路板设计也会毁掉它的CMRR性能。

1. 对称布局是生命线：对于差分信号走线（如运放的两个输入端），必须保持严格的对称。这意味着走线长度、宽度、到其他信号线的距离应尽可能一致。这能确保外部耦合进来的共模噪声对两条线的干扰几乎相等。
2. 用好“保护走线”：对于高阻抗输入线，可以在其两侧或上下层布置接地的“保护走线”（Guard Trace），将其包围起来。这能有效屏蔽空间电场干扰，防止其不对称地耦合到差分线上。
3. 电源去耦至关重要：电源噪声是共模干扰的重要来源。必须在每个运放电源引脚附近放置一个0.1μF的陶瓷电容到地。对于高频或精密电路，还需并联一个10μF的钽电容或电解电容。
4. 单点接地与星型接地：模拟地线设计要避免形成地环路。所有敏感模拟电路的地应汇聚到一点（通常是ADC或基准源的地引脚），再连接到电源地。这能减少地线噪声压差，从而降低共模电压。
5. 注意反馈电阻的匹配：在差分放大等电路中，外部电阻的失配会直接限制电路的共模抑制能力。如果使用1%精度的普通电阻，电路的整体CMRR很难超过40dB。对于要求高的场合，需要使用0.1%甚至更高精度的金属膜电阻，或使用可调电阻进行微调。

实操心得：很多时候，电路抗干扰能力差，不一定是运放CMRR不够高，而是PCB布局破坏了信号的对称性。在投板前，花时间仔细检查差分走线的对称性，比事后更换更贵的运放要有效得多。一个简单的检查方法是：将PCB的差分走线区域镜像翻转，看是否完全重合。如果不重合，就需要优化。