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1. 项目概述：为什么我们需要硬件级的时钟监控？

在工业电机驱动、数字电源或者汽车电控这类对实时性和可靠性要求极高的嵌入式系统里，时钟信号就像是整个系统的“心跳”。CPU的指令执行、PWM波的生成、ADC的采样触发，所有这些关键任务都严格依赖于一个稳定、准确的时钟节拍。想象一下，如果这个“心跳”突然变快、变慢甚至停跳，会导致什么后果？电机可能失控，电源输出可能波动，整个系统可能陷入混乱。因此，对核心时钟源进行持续、可靠的监控，不再是“锦上添花”，而是“性命攸关”的安全需求。

传统的软件监控方法，比如用定时器中断去周期性检查另一个时钟的频率，存在几个致命弱点：首先，它依赖CPU的干预，在CPU负载高或发生故障时，监控本身就可能失效；其次，软件检测存在延迟，无法捕捉到瞬间的时钟毛刺或短时频偏；最后，它增加了软件复杂度和CPU开销。而双时钟比较器（Dual-Clock Comparator, DCC）正是为了解决这些问题而生的硬件模块。它独立于CPU核心，通过纯硬件电路实时比较两个时钟信号的频率关系，一旦超出预设的容差窗口，立即产生错误标志甚至触发中断，为系统提供了一道硬件安全屏障。

德州仪器（TI）在其C2000™系列高性能微控制器（如TMS320F28P65x）中集成了DCC模块，使其成为功能安全（Functional Safety）设计中的关键一环。本文将带你深入DCC模块的内部，不仅弄懂其工作原理，更会手把手教你如何配置寄存器、计算关键参数，并分享在实际项目中应用单次测量和连续监控模式时，那些数据手册上不会写的“避坑”经验。

2. DCC模块核心原理与工作模式拆解

要玩转DCC，首先得理解它的“三板斧”：三个计数器、两种工作模式，以及一个核心的“时间窗口”概念。

2.1 核心组件：三个计数器的角色扮演

DCC模块内部有三个核心的递减计数器，它们协同工作，构成了监控逻辑的基石：

1. Counter0：这是参考时钟计数器。它由用户选择的Clock0驱动。你需要在DCCCNTSEED0寄存器中给它一个初始值（种子），然后它就开始以Clock0的频率递减。它的归零，标志着一次测量周期的“预期结束点”。

2. Counter1：这是被测时钟计数器。它由Clock1驱动，种子值写在DCCCNTSEED1寄存器里。它的递减速度反映了Clock1的实际频率。设计目标是让它在Counter0归零后的一个特定时间窗口内也归零。

3. Valid0：这是有效窗口计数器。它同样由Clock0驱动，种子值配置在DCCVALIDSEED0寄存器中。它的启动条件是Counter0归零。一旦启动，它就开始递减。你可以把Valid0的计数过程想象成一个“宽容的裁判计时器”。Counter1必须在这个裁判计时器归零之前完成自己的计数（即Counter1也归零），比赛才算顺利通过，否则就会判罚出错。

它们三者的关系，可以用一个赛跑 analogy 来理解：Counter0和Counter1是两个在不同跑道上、以不同速度跑步的运动员（速度由各自时钟频率决定）。Valid0则是在Counter0冲线后开始计时的一段时间。Counter1必须在Valid0计时结束前冲线，才算合格。

2.2 两种工作模式：单次测量与连续监控

DCC提供了两种工作模式，通过DCCGCTRL寄存器中的SINGLESHOT位域来控制，以适应不同的应用场景。

2.2.1 单次测量模式（Single-Shot Mode）

这种模式就像用精密仪器做一次“点测”。当你启动DCC后，三个计数器从种子值开始递减。无论结果成功（DONE）还是失败（ERROR），在Counter0和Valid0都归零后，整个DCC模块会自动停止（DCCENA位可能被硬件清除，具体需查勘误表或实测）。你需要手动清除状态标志并重新使能，才能进行下一次测量。

它最适合什么场景？

• 系统启动自检：上电后，验证关键的时钟源（如PLL输出）是否锁定在预期频率。
• 周期性诊断：在系统空闲时，主动测量某个辅助时钟（如外部输入的AUXCLKIN）的频率。
• 校准验证：在调整了内部振荡器（INTOSC）的微调参数后，验证其频率精度。

注意：在单次测量模式下，如果测量成功，DCCSTATUS.DONE标志位会被置1。务必在重启DCC前，通过向该位写1来清除这个标志，否则模块可能无法进入下一次计数周期。这是一个常见的初始化遗漏点。

2.2.2 连续监控模式（Continuous Monitoring Mode）

这是DCC的“看门狗”模式。一旦使能，DCC就会周而复始地工作。只要Counter1在Valid0窗口内归零（即频率关系正常），三个计数器就会自动重新装载种子值，开始下一轮比较。这个过程完全由硬件完成，无需软件干预。

一旦发生错误（Counter1过早或过晚归零），DCC会停止计数（计数器值冻结），并置位DCCSTATUS.ERR标志。此时，软件可以读取冻结的DCCCNT0、DCCVALID0和DCCCNT1寄存器值，辅助分析故障原因。

它最适合什么场景？

• 关键时钟的实时守护：持续监控主系统时钟（如SYSCLK）与一个高稳定度的参考时钟（如晶体振荡器XTAL）之间的比例关系。
• 安全冗余监控：在拥有多个时钟源的系统中，用DCC相互监控，实现时钟域的交叉校验。
• 故障永久性检测：检测时钟是否完全停滞（Stuck-at fault）。

2.3 错误条件与状态解析

理解何时会触发ERROR，是正确使用DCC的关键。错误本质上就是Counter1的归零时刻脱离了Valid0定义的“安全窗口”。

1. Counter1过早归零（Clock1过快或Clock0过慢）：Counter1在Counter0归零之前就已经数完了。这意味着Clock1的频率高于预期，或者Clock0的频率低于预期。这也包含了Clock0卡死（stuck-at）的情况，因为Counter0根本不递减。
2. Counter1过晚归零（Clock1过慢或Clock0过快）：Counter0和Valid0都数到零了，Counter1还没数完。这意味着Clock1的频率低于预期，或者Clock0的频率过高。这也包含了Clock1卡死的情况。

无论哪种错误，都会导致计数器冻结，ERR标志置位。如果使能了错误中断（ERRENA），还会产生中断。此时，读取冻结的计数器值可以帮助定位问题：如果COUNT1值还很大，可能是Clock1太慢或丢失；如果COUNT1为0但COUNT0不为0，则是Clock1太快。

3. 核心细节：寄存器配置与参数计算实战

光懂原理不够，能算出正确的参数、配好寄存器才是真本事。这部分我们结合数据手册的公式，拆解每一步的计算逻辑和实操要点。

3.1 时钟源选择寄存器：DCCCLKSRC0与DCCCLKSRC1

这两个寄存器决定了Counter0/Valid0和Counter1的“心跳”来源。DCCCLKSRC1的配置稍显特殊，它有一个KEY字段（bits 15-12），必须写入0xA才能解锁对CLKSRC1字段的写入。这是一个安全特性，防止意外修改。

选择策略与注意事项：

• 参考时钟（Clock0）的选择：应选择一个你认为更稳定、更可靠的时钟源。通常，外部晶体振荡器（XTAL）是首选，其次是芯片内部的精密振荡器（INTOSC1/2）。它的频率Fclk0需要尽可能准确。
• 被测时钟（Clock1）的选择：可以是任何你需要监控的时钟，如PLL输出、系统时钟、外设时钟（如ADC转换时钟、PWM时钟）等。
• 关键限制：两个时钟必须是异步的。如果它们同源且相位已知，这种比较就失去了意义。DCC的设计就是用来处理异步时钟比较的。
• 实操提示：在配置DCCCLKSRC1时，务必遵循“先写KEY，再写CLKSRC”的顺序，或者使用TI提供的DriverLib函数CLB_configGlobalInputMux（虽然函数名是CLB，但可能对应相关配置，具体需查库文件）来安全配置。

3.2 种子值计算：理论公式与工程化处理

这是DCC配置中最核心、最容易出错的部分。数据手册给出了理论公式，但我们需要理解其工程含义并进行调整。

核心设计目标：在理想情况下（时钟频率完全符合预期），让Counter1在Counter0归零的时刻也恰好归零。但由于时钟异步和数字电路延迟，我们允许Counter1在Counter0归零后的一小段时间窗口（即Valid0计数期间）内归零。

计算步骤分解：

步骤1：理解并计算“DCC固有误差（DCC Error）”这个误差不是时钟本身的误差，而是DCC模块因为两个时钟异步启动/停止以及数字电路量化所带来的测量误差。单位是Clock0的周期数。

• 异步误差（Async. Error）：因为Clock0和Clock1不同步，它们的启动和停止边缘可能错开。公式根据Fclk1和Fclk0的相对大小有所不同。通常，为了保守起见，即使我们知道Fclk1 > Fclk0，在未知或可能变化的情况下，可以采用最坏情况公式：Async. Error = 2 + 2 × (Fsysclk / Fclk0)。这里的Fsysclk是配置DCC模块时所在域的系统时钟频率。
• 数字化误差（Digitization Error）：固定为8个Clock0周期。
• DCC Error = Async. Error + Digitization Error。

实操心得：在实际工程中，为了简化并留足余量，我常常会做一个保守估计。例如，假设Fsysclk=200MHz，Fclk0=20MHz，那么Async. Error ≈ 2 + 2*(200/20) = 22个周期。加上8个周期的数字化误差，DCC Error我可能会直接取30或40个周期，为异步不确定性留出足够空间。稍微过大的窗口只会让检测稍欠灵敏，但过小的窗口会导致误报。

步骤2：确定“应用允许的频率容差（Allowable Frequency Tolerance）”这是你对被测时钟（Clock1）频率偏差的业务要求。例如，你要求PLL输出频率的误差不能超过±0.1%。这个值由你的系统性能指标决定。

步骤3：计算总测量窗口（Window）Window定义了以Clock0周期数表示的整个测量周期长度。公式为：Window = (DCC Error) / (0.01 × Tolerance)例如，DCC Error取30， Tolerance为0.1%，则Window = 30 / (0.01 × 0.1) = 30,000。这个值直接决定了计数器的最大规模，Window越大，Counter0和Counter1的种子值就越大。

步骤4：计算“允许的频率误差窗口”Frequency Error Allowed = Window × (Tolerance / 100)接上例，Frequency Error Allowed = 30000 × (0.1 / 100) = 30个Clock0周期。 这意味着，即使Clock1有±0.1%的固有偏差，在测量周期内，它带来的计数差异也就30个Clock0周期。

步骤5：计算总误差（Total Error）和最终种子值

• Total Error = DCC Error + Frequency Error Allowed = 30 + 30 = 60
• Counter0种子值 (DCCCNTSEED0) = Window - Total Error = 30000 - 60 = 29940
  • 意义：Counter0数完29940个周期后，进入Valid0窗口期。
• Valid0种子值 (DCCVALIDSEED0) = 2 × Total Error = 2 × 60 = 120
  • 意义：Valid0窗口的宽度是120个Clock0周期。Counter1必须在这120个周期内归零。
  • 重要限制：数据手册强调，VALIDSEED0必须不小于4。这是硬件的要求。
• Counter1种子值 (DCCCNTSEED1) = Window × (Fclk1 / Fclk0)
  • 假设Fclk1=100MHz,Fclk0=20MHz， 则DCCCNTSEED1 = 30000 × (100 / 20) = 150,000。
  • 关键限制：DCCCNTSEED1是一个20位的寄存器，最大值是2^20 - 1 = 1,048,575。如果计算值超过这个数，你必须回头调整设计：要么放宽容忍度Tolerance（减小Window），要么选择频率更接近的时钟对。

步骤6：反向校验最小容忍度如果你的被测时钟频率很高，或者参考时钟频率很低，导致Fclk1/Fclk0的比值很大，可以使用公式先计算理论最小容忍度：Tolerance_min (%) = (100 × DCC Error × (Fclk1/Fclk0)) / 1048575如果这个最小容忍度大于你的系统要求，说明此组时钟源不适合用DCC进行该精度级别的监控，需要重新选型。

3.3 控制与状态寄存器：DCCGCTRL与DCCSTATUS

• DCCGCTRL：这是DCC的“总开关”。
  • DCCENA：使能位。写非5h的值启动DCC，写5h停止。注意：在单次模式下，完成或出错后，此位可能被硬件自动清除，读取状态可以确认。
  • SINGLESHOT：模式选择。写入0xA启用单次模式，写入其他值（通常0x5是复位值，表示禁用该功能，但需根据其他值判断为连续模式）为连续模式。务必查阅具体型号的数据手册确认有效值。
  • ERRENA和DONEENA：分别用于使能错误完成和完成中断。即使不使能中断，错误和完成的状态标志依然会在DCCSTATUS寄存器中更新。
• DCCSTATUS：
  • ERR：错误标志。为1表示发生错误。清除方法是向该位写1。
  • DONE：完成标志。仅在单次模式下有效，为1表示一次测量成功完成。清除方法同样是向该位写1。

配置流程口诀：

1. 先停后配：确保DCCENA=5h（停止），再进行所有配置。
2. 种子先行：正确计算并写入DCCCNTSEED0、DCCVALIDSEED0、DCCCNTSEED1。
3. 选好时钟：配置DCCCLKSRC0和DCCCLKSRC1（注意KEY）。
4. 设置模式：配置DCCGCTRL中的SINGLESHOT位。
5. 清空状态：向DCCSTATUS的ERR和DONE位写1，清除可能存在的旧标志。
6. 最后启动：设置DCCGCTRL.DCCENA为非5h值，启动DCC。
7. 使能中断（可选）：如果需要，配置ERRENA和DONEENA，并在PIE或NVIC中配置相应的中断服务程序。

4. 实操过程：从理论到代码的完整实现

我们以TMS320F28P65x的典型应用为例，使用TI的C2000Ware DriverLib库进行编程，演示两种模式的实现。

4.1 场景一：单次测量模式验证PLL频率

目标：用20MHz的外部晶体（XTAL）作为参考时钟（Clock0），验证200MHz的PLL输出时钟（Clock1）是否准确。

假设条件：

• Fclk0 = 20 MHz(XTAL)
• Fclk1 = 200 MHz(PLLRAWCLK)
• Fsysclk = 200 MHz
• 要求频率容差Tolerance = ±0.1%
• 保守估计DCC Error = 40个Clock0周期。

计算过程：

1. Window = 40 / (0.01 * 0.1) = 40,000
2. Frequency Error Allowed = 40000 * (0.1 / 100) = 40
3. Total Error = 40 + 40 = 80
4. DCCCNTSEED0 = 40000 - 80 = 39920
5. DCCVALIDSEED0 = 2 * 80 = 160(大于4，符合要求)
6. DCCCNTSEED1 = 40000 * (200 / 20) = 400,000(小于1,048,575，符合要求)

代码实现要点：

#include "driverlib.h" #include "device.h" void DCC_SingleShot_PLL_Verification(void) { uint32_t result = 0; // 1. 初始化DCC模块（以DCC1为例） DCC_initModule(DCC1_BASE); // 2. 停止DCC DCC_disableModule(DCC1_BASE); // 3. 配置时钟源 // Clock0 选择 XTALOSC (假设其映射值为特定值，需查头文件) DCC_setClockSource0(DCC1_BASE, DCC_CLOCK_SOURCE_XTAL); // Clock1 选择 PLLRAWCLK (需查头文件确认宏定义) DCC_setClockSource1(DCC1_BASE, DCC_CLOCK_SOURCE_SYSPLL_CLKOUT); // 4. 配置种子寄存器 DCC_setCounter0Seed(DCC1_BASE, 39920); // DCCCNTSEED0 DCC_setValid0Seed(DCC1_BASE, 160); // DCCVALIDSEED0 DCC_setCounter1Seed(DCC1_BASE, 400000); // DCCCNTSEED1 // 5. 配置为单次模式，并使能完成中断（可选） DCC_setMode(DCC1_BASE, DCC_MODE_SINGLE_SHOT); DCC_enableDoneInterrupt(DCC1_BASE); // 如果需要中断 // 6. 清除可能存在的旧状态标志 DCC_clearStatus(DCC1_BASE, DCC_STATUS_ERROR | DCC_STATUS_DONE); // 7. 启动DCC DCC_enableModule(DCC1_BASE); // 8. 等待完成或错误（轮询方式示例） while(1) { result = DCC_getStatus(DCC1_BASE); if(result & DCC_STATUS_DONE) { // 测量成功，PLL频率在容差范围内 DCC_clearStatus(DCC1_BASE, DCC_STATUS_DONE); break; } if(result & DCC_STATUS_ERROR) { // 测量失败，频率超差或时钟故障 // 可以读取当前计数器值辅助诊断 uint32_t cnt0 = DCC_getCounter0Value(DCC1_BASE); uint32_t val0 = DCC_getValid0Value(DCC1_BASE); uint32_t cnt1 = DCC_getCounter1Value(DCC1_BASE); DCC_clearStatus(DCC1_BASE, DCC_STATUS_ERROR); // 处理错误... break; } } // 9. 单次测量结束，DCC模块可能已自动停止。如需再次测量，需重新配置并启动。 }

4.2 场景二：连续监控模式守护系统时钟

目标：用10MHz的内部振荡器INTOSC1作为参考时钟（Clock0），连续监控100MHz的系统时钟SYSCLK（Clock1）。

假设条件：

• Fclk0 = 10 MHz(INTOSC1)
• Fclk1 = 100 MHz(SYSCLK)
• Fsysclk = 100 MHz
• 监控容差Tolerance = ±0.5%(连续监控可稍宽松)
• 保守估计DCC Error = 50个Clock0周期。

计算过程：

1. Window = 50 / (0.01 * 0.5) = 10,000
2. Frequency Error Allowed = 10000 * (0.5 / 100) = 50
3. Total Error = 50 + 50 = 100
4. DCCCNTSEED0 = 10000 - 100 = 9900
5. DCCVALIDSEED0 = 2 * 100 = 200
6. DCCCNTSEED1 = 10000 * (100 / 10) = 100,000

代码实现要点：

void DCC_Continuous_Monitoring(void) { // 1. 初始化并停止DCC DCC_initModule(DCC1_BASE); DCC_disableModule(DCC1_BASE); // 2. 配置时钟源 DCC_setClockSource0(DCC1_BASE, DCC_CLOCK_SOURCE_INTOSC1); DCC_setClockSource1(DCC1_BASE, DCC_CLOCK_SOURCE_CPU1_SYSCLK); // 假设宏定义为此 // 3. 配置种子寄存器 DCC_setCounter0Seed(DCC1_BASE, 9900); DCC_setValid0Seed(DCC1_BASE, 200); DCC_setCounter1Seed(DCC1_BASE, 100000); // 4. 配置为连续模式，并使能错误中断 DCC_setMode(DCC1_BASE, DCC_MODE_CONTINUOUS); DCC_enableErrorInterrupt(DCC1_BASE); // 5. 清除状态 DCC_clearStatus(DCC1_BASE, DCC_STATUS_ERROR | DCC_STATUS_DONE); // 6. 启动DCC DCC_enableModule(DCC1_BASE); // 此后，DCC将在后台持续运行。 // 如果系统时钟偏差超过0.5%，将触发错误中断。 } // DCC错误中断服务例程 __interrupt void DCC1_Error_ISR(void) { uint32_t cnt0, cnt1, val0; // 读取冻结的计数器值，用于诊断 cnt0 = DCC_getCounter0Value(DCC1_BASE); val0 = DCC_getValid0Value(DCC1_BASE); cnt1 = DCC_getCounter1Value(DCC1_BASE); // 分析错误原因： // 如果 cnt1 == 0， 说明Clock1过快或Clock0过慢/停滞。 // 如果 cnt1 > 0 且 val0 == 0， 说明Clock1过慢或停滞。 // 清除DCC错误标志 DCC_clearStatus(DCC1_BASE, DCC_STATUS_ERROR); // 执行安全处理程序，如切换备份时钟、进入安全状态等。 Enter_Safe_State(); // 确认中断 DCC_clearInterruptTag(DCC1_BASE); Interrupt_clearACKGroup(INTERRUPT_ACK_GROUP9); // 假设DCC1中断在PIE GROUP9 }

5. 常见问题与排查技巧实录

在实际项目中调试DCC模块，你大概率会遇到下面这些问题。我把踩过的坑和解决方法记录下来，希望能帮你节省时间。

5.1 问题：DCC模块使能后没有任何状态变化，计数器也不递减。

排查思路：

1. 检查时钟源是否有效：这是最常见的问题。确保你选择的Clock0和Clock1在系统当前配置下是真正存在且活跃的。例如，如果你选择XTAL作为Clock0，但硬件上没有焊接晶体，或者振荡器未使能，那么Clock0就没有时钟信号。使用寄存器查看器或调试器，确认相关时钟门控和配置寄存器已正确设置。
2. 确认DCCENA位：写入DCCENA后，读取该寄存器确认值已改变。有些型号的DCC在单次模式结束后会自动清除此位，需要读取状态判断当前是否处于运行状态。
3. 检查种子寄存器是否为0：数据手册明确警告，COUNTSEED0、VALIDSEED0或COUNTSEED1为0会导致未定义行为。务必确保写入的是计算后的非零值。
4. 验证KEY字段（仅对CLKSRC1）：如果Clock1没有时钟，检查DCCCLKSRC1.KEY字段是否已正确写入0xA以解锁对CLKSRC1的配置。

5.2 问题：连续模式下频繁误报错误，但实际时钟测量正常。

排查思路：

1. DCC Error估计不足：这是导致误报的头号原因。你计算时使用的Fsysclk可能不对，或者异步误差的估计过于乐观。尝试将计算出的DCC Error值增大50%甚至100%，重新计算种子值。宁可让监控窗口宽一点，减少误报，也不要让它太敏感。
2. 时钟抖动（Jitter）：特别是开关电源或电机驱动环境中，电源噪声可能导致时钟产生较大抖动，瞬时频率可能超出你设定的静态容差。考虑增加容忍度Tolerance，或者为DCC模块使用更干净的电源轨。
3. Valid0窗口过小：确保DCCVALIDSEED0的值远大于4，建议至少为计算值的1.5倍，以吸收时钟相位抖动和毛刺。
4. 测量Counter1种子值：DCCCNTSEED1的计算依赖于准确的Fclk1/Fclk0比值。如果这个比值有微小误差（例如，PLL未完全锁定在标称值），会导致Counter1的递减速度与预期有偏差。使用高精度频率计或芯片的其他定时器模块，实际测量一下两个时钟的频率。

5.3 问题：单次测量模式完成后，无法再次启动。

排查思路：

1. 未清除状态标志：单次模式完成后，DONE或ERR标志会被置位。在重新使能DCC（DCCENA）之前，必须通过写1来清除这些标志。这是最容易被忽略的步骤。
2. 模块未正确停止：有些器件的DCC在单次模式结束后，需要先将DCCENA位写为停止值（5h），等待几个周期，再重新配置种子值（有时需要重新写入），最后再使能。参考具体型号的勘误表（Errata）或技术参考手册的“Initialization/Application Information”章节。
3. 寄存器访问顺序：确保遵循“停止 -> 配置种子/时钟源 -> 清除状态 -> 启动”的标准流程。

5.4 问题：如何用DCC测量一个未知频率的时钟？

这是单次模式的一个巧妙应用，如数据手册Example-2所示。方法：

1. 将一个已知频率的低频时钟作为Clock0（参考时钟）。
2. 将未知时钟作为Clock1。
3. 将DCCCNTSEED1设置为最大值0xFFFFF（1048575）。
4. 根据已知的Fclk0和你期望的测量精度，计算DCCCNTSEED0和DCCVALIDSEED0。Valid0窗口应设置得足够宽，以容纳Counter1从最大值递减到0的时间（当然，此时会触发错误，但我们预期如此）。
5. 启动单次测量。当Counter0和Valid0都归零而Counter1还未归零时，会触发错误并冻结计数器。
6. 读取冻结的DCCCNT1值，记为COUNT1_final。
7. 根据公式计算Fclk1：Fclk1 = Fclk0 * (DCCCNTSEED1 - COUNT1_final) / (DCCCNTSEED0 + DCCVALIDSEED0)注意：这里DCCCNTSEED0 + DCCVALIDSEED0近似等于Window，即Counter0和Valid0总共消耗的Clock0周期数。这种方法精度受到DCC误差和计数器分辨率限制，适用于粗略测量或频率范围判断。

5.5 高级技巧：利用冻结的计数器值进行深度诊断

当DCC报错时，不要仅仅重置它。读取DCCCNT0、DCCVALID0和DCCCNT1这三个冻结的值，它们包含了丰富的故障信息：

• COUNT1接近0，COUNT0还很大：强烈指示Clock1频率远高于预期，或者Clock0严重变慢/停滞。
• COUNT1值很大，VALID0为0：指示Clock1频率低于预期或已停滞。
• COUNT1为0，COUNT0也为0，VALID0不为0：这可能发生在Counter1提前归零，但Counter0也很快数完的情况下。需要结合具体种子值分析。
• 三个值都与种子值相差无几：可能DCC刚启动就因某种原因（如时钟瞬间毛刺）触发了错误，未必是频率漂移。

将这些值与种子值、以及你计算时的预期值进行比较，是定位时钟系统问题的有力手段。建议在错误中断服务程序中，将这些计数器值保存到非易失性存储器或通过诊断接口上报，便于后续分析。