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1. 项目概述

在电机控制、数字电源这类对实时性和可靠性要求极高的嵌入式系统中，电流采样的精度与速度直接决定了整个系统的性能上限和安全底线。传统的逐次逼近型ADC虽然速度不慢，但在高噪声的功率变换环境中，其精度和抗干扰能力往往捉襟见肘。这时，基于Sigma-Delta调制技术的SDFM模块就成了一个关键角色。它本质上是一个“异步采样，同步处理”的高手：前端的Σ-Δ调制器以极高的频率（通常是MHz级别）将模拟信号转换为1位比特流，后端的数字抽取滤波器则负责将这个高速但粗糙的比特流，“提炼”成我们需要的、高分辨率的低速数字信号。

然而，仅仅把信号采准了还不够。在电机控制中，我们通常需要将电流采样与PWM的开关周期严格对齐，以确保每个控制周期计算用的电流值都对应着同一个开关状态，避免因采样时刻的相位偏差引入控制误差甚至导致振荡。这就是SDSYNC（滤波器同步）事件的核心价值——它像一根指挥棒，让SDFM的数据就绪时刻与PWM的节奏同步。另一方面，系统必须能对过流、欠压等危险状况做出“本能反应”，在微秒级内切断PWM输出，这远快于CPU的中断响应。这就需要依赖SDFM内置的比较器单元和中断系统，它们能在硬件层面直接比较、决策并触发保护动作。

因此，理解并正确配置SDFM的同步与中断，不是简单的寄存器配置练习，而是构建一个既“聪明”（高精度控制）又“敏捷”（快速保护）的实时控制系统的基石。本文将结合TI AM263P等主流实时控制MCU的SDFM模块，深入拆解SDSYNC的时序约束、比较器与数字滤波器的配置陷阱，以及中断系统的联动逻辑，分享从理论到实战的完整配置心得与避坑指南。

2. SDFM核心架构与同步机制深度解析

要玩转SDFM的同步与中断，必须先对其内部的工作流有一个清晰的画像。我们可以把SDFM的一个通道想象成一个拥有两条并行流水线的精密工厂。

第一条流水线是“数据通路”，负责高精度测量。它从Σ-Δ调制器（如AMC1306）接收高速比特流（SD-Dx），经过一个可配置的Sinc滤波器（主数据滤波器）进行抽取和滤波。这个滤波器的过采样率（DOSR）决定了最终输出的数据速率和分辨率。例如，一个Sinc3滤波器配合DOSR=256，能提供极高的噪声抑制能力，但输出数据率会降低，延迟（Latency）也会增加。处理后的高精度数据被存入一个16级的FIFO，等待CPU读取或用于控制算法。

第二条流水线是“监控与保护通路”，负责快速反应。它使用另一个独立的Sinc滤波器（比较器滤波器），通常配置为更低的过采样率（COSR），以实现更快的响应速度。这个滤波器的输出会实时与用户预设的高阈值（HLT）和低阈值（LLT）进行比较。一旦超标，立即生成事件（COMPHx/COMPLx），这个事件可以通过XBAR直接送到PWM的Trip输入端，实现“硬件杀车”，也可以在触发CPU中断进行更复杂的故障处理。

而SDSYNC事件，就是协调这两条流水线，并使其与外部PWM世界同步的关键信号。它通常由ePWM模块在特定时刻（如计数器为零或周期匹配时）产生。当SDFM收到SDSYNC脉冲后，会复位其内部滤波器的抽取状态，确保下一个滤波结果的起始边界与PWM周期对齐。这就好比在工厂的装配线上打下一个标记，保证每个生产节拍产出的“产品”（电流采样值）都能对应到正确的“时间窗口”（PWM周期）。

关键约束：SDSYNC的“单脉冲”原则技术手册中特别强调：每个PWM周期内，必须确保只产生一个SDSYNC事件。在使用PWM递增或递减计数模式时，这很容易保证。但在递增-递减计数模式下，PWM计数器会先增后减，在一个周期内会两次经过产生同步事件的点（例如0点）。如果不加处理，就会在一个PWM周期内产生两个SDSYNC脉冲。这将彻底扰乱SDFM的时序，导致滤波器同步状态机混乱，采样时刻完全错乱。解决方法是利用PWM模块的同步输出逻辑，确保只在计数器递增到周期值或递减到0时（根据具体需求选择其一）产生一次同步信号。

3. 比较器滤波器与数字滤波器的实战配置

比较器单元是SDFM的保护机制核心，其配置的合理性直接关系到系统保护的可靠性与抗干扰能力。它并非简单地比较一个“原始值”，而是包含了一个可配置的Sinc滤波器（用于信号调理）和一个可选的数字滤波器（用于抗干扰）。

3.1 比较器Sinc滤波器的配置与延迟计算

比较器滤波器同样支持Sinc1, Sinc2, Sinc3, SincFast等类型，其过采样率（COSR）独立于主数据滤波器。选择的原则是在响应速度和噪声抑制之间取得平衡。例如，在需要极快速过流保护的场合，可能会选择Sinc1或SincFast配合较低的COSR（如8或16）；而在需要对噪声较大的电压信号进行阈值监控时，则可能选择Sinc2或Sinc3配合较高的COSR。

这里有一个至关重要的启动陷阱：由于Sinc滤波器的固有结构，在滤波器首次启用、禁用后重新启用、或在运行中动态重配置后，输出的前几个样本是无效的。具体无效样本数量取决于滤波器类型：

• Sinc1: 无无效样本。
• Sinc2: 第1个样本无效。
• Sinc3/SincFast: 前2个样本无效。

如果在这个“无效样本”窗口内就使能比较器中断（CMPxH/CMPLx），极有可能因为错误的采样值触发误保护，导致系统无故停机。因此，技术手册明确要求：必须在配置比较器滤波器后，等待一段足够的“建立时间”，才能开启比较器中断。

这段建立时间的计算公式为：比较器滤波器延迟 + 5个SDFM时钟周期。 比较器滤波器的延迟（Latency）可以通过公式计算。对于SincN型滤波器，其延迟通常为(N * COSR) / f_sdm_clk。例如，对于一个配置为Sinc2、COSR=16、SDFM输入时钟为10MHz的滤波器，其延迟为(2 * 16) / 10MHz = 3.2μs。再加上5个时钟周期（0.5μs），总的建立时间至少需要3.7μs。在实际编程中，我们通常会通过一个简单的延时循环或利用PWM周期计数器来确保这段时间过去。

3.2 数字滤波器：消除误触发的硬件“去抖”器

比较器输出的COMPHx/COMPLx事件是“生硬”的，任何一次瞬时的噪声毛刺都可能导致其翻转，从而引发误保护。SDFM内置的数字滤波器就是一个硬件“去抖”电路，专门用于滤除这类干扰。

它的工作原理基于一个可配置深度的采样窗口（FIFO）。假设我们设置窗口大小SAMPWIN = 7（即窗口内有8个样本），阈值THRESH = 6。数字滤波器会持续监测输入事件（COMPHx）在这个窗口内的状态。

• 如果当前输出为0，当窗口内“1”（事件有效）的个数达到或超过6个时，输出才翻转为1。
• 如果当前输出为1，当窗口内“0”（事件无效）的个数达到或超过6个时，输出才翻转为0。
• 如果“1”或“0”的个数达不到阈值，输出则保持不变。

这确保了只有持续一段时间（由窗口大小和采样时钟预分频CLKPRESCALE决定）的稳定事件信号，才能最终传递出去。THRESH必须大于SAMPWIN/2，这是为了防止在窗口内“1”和“0”数量相等时输出发生振荡。

配置数字滤波器的一个关键步骤是初始化其内部FIFO。在设置好SAMPWIN、THRESH、CLKPRESCALE参数后��必须将控制寄存器中的FILINIT位置1。这个操作会将FIFO窗口内的所有样本初始化为一个已知状态（通常为0），防止上电或配置后残留的随机数据导致立即误触发。

一个重要的行为差异：当选择数字滤波器路径时，其输出到事件标志位（SDIFLG.FLTx_FLG_CEVTx）的路径上有一个上升沿检测逻辑。这意味着，即使数字滤波器输出持续为高，事件标志也只在从0到1的跳变沿被置位一次。如果软件清除了该标志，在滤波器输出保持高电平期间，标志位不会再次被置位。然而，直接输出到XBAR的CEVETxOUT事件，或者选择原始比较器输出路径时，则没有这个限制，会持续反映当前状态。这个细节在设计故障锁存或周期性检查的逻辑时需要特别注意。

4. 中断系统配置与联动逻辑全解

SDFM的中断系统是其与CPU协同工作的神经枢纽，分为两大类：错误中断（SDy_ERR）和数据就绪中断（SDy_DRINTx）。每一类中断都有复杂的使能链和标志管理逻辑。

4.1 错误中断（SDy_ERR）：系统的安全哨兵

SDy_ERR是一个聚合中断，任何通道的多种故障事件都可能触发它。其使能逻辑是一个多级“与门”：

1. 全局主中断使能：SDCTL.MIE必须置1。这是总开关。
2. 具体事件中断使能：需要为特定事件单独使能。
   • 比较器事件1/2：需设置SDCPARMx.EN_CEVT1或EN_CEVT2= 1。
   • 调制器失效：需设置SDCPARMx.MFIE= 1。
   • FIFO溢出：需先使能FIFO (SDFIFOCTLx.FFEN=1)，再使能其溢出中断 (SDFIFOCTLx.OVFIEN=1)。
3. 事件源选择：对于比较器事件，还需要通过SDCPARMx.CEVT1SEL和CEVT2SEL寄存器，选择哪些具体的比较器输出（COMPH1, COMPL1, COMPH2, COMPL2）可以触发CEVT1和CEVT2事件。

当事件发生时，对应的标志位（如SDIFLG.FLTx_FLG_CEVT1,SDIFLG.MFx）会被硬件置位。清除这些标志需要满足两个条件：一是软件向SDIFLGCLR寄存器中对应的位写1；二是触发该标志的硬件事件源已经变为无效状态（例如，过流状态已消失）。如果事件源持续有效，即使软件清除了标志，它也会立即被重新置起。这种设计防止了软件在故障未消除时盲目清除标志而忽略持续存在的危险。

4.2 数据就绪中断（SDy_DRINTx）：高效的数据搬运工

SDy_DRINTx是每个数据通道独立的中断，用于通知CPU有新数据可供读取。它有两种触发模式，通过SDFIFOCTLx.DRINTSEL位选择：

• 模式0（AFx触发）：每当主数据滤波器完成一次数据转换，就会产生AFx（Acknowledge Flag）事件。如果使能了该通道的数据确认中断（SDDFPARMx.AE = 1），且DRINTSEL=0，则AFx事件会触发SDy_DRINTx中断。这种模式适合需要处理每一个数据样本的场景，但中断频率高，CPU负担重。
• 模式1（FIFO中断触发）：这是更常用、更高效的模式。当使能FIFO (FFEN=1) 和FIFO中断 (FFIEN=1)，并设置DRINTSEL=1时，中断将由FIFO数据就绪事件（SDFFINTx）触发。SDFFINTx事件产生的条件是：FIFO状态计数器SDFIFOCTLx.SDFFST的值大于或等于FIFO中断水平位SDFIFOCTLx.SDFFIL的设置值。

例如，设置SDFFIL = 8，那么当FIFO中积累的数据达到或超过8个时，才产生一次中断。CPU可以在中断服务程序中一次性读取多个数据，大大降低了中断频率，提升了系统效率。SDFFIL可以动态调整，用于实现不同深度的“水印”告警。

4.3 中断服务程序（ISR）编写要点

在ISR中，标准的处理流程如下：

1. 判断中断源：读取SDIFLG寄存器，确定是哪个通道、哪种事件触发了中断。
2. 处理事件：
   • 如果是数据就绪中断，则从SDFIFOx寄存器中读取相应数量的数据。
   • 如果是比较器错误中断，应立即读取SDCDATAx寄存器确认当前比较器值，并执行保护动作（如通过软件强制PWM输出高阻态），同时通过XBAR配置确保硬件Trip也已生效。
   • 如果是调制器失效或FIFO溢出，需要进行错误恢复或系统复位。
3. 清除中断标志：向SDIFLGCLR寄存器中对应的位写1，以清除SDIFLG中的标志位。务必在ISR返回前完成此操作。
4. （可选）清除PIE组应答位：如果使用了TI的PIE中断控制器，还需要清除对应PIE组的应答位，以允许该组后续中断的进入。

5. 与PWM及XBAR的联动配置实战

SDFM的强大之处在于它能与PWM模块、XBAR（交叉开关）无缝联动，构建纯硬件的快速保护路径。

5.1 通过XBAR实现硬件Trip路径

这是实现纳秒级保护的关键。以过流保护为例，配置步骤如下：

1. 在SDFM中配置比较器：设置合适的阈值（HLT1），使能比较器，并选择其输出事件（如COMPH1）作为CEVT1的来源。
2. 配置PWMXBAR：将SDFM产生的CEVT1OUT（或CEVT2OUT）事件，路由到目标PWM模块的Trip输入引脚。例如，将PWMXBAR.Out0的来源选择为SDFM1_CEVT1OUT，并将其目的地指向EPWM1.TripInput.1。
3. 配置ePWM的Trip子模块：在对应的ePWM模块中，使能该Trip输入（例如TZ1），并配置其动作（Cycle-by-Cycle或One-Shot），例如设置为“强制所有PWM输出为高阻态（Hi-Z）”。

这样，当电流超过阈值时，SDFM比较器在几个微秒内输出事件，该事件通过XBAR直接送达PWM的Trip端，PWM硬件在几十个纳秒内即可关闭驱动，完全无需CPU干预。这条路径的延迟极短，是保护功率器件的生命线。

5.2 同步采样与PWM的相位对齐

为了实现同步采样，需要配置ePWM模块在特定的时刻产生SDSYNC脉冲。

1. 选择同步源：在ePWM的时基子模块（TB）中，配置TBPHS和TBCTR的同步输出逻辑。通常，我们选择在TB计数器等于0（CTR=0）或等于周期值（CTR=TBPRD）时产生同步脉冲。
2. 输出同步信号：通过ePWM的同步输出链，将内部产生的同步事件输出到EPWMSYNCOUT信号上。
3. 路由至SDFM：通过PWMSYNCOUTXBAR和INPUTXBAR，将EPWMSYNCOUTx信号路由到SDFM模块的SDSYNC输入引脚。这可能需要多级XBAR配置。
4. 配置SDFM同步：在SDFM模块中，使能对应滤波器的同步功能（设置SDCTL.SYNCSEL等寄存器），并选择正确的同步源。

一个高级技巧是，在多相电机控制中，可以利用多个ePWM模块产生相位互差一定角度的SDSYNC信号，分别触发不同SDFM通道的采样，从而实现对各相电流的错相采样，均衡CPU的中断处理负载。

6. 常见问题排查与调试技巧实录

在实际调试中，SDFM的同步与中断配置容易遇到一些隐蔽的问题。以下是我总结的常见故障排查清单：

调试心得：在项目初期，建议采用“分步验证”法。先屏蔽所有中断和硬件Trip，专注于让SDFM能稳定输出正确的数据。可以通过轮询方式读取FIFO数据，并打印出来与已知的模拟输入对比。数据正确后，再使能数据就绪中断，验证中断响应和数据处理流程。接着，配置比较器，先连接到CPU中断，在软件中打印报警信息，验证阈值比较功能。最后，再打通XBAR到PWM的硬件Trip路径，并用一个可控制的过流信号进行实际保护测试。每一步都稳扎稳打，能极大降低整体调试的复杂度。

7. 理论计算与实际参数选择指南

理解SDFM输出数据的理论计算，对于校准和验证系统至关重要。技术手册提供了从模拟输入电压到最终数字输出的完整计算公式链。

第一步：计算比特流中‘1’的密度这取决于Σ-Δ调制器的输入电压和其最大差分输入范围（Vclipping）。例如，使用AMC1306x25调制器，其Vclipping = ±320mV。若输入电压（AINP - AINN）= 100mV，则密度 = (100mV + 320mV) / (2 * 320mV) = 0.65625。这个值代表了调制器输出比特流中高电平的比例。

第二步：计算比较器滤波器输出比较器滤波器的最大输出值取决于其类型（Sinc1/2/3/Fast）和COSR。例如，Sinc3滤波器在COSR=32时，其最大输出值为32,768（查表可得）。那么，对于上述输入，理论比较器输出值 = 0.65625 * 32768 ≈ 21504。这个值将用于与HLT/LLT阈值寄存器进行比较。

第三步：计算主数据滤波器输出主数据滤波器的计算类似，但使用其自身的DOSR。对于Sinc3，DOSR=100时，最大输出值为100^3 = 1,000,000。则32位输出值 = (100mV / 320mV) * 1,000,000 ≈ 312,500。如果配置为16位输出模式，通常还需要根据滤波器和OSR进行右移。例如，Sinc3在DOSR=100时可能需要右移5位，最终16位输出值 = 312,500 >> 5 = 9765。

参数选择经验：

• 数据滤波器DOSR选择：在电机FOC控制中，电流环带宽通常在几百Hz到几kHz。数据输出率应至少是电流环带宽的10倍以上（奈奎斯特采样定理），同时考虑控制周期。例如，20kHz开关频率，控制周期50μs。若选择Sinc3滤波器，其延迟为3 * DOSR / f_sdm_clk。为了在下一个PWM周期前得到数据，延迟必须小于50μs。假设f_sdm_clk=10MHz，则DOSR < (50μs * 10MHz) / 3 ≈ 166。在满足延迟要求下，选择最大的DOSR以获得最佳精度，例如DOSR=128或100。
• 比较器滤波器COSR选择：过流保护要求响应速度极快。假设要求保护响应时间小于5μs。对于Sinc1滤波器，延迟 =1 * COSR / f_sdm_clk。则COSR < 5μs * 10MHz = 50。可选择COSR=32，在速度和噪声抑制间取得平衡。同时，根据理论输出公式和设定的硬件保护点（如50A对应电压），反推出对应的数字阈值填入HLT寄存器。
• 数字滤波器参数选择：用于滤除可能持续数微秒的开关噪声毛刺。假设开关噪声脉冲宽度不超过1μs，系统时钟SYSCLK=200MHz。设置CLKPRESCALE=200，则数字滤波器采样周期为1μs。设置SAMPWIN=3（4个样本窗口），THRESH=3。这样，只有持续超过3μs（3个采样周期）的事件才会被确认，能有效滤除1μs的毛刺，同时对真实的过流信号（通常持续数十微秒以上）响应迅速。