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从内部电路看本质：拆解一块CPLD和FPGA，聊聊它们到底怎么‘编程’的

当你在电子市场上拿起一块CPLD或FPGA芯片时，它们看起来可能只是普通的黑色塑料封装。但在这层外壳之下，隐藏着两种截然不同的数字电路世界。作为一名硬件爱好者，我最近用显微镜拆解了几块典型器件，发现它们的内部结构差异远比参数表上的数字对比更有趣。今天，我们就从硅片层面出发，看看这些可编程器件究竟如何工作。

1. 显微镜下的结构差异

1.1 CPLD：乘积项的物理实现

在200倍显微镜下观察一款Altera MAX 7000系列CPLD，可以清晰地看到整齐排列的逻辑阵列块（LAB）。每个LAB包含16个宏单元，这些宏单元通过一个全局可编程互连阵列连接。最有趣的是，CPLD的核心——乘积项发生器实际上是由大量的AND-OR门阵列构成的物理电路。

关键观察点：

• 非易失性存储单元分布在逻辑单元之间，采用浮栅晶体管结构
• 金属熔丝或反熔丝技术形成的永久性连接
• 全局布线资源占比约30%，呈现规则的网格状分布

提示：CPLD的这种固定结构使其信号延迟可预测，典型传播延迟在5ns以内

1.2 FPGA：查找表的硅片舞蹈

切换到Xilinx Spartan-6 FPGA的显微图像，画面截然不同。你会看到成百上千个可配置逻辑块（CLB）像城市街区般排列，每个CLB包含两个切片（Slice）。放大到1000倍时，可以发现每个切片内部有：

// 典型的4输入LUT结构 module LUT4 (input [3:0] addr, output reg out); always @(*) begin case(addr) 4'b0000: out = mem[0]; // ... 其他15种组合 4'b1111: out = mem[15]; endcase end endmodule

这种基于SRAM的查找表（LUT）结构让FPGA能够模拟任何4输入逻辑函数。更惊人的是，在芯片边缘还能观察到Block RAM的规律阵列和DSP模块的特殊结构。

2. 配置技术的本质区别

2.1 CPLD的永久编程

CPLD的编程过程实际上是修改其内部非易失性存储单元的状态。以Flash-based CPLD为例：

1. 编程器施加高压（通常12V）到特定引脚
2. 电荷通过Fowler-Nordheim隧穿进入浮栅
3. 阈值电压永久改变，代表存储了"0"或"1"

典型编程参数：

2.2 FPGA的易失性配置

FPGA的配置过程则是完全不同的故事。上电时，外部配置存储器（通常是Flash或EEPROM）通过以下步骤加载配置数据：

# 典型的FPGA配置流程 1. POWER_ON -> 检测配置模式引脚 2. 初始化配置接口(SPI/JTAG) 3. 时钟同步数据传输 4. CRC校验配置数据 5. 启动用户逻辑

这个过程中，每个CLB中的SRAM单元被逐位填充，形成所需的逻辑功能映射。这也是为什么FPGA支持运行时重配置——本质上只是改写SRAM内容。

3. 结构差异带来的实际影响

3.1 启动时间对比

CPLD的启动优势来自于其非易失性存储特性：

• 上电即运行（<1ms）
• 无需外部配置器件
• 适合关键任务的即时响应

而FPGA的启动过程复杂得多：

3.2 功耗特性的底层原因

CPLD的低功耗优势源自：

• 静态功耗几乎为零（非易失性技术）
• 动态功耗仅来自开关活动
• 典型的待机电流<100μA

FPGA则面临SRAM的固有挑战：

# SRAM单元的静态功耗模型 def static_power(cell_count, leakage_current, voltage): return cell_count * leakage_current * voltage

以Artix-7为例，即使不做任何操作，数千万个SRAM单元的漏电流也会导致mA级的静态功耗。

4. 高级配置技巧与实践

4.1 CPLD的加密与保护

现代CPLD提供多重保护机制：

1. 编程文件加密（128位AES）
2. 熔断保护位（物理不可逆）
3. 读回禁止功能
4. 电压毛刺检测

注意：某些旧款CPLD使用UV擦除窗口，需避免阳光直射导致数据丢失

4.2 FPGA的部分重配置

Xilinx 7系列FPGA支持通过ICAP接口进行动态重构：

// 部分重配置示例代码 void reconfigure_frame(uint32_t frame_addr, uint32_t *data, int len) { icap_write(0xAA995566); // 同步头 icap_write(0x20000000); // 写命令 icap_write(frame_addr); // 目标帧地址 for(int i=0; i<len; i++) { icap_write(data[i]); // 配置数据 } }

这种技术可实现：

• 硬件功能动态切换
• 错误修复无需重启
• 多任务时分复用逻辑资源

拆解到硅片层面后，你会发现CPLD和FPGA的区别远不止于参数表上的数字。CPLD像精心设计的机械手表——可靠、精确但功能固定；FPGA则如同可编程的乐高积木——灵活多变但需要持续供电维持形态。选择哪种器件，最终取决于你的项目是否需要即时启动的确定性，还是运行时重构的灵活性。